本文介紹一種利用 EDA技術 和VHDL 語言 ,在max+PLUSⅡ環境下,設計了一種新型的智能密碼鎖。它體積小、功耗低、價格便宜、安全可靠,維護和升級都十分方便,具有較好的應用前景
標簽： VHDL PLUS EDA max
上傳時間： 2016-07-20
上傳用戶：咔樂塢
輸入十個整形數字求出最大值（如果輸入超過10個數輸出的max為前十位的最大值）
標簽： max 輸入 數字 輸出
上傳時間： 2014-07-27
上傳用戶：ainimao
max plus2設計的電子鐘 計算機iaji時間愛上佳潔士i好ikskas薩
標簽： ikskas plus2 iaji max
上傳時間： 2016-07-28
上傳用戶：luopoguixiong
這是一個在max II CPLD利用FT245BM 模塊實現USB傳輸的讀寫程序，用的是Verilog HDL語言
標簽： CPLD max 245 USB
上傳時間： 2014-01-01
上傳用戶：lingzhichao
max—PLUSII快速入門，適合初學著。
標簽： PLUSII max 快速入門
上傳時間： 2013-11-26
上傳用戶：電子世界
這是一個利用max PULL 制作的VHDL的全加器的程序 如果有需要仿真圖的 請叫站長聯系我
標簽： PULL VHDL max 全加器
上傳時間： 2016-07-30
上傳用戶：asdkin
這是一個利用max PULL 制作的VHDL的四位除法器的程序 如果有需要仿真圖的 請叫站長聯系我
標簽： PULL VHDL max 除法器
上傳用戶：1159797854
這是一個利用max PULL 制作的VHDL的四位全加器的程序 如果有需要仿真圖的 請叫站長聯系我
上傳時間： 2014-05-31
上傳用戶：lht618
這是一個利用max PULL 制作的VHDL的減法器的程序 如果有需要仿真圖的 請叫站長聯系我
標簽： PULL VHDL max 減法器
上傳時間： 2014-01-10
上傳用戶：baitouyu
用max+plusⅡ設計實現QPSK解調器。
標簽： plus QPSK max 設計實現
上傳時間： 2013-12-13
上傳用戶：xfbs821
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