大型設計中FPGA的多時鐘設計策略,希望有需要的人喜歡
標簽： FPGA 大型 多時鐘 策略
上傳時間： 2013-08-14
上傳用戶：zhichenglu
采用Altera公司的FPGA芯片，在MAX+plus II軟件平臺上實現多路HDLC電路
標簽： Altera FPGA HDLC plus
上傳時間： 2013-08-16
上傳用戶：ommshaggar
多款FPGA CPLD開發板的原理圖，很好的線路設計參考
標簽： FPGA CPLD 開發板 原理圖
上傳時間： 2013-08-18
上傳用戶：shanml
基于FPGA的多功能數字鐘的設計與實現 內附有詳盡的Verilog HDL源碼，其功能主要有：時間設置，時間顯示，跑表，分頻，日期設置，日期顯示等
標簽： Verilog FPGA HDL 多功能
上傳用戶：問題問題
PROTUES中簡單圖片顯示,請多提意見.謝謝!
標簽： PROTUES
上傳時間： 2013-08-20
上傳用戶：wawjj
多路18b20測溫顯示系統,可同時測量n個第三18b20
標簽： 18b20 多路 測溫 顯示系統
上傳時間： 2013-08-21
上傳用戶：zhangchu0807
關于FPGA的設計方面的諸多經驗總結，討論了設計方面應該注意的問題。
標簽： FPGA 方面 經驗
上傳用戶：onewq
多個Verilog和vhdl程序例子，可以作為初學者參考實例，按照電路結構寫出HDL代碼
標簽： Verilog vhdl 程序
上傳時間： 2013-08-26
上傳用戶：athjac
節點是網絡系統的基本控制單元，論文提出了一種基于CPLD和多處理器結構的控制網絡節點設計方案，它能夠提高單節點并行處理能力，其模塊化結構增強了節點的可靠性。
標簽： CPLD 多處理器 控制網絡 節點設計
上傳時間： 2013-08-31
上傳用戶：shanxiliuxu
基于CPLD的多功能信號發生器設計.PDF
標簽： CPLD 多功能 信號發生器
上傳時間： 2013-09-02
上傳用戶：lnnn30
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