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位同步時鐘

  • java用時鐘,行針時鐘而不是數位時鐘來的

    java用時鐘,行針時鐘而不是數位時鐘來的

    標簽: java

    上傳時間: 2015-05-08

    上傳用戶:希醬大魔王

  • 數位電子時鐘 用自製圖檔製成 不是用quartusII 內建的圖檔製成

    數位電子時鐘 用自製圖檔製成 不是用quartusII 內建的圖檔製成

    標簽: quartusII

    上傳時間: 2016-11-13

    上傳用戶:遠遠ssad

  • qt4-DigitalClock 源碼 數位時鐘

    qt4-DigitalClock 源碼 數位時鐘

    標簽: DigitalClock qt

    上傳時間: 2017-01-20

    上傳用戶:15736969615

  • 基于FPGA的海事衛星突發信號位同步檢測研究及實現.rar

    碼元定時恢復(位同步)技術是數字通信中的關鍵技術。位同步信號本身的抖動、錯位會直接降低通信設備的抗干擾性能,使誤碼率上升,甚至會使傳輸遭到完全破壞。尤其對于突發傳輸系統,快速、精確的定時同步算法是近年來研究的一個焦點。本文就是以Inmarsat GES/AES數據接收系統為背景,研究了突發通信傳輸模式下的全數字接收機中位同步方法,并予以實現。 本文系統地論述了位同步原理,在此基礎上著重研究了位同步的系統結構、碼元定時恢復算法以及衡量系統性能的各項指標,為后續工作奠定了基礎。 首先根據衛星系統突發信道傳輸的特點分析了傳統位同步方法在突發系統中的不足,接下來對Inmarsat系統的短突發R信道和長突發T信道的調制方式和幀結構做了細致的分析,并在Agilent ADS中進行了仿真。 在此基礎上提出了一種充分利用報頭前導比特信息的,由滑動平均、閾值判斷和累加求極值組成的快速報頭時鐘捕獲方法,此方法可快速精準地完成短突發形式下的位同步,并在FPGA上予以實現,效果良好。 在長突發形式下的報頭時鐘捕獲后還需要對后續數據進行位同步跟蹤,在跟蹤過程中本論文首先用DSP Builder實現了插值環路的位同步算法,進行了Matlab仿真和FPGA實現。并在插值環路的基礎上做出改進,提出了一種新的高效的基于移位算法的位同步方案并予以FPGA實現。最后將移位算法與插值算法進行了性能比較,證明該算法更適合于本項目中Inmarsat的長突發信道位同步跟蹤。 論文對兩個突發信道的位同步系統進行了理論研究、算法設計以及硬件實現的全過程,滿足系統要求。

    標簽: FPGA 海事衛星 信號

    上傳時間: 2013-04-24

    上傳用戶:yare

  • 海事衛星突發信號位同步檢測

    碼元定時恢復(位同步)技術是數字通信中的關鍵技術。位同步信號本身的抖動、錯位會直接降低通信設備的抗干擾性能,使誤碼率上升,甚至會使傳輸遭到完全破壞。尤其對于突發傳輸系統,快速、精確的定時同步算法是近年來研究的一個焦點。本文就是以Inmarsat GES/AES數據接收系統為背景,研究了突發通信傳輸模式下的全數字接收機中位同步方法,并予以實現。 本文系統地論述了位同步原理,在此基礎上著重研究了位同步的系統結構、碼元定時恢復算法以及衡量系統性能的各項指標,為后續工作奠定了基礎。 首先根據衛星系統突發信道傳輸的特點分析了傳統位同步方法在突發系統中的不足,接下來對Inmarsat系統的短突發R信道和長突發T信道的調制方式和幀結構做了細致的分析,并在Agilent ADS中進行了仿真。 在此基礎上提出了一種充分利用報頭前導比特信息的,由滑動平均、閾值判斷和累加求極值組成的快速報頭時鐘捕獲方法,此方法可快速精準地完成短突發形式下的位同步,并在FPGA上予以實現,效果良好。 在長突發形式下的報頭時鐘捕獲后還需要對后續數據進行位同步跟蹤,在跟蹤過程中本論文首先用DSP Builder實現了插值環路的位同步算法,進行了Matlab仿真和FPGA實現。并在插值環路的基礎上做出改進,提出了一種新的高效的基于移位算法的位同步方案并予以FPGA實現。最后將移位算法與插值算法進行了性能比較,證明該算法更適合于本項目中Inmarsat的長突發信道位同步跟蹤。 論文對兩個突發信道的位同步系統進行了理論研究、算法設計以及硬件實現的全過程,滿足系統要求。

    標簽: 海事衛星 信號 位同步 檢測

    上傳時間: 2013-04-24

    上傳用戶:zukfu

  • 基于FPGA的新型數據位同步時鐘提取(CDR)實現方法

    基于FPGA的新型數據位同步時鐘提取(CDR)實現方法

    標簽: FPGA CDR 數據 位同步時鐘

    上傳時間: 2013-08-28

    上傳用戶:huyahui

  • 一種可變位速率的位同步器的設計與仿真

    大部分傳統的位同步器是針對固定位速率遙測系統來設計的,這不能滿足一些可變位速率遙測接收機的需求。因此,提出一種基于FPGA實現的位同步器的設計,它能適應不同位速率的遙測系統。同時,對這種位同步器的實現進行了仿真,驗證其正確性和可實現性。

    標簽: 速率 位同步器 仿真

    上傳時間: 2013-11-01

    上傳用戶:qb1993225

  • 設計VHDL24小時的時鐘

    設計VHDL24小時的時鐘,去除了按鍵彈跳現象

    標簽: VHDL 24

    上傳時間: 2013-12-23

    上傳用戶:hzy5825468

  • 一個很好用的 lcd 時鐘程序 C語言 #include<reg51.h> #include<stdio.h> //定義計時器0 的重裝值 #define RELOAD

    一個很好用的 lcd 時鐘程序 C語言 #include<reg51.h> #include<stdio.h> //定義計時器0 的重裝值 #define RELOAD_HIGH 0x3C #define RELOAD_LOW 0xD2 //定義按鍵彈跳時間 #define DB_VAL //定義設置模式的最大時間間隔 #define TIMEOUT 200 //定義游標位置常數 #define HOME 0 #define HOUR 1 #define MIN 2 #define SEC 3

    標簽: include define RELOAD stdio

    上傳時間: 2014-12-19

    上傳用戶:zukfu

  • 通信中位同步的gardner算法的matlab仿真

    通信中位同步的gardner算法的matlab仿真

    標簽: gardner matlab 通信 位同步

    上傳時間: 2015-11-03

    上傳用戶:zhichenglu

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