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時(shí)頻

DDR記憶體電源

CMOS 邏輯系統的功耗主要與時脈頻率、系統內各閘極輸入電容及電源電壓有關，裝置尺寸縮小後，電源電壓也隨之降低，使得閘極大幅降低功耗。這種低電壓裝置擁有更低的功耗和更高的運作速度，因此系統時脈頻率可升高至 Ghz 範圍。

標簽： DDR 記憶體電源

上傳時間： 2013-10-14

上傳用戶：immanuel2006
使用VHDL設計一個適用於ETSI OFDM的時間和頻率同步處理器

使用VHDL設計一個適用於ETSI OFDM的時間和頻率同步處理器

標簽： VHDL ETSI OFDM

上傳時間： 2015-09-21

上傳用戶：luke5347
除頻code,只要修改數字並接上時脈,即可得到所要的頻率

除頻code,只要修改數字並接上時脈,即可得到所要的頻率

標簽： code 修改

上傳時間： 2013-12-13

上傳用戶：zmy123
Matlab時頻分析工具箱原始碼及其應用

Matlab時頻分析工具箱原始碼及其應用

標簽： Matlab 分工具箱

上傳時間： 2013-12-01

上傳用戶：hzy5825468
利用89s51去寫結構化keil-C 4x4鍵盤掃描+LCD螢幕顯示 HW01:四則運算+時鍾顯示 HW02:頻率偵測器 ps.鍵盤掃描不是利用延遲作彈跳(推薦)

利用89s51去寫結構化keil-C 4x4鍵盤掃描+LCD螢幕顯示 HW01:四則運算+時鍾顯示 HW02:頻率偵測器 ps.鍵盤掃描不是利用延遲作彈跳(推薦)

標簽： keil-C 89s51 HW 4x4

上傳時間： 2014-11-22

上傳用戶：zycidjl
altera Quartus II FSM使用可設定時間波形

altera Quartus II FSM使用可設定時間波形，手動調整波形頻率。 (含電路)

標簽： Quartus altera FSM II

上傳時間： 2016-02-13

上傳用戶：kbnswdifs
產生頻率選擇性衰落的雷利通道

產生頻率選擇性衰落的雷利通道，參數由天線結構、OFDM系統的結構與功率延時結構來決定。

標簽：

上傳時間： 2014-12-20

上傳用戶：lizhizheng88
FPGA可促進嵌入式系統設計改善即時應用性能

FPGA可促進嵌入式系統設計改善即時應用性能，臺灣人寫的，關于FPGA應用的技術文章

標簽： FPGA 嵌入式系統性能

上傳時間： 2013-08-20

上傳用戶：liuwei6419
傳輸線與電路觀點詳解

•1-1 傳輸線方程式 •1-2 傳輸線問題的時域分析 •1-3 正弦狀的行進波 •1-4 傳輸線問題的頻域分析 •1-5 駐波和駐波比 •1-6 Smith圖 •1-7 多段傳輸線問題的解法 •1-8 傳輸線的阻抗匹配

標簽： 傳輸線電路

上傳時間： 2013-11-21

上傳用戶：laomv123
傳輸線與電路觀點詳解

•1-1 傳輸線方程式 •1-2 傳輸線問題的時域分析 •1-3 正弦狀的行進波 •1-4 傳輸線問題的頻域分析 •1-5 駐波和駐波比 •1-6 Smith圖 •1-7 多段傳輸線問題的解法 •1-8 傳輸線的阻抗匹配

標簽： 傳輸線電路

上傳時間： 2013-10-21

上傳用戶：fhzm5658