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賽靈思 FPGA 設計時序

  • 資源大小:848 K
  • 上傳時間: 2016-12-14
  • 上傳用戶:bigbibby
  • 資源積分:2 下載積分
  • 標      簽: FPGA 賽靈思 計時

資 源 簡 介

賽靈思 FPGA 設計時序:作為賽靈思用戶論壇的定期訪客(見
http://forums.xilinx.com),我注意到新用
戶往往對時序收斂以及如何使用時序約束
來達到時序收斂感到困惑。為幫助 FPGA
設計新手實現時序收斂,讓我們來深入了
解時序約束以及如何利用時序約束實現
FPGA 設計的最優結果。

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