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直接數(shù)字頻率合成研究及其FPGA實現(xiàn)

  • 資源大小:1677 K
  • 上傳時間: 2013-04-24
  • 上傳用戶:faye3000
  • 資源積分:2 下載積分
  • 標(biāo)      簽: FPGA 數(shù)字頻率合成

資 源 簡 介

本文首先介紹了直接數(shù)字頻率合成技術(shù)(DDS)的基本原理、體系結(jié)構(gòu)及工作過程,然后針對其關(guān)鍵部分進(jìn)行了優(yōu)化,即采用函數(shù)近似法對存儲表結(jié)構(gòu)(LUT)進(jìn)行了優(yōu)化,使存貯位數(shù)大大縮小,并提出了一種雜散抑制技術(shù)的運用,即相位抖動技術(shù)。在對直接數(shù)字頻率合成(DDS)方法產(chǎn)生的信號進(jìn)行理論分析的過程中,用matlab進(jìn)行編程仿真作出了詳細(xì)的頻譜分析驗證。本文詳細(xì)的介紹了本次設(shè)計的具體實現(xiàn)過程和方法,將現(xiàn)場可編程邏輯器件(FPGA)和 DDS技術(shù)相結(jié)合,具體的體現(xiàn)了基于VHDL語言的靈活設(shè)計和修改方式是對傳統(tǒng)頻率合成實現(xiàn)方法的一次重要改進(jìn)。文章最后給出了實現(xiàn)代碼、仿真結(jié)果,經(jīng)過驗證,本設(shè)計能夠達(dá)到其預(yù)期性能指標(biāo)。

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