Verilog編寫的M序列發生器,希望能對大家帶來幫助。
資源簡介:Verilog編寫的M序列發生器,希望能對大家帶來幫助。
上傳時間: 2014-01-11
上傳用戶:zhliu007
資源簡介:利用matlab編寫的M序列發生器。內容參見《FPGA設計及應用》褚振勇編 西安電子科技大學出版社
上傳時間: 2016-08-31
上傳用戶:dongqiangqiang
資源簡介:·基于FPGA的M序列發生器實現
上傳時間: 2013-04-24
上傳用戶:gengxiaochao
資源簡介:一個典型的M序列發生器,生成M序列:1110010
上傳時間: 2014-01-03
上傳用戶:sevenbestfei
資源簡介:mSequence_generatorM序列發生器.rar是基于MATLAB編器的M序列發生器
上傳時間: 2014-02-07
上傳用戶:ruan2570406
資源簡介:基于51單片機實現的M序列發生器(偽隨機序列),在Keil編程環境下的源碼
上傳時間: 2016-10-21
上傳用戶:banyou
資源簡介:基于VHDL的M序列發生器~大家可以作為參考試用看
上傳時間: 2014-01-17
上傳用戶:playboys0
資源簡介:·?摘要:? 本文研究了由線性反饋移位寄存器(Linear Feedback Shift Registers,LFSR)生成M序列的原理,并對LFSR電路結構作了改進,利用基于現代DSP技術的DSP Builder軟件,設計了一種周期、相位可調的M序列發生器.經調試與仿真,結果表明該方法硬件結構簡單、開...
上傳時間: 2013-07-18
上傳用戶:fuzhoulinzexu
資源簡介:用Verilog編寫的一個簡單的產生偽隨機序列的代碼(M序列),比較實用。
上傳時間: 2017-06-27
上傳用戶:dave520l
資源簡介:Verilog編寫的狀態機檢測00100序列. 實現 input:...011000010010000... output:...000000000100100... 并且 用測試模塊來驗證狀態是否正確工作
上傳時間: 2015-07-14
上傳用戶:ggwz258
資源簡介:讓讀者對基于VHDL可編程M序列發生器有更深的了解
上傳時間: 2014-01-19
上傳用戶:2404
資源簡介:利用Matlab編寫求取4級移位寄存器的M序列 設初始序列為:1 1 1 1 通過一個四級的移位寄存器,其中在第三級有負反饋(一個模二加法),即將序列的第三位和第四位相加(如序列1 1 1 1經移位寄存器第一次移位后為0 1 1 1)的值再賦到第一位. 序列的周期為16.
上傳時間: 2016-02-14
上傳用戶:tfyt
資源簡介:利用Visual C++編寫M序列的生成以及利用給定的M序列采用采樣技術生成其他的不同的序列
上傳時間: 2014-11-28
上傳用戶:maizezhen
資源簡介:此函數實現了M序列發生器的matlab實現
上傳時間: 2014-01-15
上傳用戶:yuchunhai1990
資源簡介:使用Verilog編寫的同步FIFO,可通過設置程序中的DEPTH設置FIFO的深度,FIFO_WRITE_CLOCK上升沿向FIFO中寫入數據,\r\nFIFO_READ_CLOCK上升沿讀取數據。本程序對FIFO上層操作簡單實用。
上傳時間: 2013-08-12
上傳用戶:ljt101007
資源簡介:Verilog 編寫的I2c協議程序,用于cpld讀寫EEPROM
上傳時間: 2013-08-31
上傳用戶:csgcd001
資源簡介:用Verilog編寫的多功能數字鐘
上傳時間: 2015-02-25
上傳用戶:王者A
資源簡介:這是一個很好的Verilog 編寫的8位RISC CPU源碼(可做為MCU),并且包括完整的C 語言的測試代碼。
上傳時間: 2014-01-05
上傳用戶:李夢晗
資源簡介:Verilog編寫的32位浮點加法器
上傳時間: 2015-03-09
上傳用戶:372825274
資源簡介:Verilog編寫的全功能串口
上傳時間: 2014-02-11
上傳用戶:Breathe0125
資源簡介:Verilog編寫的計算百分比模塊
上傳時間: 2013-12-17
上傳用戶:wang0123456789
資源簡介:Verilog編寫的流水線模塊
上傳時間: 2015-03-09
上傳用戶:杜瑩12345
資源簡介:Verilog編寫的alu模塊
上傳時間: 2015-03-09
上傳用戶:qb1993225
資源簡介:加法器(使用Verilog編寫的),雖然簡單,但是這也是學習Verilog最基礎的東西!希望大家一起學習!
上傳時間: 2013-12-10
上傳用戶:410805624
資源簡介:用Verilog編寫的網卡芯片rtl級。前仿后仿都通過了,可以在modelsim上運行察看
上傳時間: 2015-03-31
上傳用戶:lxm
資源簡介:采用Verilog編寫的串口通信程序,采用了狀態機設計!程序簡單,消耗資源少
上傳時間: 2014-12-08
上傳用戶:yd19890720
資源簡介:M序列發生器(簡單型碼序列發生器-----simple shift register generator)
上傳時間: 2014-12-01
上傳用戶:dbs012280
資源簡介:matlab在系統辨識中的應用: 利用六級移位寄存器產生的M序列
上傳時間: 2015-05-17
上傳用戶:Late_Li
資源簡介:使用matlab編寫的PN序列函數,用來生成PN序列,里面有大量說明
上傳時間: 2013-12-12
上傳用戶:ommshaggar
資源簡介:一個非常簡單的cpu設計的原代碼,是用Verilog編寫的
上傳時間: 2014-12-08
上傳用戶:siguazgb