Verilog+HDL程序設(shè)計(jì)與實(shí)踐（云創(chuàng)工作室）.pdf
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資源簡(jiǎn)介：JAVA程序設(shè)計(jì)與實(shí)踐.rar
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資源簡(jiǎn)介：eetop.cn_Verilog HDL程序設(shè)計(jì)與實(shí)踐(xilinx)
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資源簡(jiǎn)介：XILINX大學(xué)合作教材-Verilog+HDL程序設(shè)計(jì)與實(shí)踐
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資源簡(jiǎn)介：開發(fā)板上已經(jīng)調(diào)試過的電梯控制器程序設(shè)計(jì)與仿真
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資源簡(jiǎn)介：開發(fā)板上已經(jīng)調(diào)試過的電子琴程序設(shè)計(jì)與仿真
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資源簡(jiǎn)介：《Verilog HDL程序設(shè)計(jì)與實(shí)踐》系統(tǒng)講解了Verilog HDL的基本語法和高級(jí)應(yīng)用技巧，對(duì)于每個(gè)知識(shí)點(diǎn)都按照開門見山、自頂向下的方式來組織內(nèi)容，在介紹相關(guān)知識(shí)點(diǎn)之前，先告訴讀者其出現(xiàn)的背景、本質(zhì)特征以及應(yīng)用場(chǎng)景，讓讀者不僅掌握基本語法，還能夠獲得深層次...
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資源簡(jiǎn)介：FPGA系統(tǒng)設(shè)計(jì)與實(shí)踐的VHDL程序代碼
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資源簡(jiǎn)介：電子電路設(shè)計(jì)與實(shí)踐
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資源簡(jiǎn)介：電子線路設(shè)計(jì)與實(shí)踐
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資源簡(jiǎn)介：專輯類-實(shí)用電子技術(shù)專輯-385冊(cè)-3.609G 電子電路設(shè)計(jì)與實(shí)踐-214頁(yè)-6.0M.pdf
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資源簡(jiǎn)介：51單片機(jī)程序設(shè)計(jì)與實(shí)驗(yàn)，51單片機(jī)程序設(shè)計(jì)與實(shí)驗(yàn)
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資源簡(jiǎn)介：西安交通大學(xué)電氣工程學(xué)院編寫的《電子系統(tǒng)設(shè)計(jì)與實(shí)踐》中的第7章節(jié)--電子系統(tǒng)設(shè)計(jì)設(shè)計(jì)實(shí)例，既有理論分析又有具體方案介紹，內(nèi)容有：簡(jiǎn)易數(shù)字頻率計(jì)、數(shù)字式工頻有效值多用表、存貯式數(shù)字式示波器、簡(jiǎn)易邏輯分析儀、低頻數(shù)字式相位測(cè)試儀、液體點(diǎn)滴速度監(jiān)控...
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