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在信息信號處理過程中,如對信號的過濾、檢測、預測等,都要使用濾波器,數字濾波器是數字信號處理(DSP,DigitalSignalProcessing)中使用最廣泛的一種器件。常用的濾波器有無限長單位脈沖響應(ⅡR)濾波器和有限長單位脈沖響應(FIR)濾波器兩種[1],其中,FIR濾波器能提供理想的線性相位響應,在整個頻帶上獲得常數群時延從而得到零失真輸出信號,同時它可以采用十分簡單的算法實現,這兩個優點使FIR濾波器成為明智的設計工程師的首選,在采用VHDL或verilogHDL等硬件描述語言設計數字濾波器時,由于程序的編寫往往不能達到良好優化而使濾波器性能表現一般。而采用調試好的IPCore需要向Altera公司購買。筆者采用了一種基于DSPBuilder的FPGA設計方法,使FIR濾波器設計較為簡單易行,并能滿足設計要求

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