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  上傳時間： 2013-10-08

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  上傳時間： 2013-12-24

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  上傳時間： 2013-12-23

  上傳用戶：稀世之寶039

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  標簽： 4046 CD 鎖相環技術

  上傳時間： 2013-10-27

  上傳用戶：gxm2052

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  標簽： 鎖相環 控制

  上傳時間： 2016-07-29

  上傳用戶：qoovoop

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  標簽： 高頻感應 加熱電源 模擬鎖相環 頻率

  上傳時間： 2013-08-22

  上傳用戶：nairui21

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  上傳時間： 2013-12-18

  上傳用戶：pkkkkp

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  上傳時間： 2014-01-11

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  上傳時間： 2013-12-19

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  上傳時間： 2022-06-11

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  上傳時間： 2013-07-25

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  上傳時間： 2013-07-13

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  上傳時間： 2013-04-24

  上傳用戶：461449632

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  上傳時間： 2013-06-10

  上傳用戶：yd19890720

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  上傳時間： 2013-04-24

  上傳用戶：變形金剛

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  上傳時間： 2013-07-06

  上傳用戶：LouieWu

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  上傳時間： 2013-06-09

  上傳用戶：mosliu

• 基于FPGA實現的一種新型數字鎖相環免費下載

  資源簡介：基于FPGA實現的一種新型數字鎖相環

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  上傳時間： 2013-08-07

  上傳用戶：2467478207

• 基于FPGA的全數字鎖相環設計免費下載

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  上傳時間： 2013-08-13

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  上傳時間： 2013-12-16

  上傳用戶：萍水相逢

• 基于FPGA的數字三相鎖相環的優化設計免費下載

  資源簡介：數字三相鎖相環中含有大量乘法運算和三角函數運算，占用大量的硬件邏輯資源。為此，提出一種數字三相鎖相環的優化實現方案，利用乘法模塊復用和CORDIC算法實現三角函數運算，并用Verilog HDL硬件描述語言對優化前后的算法進行了編碼實現。仿真和實驗結果表明...

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  上傳時間： 2013-11-15

  上傳用戶：yjj631

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  上傳時間： 2013-10-22

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• PLL是數字鎖相環設計源程序, 其中, Fi是輸入頻率(接收數據), Fo(Q5)是本地輸出頻率. 目的是從輸入數據中提取時鐘信號(Q5), 其頻率與數據速率一致, 時鐘上升沿鎖定在數據的上升和下降沿免費下載

  資源簡介：PLL是數字鎖相環設計源程序, 其中, Fi是輸入頻率(接收數據), Fo(Q5)是本地輸出頻率. 目的是從輸入數據中提取時鐘信號(Q5), 其頻率與數據速率一致, 時鐘上升沿鎖定在數據的上升和下降沿上；頂層文件是PLL.GDF

  標簽： 數據 Q5 PLL 輸入

  上傳時間： 2014-06-09

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• 用VHDL寫的數字鎖相環程序 pll.vhd為源文件 pllTB.vhd為testbench免費下載

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  上傳時間： 2014-01-20

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  上傳時間： 2015-04-12

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  上傳時間： 2015-06-13

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  上傳時間： 2013-12-29

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