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這是我個(gè)人寫(xiě)的DLX處理器流水線的Verilog代碼

  • 資源大小:10 K
  • 上傳時(shí)間: 2016-11-27
  • 上傳用戶(hù):granite518
  • 資源積分:2 下載積分
  • 標(biāo)      簽: Verilog DLX 處理器 代碼

資 源 簡(jiǎn) 介

這是我個(gè)人寫(xiě)的DLX處理器流水線的Verilog代碼,在ModelSim中仿真通過(guò),并且在ISE中能綜合!即可以下載到FPGA中運(yùn)行指令,指令可以根據(jù)需要定義,也可和相應(yīng)的編譯器配合使用,這里給學(xué)習(xí)流水線和Verilog的朋友共享。

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