100位計(jì)數(shù)器，匯編語(yǔ)言實(shí)驗(yàn)，很精準(zhǔn)的，計(jì)數(shù)從0到
資源簡(jiǎn)介：100位計(jì)數(shù)器，匯編語(yǔ)言實(shí)驗(yàn)，很精準(zhǔn)的，計(jì)數(shù)從0到
上傳時(shí)間： 2017-01-26
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資源簡(jiǎn)介：16位計(jì)數(shù)器的設(shè)計(jì)，這里是實(shí)現(xiàn)上述功能的VHDL源程序，供大家學(xué)習(xí)和討論。\r\n
上傳時(shí)間： 2013-09-05
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資源簡(jiǎn)介：可預(yù)置可逆4位計(jì)數(shù)器
上傳時(shí)間： 2014-12-25
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資源簡(jiǎn)介：一個(gè)可以計(jì)算階乘結(jié)果達(dá)到100位的程序一 個(gè)可以計(jì)算階乘結(jié)果達(dá)到100位的程序
上傳時(shí)間： 2015-04-23
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資源簡(jiǎn)介：可預(yù)置的8位計(jì)數(shù)器程序的主要部分分析 #include <AT89X51.H> //器件配置文件 #define uchar unsigned char //變量類型的宏定義 #define uint unsigned int uchar code SEG7[10]={0x03,0x9f,0x25,0x0d,0x99, //0~9的數(shù)碼管段碼 0x49,0x41,0x1f,0x01...
上傳時(shí)間： 2015-04-29
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資源簡(jiǎn)介：16位計(jì)數(shù)器的設(shè)計(jì)，這里是實(shí)現(xiàn)上述功能的VHDL源程序，供大家學(xué)習(xí)和討論。
上傳時(shí)間： 2013-12-20
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資源簡(jiǎn)介：可預(yù)置可逆4位計(jì)數(shù)器 利用AT89S51單片機(jī)的P1.0－P1.3接四個(gè)發(fā)光二極管L1－L4，用來(lái)指示當(dāng)前計(jì)數(shù)的數(shù)據(jù)；用P1.4－P1.7作為預(yù)置數(shù)據(jù)的輸入端，接四個(gè)撥動(dòng)開關(guān)K1－K4，用P3.6/WR和P3.7/RD端口接兩個(gè)輕觸開關(guān)，用來(lái)作加計(jì)數(shù)和減計(jì)數(shù)開關(guān)
上傳時(shí)間： 2014-01-15
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資源簡(jiǎn)介：風(fēng)格非常好 一六位計(jì)數(shù)器 無(wú)密碼 質(zhì)量很高
上傳時(shí)間： 2015-06-20
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資源簡(jiǎn)介：可預(yù)置的8位計(jì)數(shù)器程序的主要部分分析，用C語(yǔ)言開發(fā)！
上傳時(shí)間： 2015-08-13
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資源簡(jiǎn)介：一個(gè)不錯(cuò)的算法,計(jì)算圓周率的PI,快到100位了...好東東大家分享,不過(guò)程序雖短,很難看明白的
上傳時(shí)間： 2014-01-16
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資源簡(jiǎn)介：自己作課題用到的16位計(jì)數(shù)器，已經(jīng)過(guò)仿真試驗(yàn)，具有較好的計(jì)數(shù)準(zhǔn)確性。
上傳時(shí)間： 2015-08-16
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資源簡(jiǎn)介：本文件介紹的是用VerilogHDL語(yǔ)言設(shè)計(jì)分頻器和32位計(jì)數(shù)器.
上傳時(shí)間： 2013-12-15
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資源簡(jiǎn)介：世界帝王故事100篇,這里有古今中外的100位帝王的故事,你可以學(xué)到好多的知識(shí).
上傳時(shí)間： 2015-09-25
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資源簡(jiǎn)介：一位計(jì)數(shù)器，按p3.2數(shù)碼管加1，到9后回0,同時(shí)小喇叭響一下報(bào)警碼管數(shù)據(jù)p0,數(shù)碼管控制p2口,按鍵p3.2口 ，喇叭p3.3
上傳時(shí)間： 2015-11-07
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資源簡(jiǎn)介：8051單片機(jī)的一位計(jì)數(shù)器，按p3.2數(shù)碼管加1，到9后回0,同時(shí)小喇叭響一下報(bào)警
上傳時(shí)間： 2014-01-16
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資源簡(jiǎn)介：8051的6位計(jì)數(shù)器，按p3.2數(shù)碼管加1，到9后回0,同時(shí)小喇叭響一下報(bào)警
上傳時(shí)間： 2015-11-07
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資源簡(jiǎn)介：8位計(jì)數(shù)器，可逆，可加可減，可以以時(shí)鐘輸入也可手動(dòng)輸入
上傳時(shí)間： 2016-01-28
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資源簡(jiǎn)介：8位計(jì)數(shù)器的程序，CYPRESS公司生產(chǎn)的PSOC
上傳時(shí)間： 2013-12-23
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資源簡(jiǎn)介：16位計(jì)數(shù)器的計(jì)數(shù)程序，CYPRESS公司生產(chǎn)的PSOC。
上傳時(shí)間： 2014-01-18
上傳用戶：ggwz258
資源簡(jiǎn)介：24位計(jì)數(shù)器的計(jì)數(shù)程序，CYPRESS公司生產(chǎn)的PSOC。
上傳時(shí)間： 2013-12-26
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資源簡(jiǎn)介：32位計(jì)數(shù)器的計(jì)數(shù)程序，CYPRESS公司生產(chǎn)的PSOC。
上傳時(shí)間： 2014-01-09
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資源簡(jiǎn)介：用VHDL寫的帶有防抖動(dòng)功能的四位計(jì)數(shù)器
上傳時(shí)間： 2013-12-26
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資源簡(jiǎn)介：四位計(jì)數(shù)器 計(jì)數(shù)器是數(shù)字系統(tǒng)中用得較多的基本邏輯器件。它不僅能記錄輸入時(shí)鐘脈沖的個(gè)數(shù)，還可以實(shí)現(xiàn)分頻、定時(shí)、產(chǎn)生節(jié)拍脈沖和脈沖序列等。例如，計(jì)算機(jī)中的時(shí)序發(fā)生器、分頻器、指令計(jì)數(shù)器等都要使用計(jì)數(shù)器。
上傳時(shí)間： 2013-12-22
上傳用戶：maizezhen
資源簡(jiǎn)介：chdl 64位計(jì)數(shù)器，利用mif格式文件產(chǎn)生正弦波。可以在fpga模擬正弦波
上傳時(shí)間： 2016-07-17
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資源簡(jiǎn)介：包含了四位計(jì)數(shù)器等基本數(shù)字模塊的的verilog HDL程序代碼,該功能實(shí)現(xiàn),可以直接利用DC進(jìn)行綜合,得到硬件電路,亦能夠轉(zhuǎn)換成VHDL語(yǔ)言進(jìn)行綜合
上傳時(shí)間： 2013-12-19
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資源簡(jiǎn)介：題目：電子時(shí)鐘的設(shè)計(jì) 一、實(shí)驗(yàn)?zāi)康模? 1． 掌握多位計(jì)數(shù)器相連的設(shè)計(jì)方法。 2． 掌握十進(jìn)制、六十進(jìn)制、二十四進(jìn)制計(jì)數(shù)器的設(shè)計(jì)方法。 3． 繼續(xù)鞏固多位數(shù)碼管的驅(qū)動(dòng)及編碼。 4． 掌握揚(yáng)聲器的驅(qū)動(dòng) 5． 掌握EPLD技術(shù)的層次化設(shè)計(jì)方法 二、實(shí)驗(yàn)要求：...
上傳時(shí)間： 2013-12-23
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資源簡(jiǎn)介：一路24位計(jì)數(shù)器,cpu可直接讀寫計(jì)數(shù)器的計(jì)數(shù)值.
上傳時(shí)間： 2013-12-09
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資源簡(jiǎn)介：一中非常實(shí)用的單片機(jī)做的10000位計(jì)數(shù)器,可代替?zhèn)鹘y(tǒng)的專用計(jì)數(shù)器,可嵌入到其它系統(tǒng)使用.
上傳時(shí)間： 2017-04-07
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資源簡(jiǎn)介：可預(yù)置16位計(jì)數(shù)器可預(yù)置16位計(jì)數(shù)器可預(yù)置16位計(jì)數(shù)器
上傳時(shí)間： 2017-04-18
上傳用戶：米卡
資源簡(jiǎn)介：計(jì)算兩個(gè)100位大數(shù)的除法，結(jié)果保留100位小數(shù)
上傳時(shí)間： 2017-06-18
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