用ＦＰＧＡ實(shí)現(xiàn)非標(biāo)準(zhǔn)速率到標(biāo)準(zhǔn)速率轉(zhuǎn)換的實(shí)現(xiàn)方法．
資源簡(jiǎn)介：用ＦＰＧＡ實(shí)現(xiàn)非標(biāo)準(zhǔn)速率到標(biāo)準(zhǔn)速率轉(zhuǎn)換的實(shí)現(xiàn)方法．
上傳時(shí)間： 2016-03-07
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資源簡(jiǎn)介：E1與V.35標(biāo)準(zhǔn)說(shuō)明及E1與V.35信號(hào)轉(zhuǎn)換的實(shí)現(xiàn)方法。
上傳時(shí)間： 2015-03-12
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資源簡(jiǎn)介：用 ＦＰＧＡ 可編程器件和 ＶＨＤＬ 硬件描述語(yǔ)言來(lái)實(shí)現(xiàn) Ｆｌａｓｈ 編程器
上傳時(shí)間： 2017-05-24
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資源簡(jiǎn)介：從算法設(shè)計(jì)到硬線邏輯的實(shí)現(xiàn)——實(shí)驗(yàn)練習(xí)與Verilog語(yǔ)法手冊(cè)，與先前傳的《VerilogHDL教程》配合使用，Pdg格式，請(qǐng)用超星閱覽器打開(kāi)。
上傳時(shí)間： 2014-10-28
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資源簡(jiǎn)介：夏宇聞著作：從算法設(shè)計(jì)到硬線邏輯的實(shí)現(xiàn)，fpga經(jīng)驗(yàn)談，數(shù)字信號(hào)處理的FPGA實(shí)現(xiàn)
上傳時(shí)間： 2013-04-24
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資源簡(jiǎn)介：夏宇聞著作：從算法設(shè)計(jì)到硬線邏輯的實(shí)現(xiàn),講解比較詳細(xì)，是一本不錯(cuò)的參考資料
上傳時(shí)間： 2013-08-16
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資源簡(jiǎn)介：1. 實(shí)現(xiàn)BMP文件到JPEG文件的壓縮轉(zhuǎn)換。 2. 自選：實(shí)現(xiàn)從JPEG文件到BMP文件轉(zhuǎn)換。 3. 采用C/C++編寫程序
上傳時(shí)間： 2013-12-19
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資源簡(jiǎn)介：最短路徑算法,可以實(shí)現(xiàn)從一個(gè)站點(diǎn)到另一個(gè)站點(diǎn)的最短路徑搜尋
上傳時(shí)間： 2015-05-11
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資源簡(jiǎn)介：本原碼用VB2005演示了串口控制,多線程的實(shí)現(xiàn),程序性指
上傳時(shí)間： 2013-11-29
上傳用戶：牧羊人8920
資源簡(jiǎn)介：一個(gè)可以實(shí)現(xiàn)與SCADA系統(tǒng)實(shí)現(xiàn)數(shù)據(jù)訪問(wèn),并且通過(guò)手機(jī)短消息的方式發(fā)送到指定手機(jī)用戶的實(shí)現(xiàn).
上傳時(shí)間： 2015-10-03
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資源簡(jiǎn)介：用JAVA實(shí)現(xiàn)由中文字符向UNICODE編碼轉(zhuǎn)換的簡(jiǎn)單代碼.這是一個(gè)上課演示用過(guò)的
上傳時(shí)間： 2015-11-10
上傳用戶：lijianyu172
資源簡(jiǎn)介：用dom解析xml文件,讀到一顆Jtree 的樹(shù)中,可供初學(xué)者參考
上傳時(shí)間： 2013-12-02
上傳用戶：chens000
資源簡(jiǎn)介：可很方便的實(shí)現(xiàn)從算術(shù)表達(dá)式到四元式的翻譯,在編譯原理的課程設(shè)計(jì)中非常有用.
上傳時(shí)間： 2015-11-19
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資源簡(jiǎn)介：一本夏宇聞的著作：從算法設(shè)計(jì)到硬線邏輯的實(shí)現(xiàn)。
上傳時(shí)間： 2014-02-21
上傳用戶：siguazgb
資源簡(jiǎn)介：從算法設(shè)計(jì)到硬線邏輯的實(shí)現(xiàn) Verilog HDL牛人編寫的有關(guān)經(jīng)典書(shū)籍，其中包含很多例子
上傳時(shí)間： 2013-12-03
上傳用戶：R50974
資源簡(jiǎn)介：stc12c2052AD頭文件,用KEIL時(shí)直接找不到STC這個(gè)型號(hào)的.
上傳時(shí)間： 2016-01-14
上傳用戶：gengxiaochao
資源簡(jiǎn)介：從算法設(shè)計(jì)到硬線邏輯的實(shí)現(xiàn)：復(fù)雜數(shù)字邏輯系統(tǒng)的Verilog
上傳時(shí)間： 2016-03-09
上傳用戶：weixiao99
資源簡(jiǎn)介：針對(duì)嵌入式系統(tǒng)的底層網(wǎng)絡(luò)接口給出了一種由FPGA實(shí)現(xiàn)的以太網(wǎng)控制器的設(shè)計(jì)方法．該控制器能支持10Mbps和100Mbps的傳輸速率以及半雙工和全雙工模式，同時(shí)可提供MII接口，可并通過(guò)外接以太網(wǎng)物理層（PHY）芯片來(lái)實(shí)現(xiàn)網(wǎng)絡(luò)接入
上傳時(shí)間： 2013-12-11
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資源簡(jiǎn)介：用Eclipse里面的SWT控件對(duì)連接數(shù)據(jù)庫(kù)的實(shí)現(xiàn)
上傳時(shí)間： 2014-01-19
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資源簡(jiǎn)介：從算法設(shè)計(jì)到硬線邏輯的實(shí)現(xiàn) 關(guān)于算法和硬件邏輯的書(shū)籍
上傳時(shí)間： 2013-12-23
上傳用戶：zhoujunzhen
資源簡(jiǎn)介：從算法設(shè)計(jì)到硬線邏輯的實(shí)現(xiàn)：復(fù)雜數(shù)字邏輯系統(tǒng)的Verilog HDL設(shè)計(jì)技術(shù)和方法，結(jié)合DSP算法介紹verilog HdL 設(shè)計(jì)。
上傳時(shí)間： 2016-12-16
上傳用戶：xiaohuanhuan
資源簡(jiǎn)介：這是一個(gè)用VHDL實(shí)現(xiàn)SOBEL算子進(jìn)行圖像邊緣算法的實(shí)現(xiàn)
上傳時(shí)間： 2014-01-21
上傳用戶：小眼睛LSL
資源簡(jiǎn)介：夏宇聞著作：從算法設(shè)計(jì)到硬線邏輯的實(shí)現(xiàn),一共有九章的內(nèi)容,主要是關(guān)于VerilogHDL東西
上傳時(shí)間： 2013-12-21
上傳用戶：gououo
資源簡(jiǎn)介：夏宇聞著作：從算法設(shè)計(jì)到硬線邏輯的實(shí)現(xiàn),講解比較詳細(xì)，是一本不錯(cuò)的參考資料
上傳時(shí)間： 2014-01-23
上傳用戶：lepoke
資源簡(jiǎn)介：解決算法題目時(shí)常用的標(biāo)準(zhǔn)庫(kù)函數(shù)。有詳細(xì)的使用方法說(shuō)明哦。
上傳時(shí)間： 2014-11-22
上傳用戶：qazxsw
資源簡(jiǎn)介：本文對(duì)指針做了比較全面的介紹。指明了c語(yǔ)言中指針定義時(shí)的注意事項(xiàng)；給出了指針的數(shù)據(jù)類型以及指針在不同運(yùn)算過(guò)程中的實(shí)際含義；用實(shí)例詳細(xì)說(shuō)明了指針對(duì)動(dòng)態(tài)數(shù)組的實(shí)現(xiàn)；并介紹了指針在函數(shù)調(diào)用時(shí)的作用。
上傳時(shí)間： 2017-08-10
上傳用戶：nanshan
資源簡(jiǎn)介：從算法設(shè)計(jì)到硬線邏輯的實(shí)現(xiàn)
上傳時(shí)間： 2022-06-03
上傳用戶：ttalli
資源簡(jiǎn)介：linux下同一個(gè)進(jìn)程中多個(gè)定時(shí)器實(shí)現(xiàn)。簡(jiǎn)單描述下定時(shí)器模塊的實(shí)現(xiàn)，有一個(gè)manager單例類保存所有CTimer對(duì)象，開(kāi)啟一線程運(yùn)行延遲函數(shù)，每次延遲間隔到，掃描保存CTimer的容器，對(duì)每個(gè)CTimer對(duì)象執(zhí)行減少時(shí)間操作，減少到0則執(zhí)行回調(diào)函數(shù)。對(duì)一次性CTimer，超...
上傳時(shí)間： 2017-01-03
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資源簡(jiǎn)介：內(nèi)含有: 1.系統(tǒng)窗體模塊組成 2.數(shù)據(jù)模塊窗體設(shè)置 3.主窗體功能模塊的實(shí)現(xiàn) 4.入庫(kù)、出庫(kù)窗體模塊的實(shí)現(xiàn) 5. 查詢功能的實(shí)現(xiàn)
上傳時(shí)間： 2015-03-24
上傳用戶：sevenbestfei
資源簡(jiǎn)介：本程序利用vb實(shí)現(xiàn)了地理信息系統(tǒng)中空間分析的各種方法
上傳時(shí)間： 2014-08-09
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