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基于fpga和sopc的用VHDL語(yǔ)言編寫的EDA含異步清0和同步時(shí)鐘使能的加法計(jì)數(shù)器

  • 資源大小:35 K
  • 上傳時(shí)間: 2014-01-17
  • 上傳用戶:wjm197811
  • 資源積分:2 下載積分
  • 標(biāo)      簽: fpga VHDL sopc EDA

資 源 簡(jiǎn) 介

基于fpga和sopc的用VHDL語(yǔ)言編寫的EDA含異步清0和同步時(shí)鐘使能的加法計(jì)數(shù)器

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