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使用VerilogHDL語言實現(xiàn)硬件的開發(fā)模擬

  • 資源大小:209 K
  • 上傳時間: 2016-02-27
  • 上傳用戶:yzhowl
  • 資源積分:2 下載積分
  • 標(biāo)      簽: VerilogHDL 語言 硬件 模擬

資 源 簡 介

使用VerilogHDL語言實現(xiàn)硬件的開發(fā)模擬,本程序是實現(xiàn)靜態(tài)數(shù)碼管的模擬顯示

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