《Altera FPGA/CPLD設(shè)計（高級篇）（第2版）》結(jié)合作者多年工作經(jīng)驗，深入地討論了altera
fpga/cpld的設(shè)計和優(yōu)化技巧。在討論fpga/cpld設(shè)計指導(dǎo)原則的基礎(chǔ)上，介紹了altera器件的高級應(yīng)用；引領(lǐng)讀者學(xué)習(xí)邏輯鎖定設(shè)計工具，詳細討論了時序約束與靜態(tài)時序分析方法；結(jié)合實例討論如何進行設(shè)計優(yōu)化，介紹了altera的可編程器件的高級設(shè)計工具與系統(tǒng)級設(shè)計技巧。 本書附帶光盤中收錄了altera quartus ii web版軟件，讀者可以安裝使用，同時還收錄了本書所有實例的完整工程、源代碼和使用說明文件，便于讀者邊學(xué)邊練，提高實際應(yīng)用能力。第1章 可編程邏輯設(shè)計指導(dǎo)原則 第2章 Altera器件高級特性與應(yīng)用第3章 LogicLock設(shè)計方法.第4章 時序約束與時序分析 第5章 設(shè)計優(yōu)化第6章 Altera其他高級工具 第7章 FPGA系統(tǒng)級設(shè)計技術(shù)
標(biāo)簽：
fpga
cpld
上傳時間：
2022-06-13
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