本文主要介紹了50%占空比三分頻器的三種設(shè)計(jì)方法,并給出了圖形設(shè)計(jì)、VHDL設(shè)計(jì)、編譯結(jié)果和仿真結(jié)果。設(shè)計(jì)中采用EPM7064AETC44-7 CPLD,在QUARTUSⅡ4.2軟件平臺(tái)上進(jìn)行。
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