基于FPGA的衛(wèi)星數(shù)據(jù)地面接入系統(tǒng)設(shè)計(jì) - 免費(fèi)下載
技術(shù)資料資源
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衛(wèi)星技術(shù)的迅猛發(fā)展，信道容量的擴(kuò)大，要求地面系統(tǒng)能夠高速有效的對(duì)數(shù)據(jù)進(jìn)行實(shí)時(shí)處理，具有信息存儲(chǔ)、處理和轉(zhuǎn)發(fā)功能。同時(shí)衛(wèi)星通信系統(tǒng)能量與帶寬受限，采用FEC差錯(cuò)控制技術(shù)能有效的保證高效率、高傳輸碼率、低誤碼率的信息傳輸，這要求地面系統(tǒng)具備高速穩(wěn)定的糾錯(cuò)譯碼能力。 近年來(lái)可編程芯片(SoPC)推出和應(yīng)用，使得系統(tǒng)的設(shè)計(jì)變得更加靈活。目前國(guó)內(nèi)相關(guān)方面的研究和應(yīng)用相對(duì)較少，所以對(duì)可編程片上系統(tǒng)進(jìn)行研究也有著比較重要的意義。本課題目的是將地面系統(tǒng)的關(guān)鍵部分，包括同步、解擾、RS譯碼與以太網(wǎng)接入單元集中到一個(gè)可編程邏輯電路(PLD)芯片中，以便于減少芯片的數(shù)量，增加系統(tǒng)的可編程、可升級(jí)性。每個(gè)模塊以自頂向下(TOP-DOWN)的設(shè)計(jì)方法實(shí)現(xiàn)硬件描述語(yǔ)言的設(shè)計(jì)，然后將各設(shè)計(jì)集成到一個(gè)PLD芯片中。 本文結(jié)合衛(wèi)星數(shù)據(jù)傳輸中地面系統(tǒng)對(duì)數(shù)據(jù)處理速度要求高，以太網(wǎng)數(shù)據(jù)接入過(guò)程比較復(fù)雜的應(yīng)用需求，應(yīng)用微處理器IP core代替通用的處理器芯片，與硬件算法相結(jié)合，在FPGA內(nèi)設(shè)計(jì)實(shí)現(xiàn)了衛(wèi)星地面數(shù)據(jù)處理系統(tǒng)的主要功能。最后完成了譯碼電路硬件實(shí)現(xiàn)與以太網(wǎng)接入的軟件實(shí)現(xiàn)。
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