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基于FPGA的數字穩定校正單元的實現

  • 資源大小:980 K
  • 上傳時間: 2013-10-14
  • 上傳用戶:dragn
  • 資源積分:2 下載積分
  • 標      簽: FPGA 數字穩定校正

資 源 簡 介

  為了實現對非相干雷達的接收相參處理,基于數字穩定校正(DSU)的原理,采用ALTERA公司的StratixⅡ系列芯片和VHDL編程語言,設計了一種基于FPGA的DSU硬件實現方法。實驗結果表明基于FPGA的DSU方法可以提高程序的執行效率和系統的實時性,可實現非相參雷達的相參化功能。

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