?? lcdmpddr.fit.rpt
字號(hào):
; 2 ; 8 / 42 ( 19 % ) ; 3.3V ; -- ;
; 3 ; 0 / 45 ( 0 % ) ; 3.3V ; -- ;
; 4 ; 19 / 42 ( 45 % ) ; 3.3V ; -- ;
+----------+------------------+---------------+--------------+
+--------------------------------------------------------------------------------------------------------------------+
; All Package Pins ;
+----------+------------+----------+----------------+--------+--------------+---------+------------+-----------------+
; Location ; Pad Number ; I/O Bank ; Pin Name/Usage ; Dir. ; I/O Standard ; Voltage ; I/O Type ; User Assignment ;
+----------+------------+----------+----------------+--------+--------------+---------+------------+-----------------+
; 1 ; 0 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 2 ; 1 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 3 ; 2 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 4 ; 3 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 5 ; 4 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 6 ; 5 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 7 ; 6 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 8 ; 7 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 9 ; ; 1 ; VCCIO1 ; power ; ; 3.3V ; -- ; ;
; 10 ; ; 1 ; GND ; gnd ; ; ; -- ; ;
; 11 ; 8 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 12 ; 9 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 13 ; 10 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 14 ; 11 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 15 ; 12 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 16 ; 13 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 17 ; 14 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 18 ; 15 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 19 ; 16 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 20 ; 17 ; 1 ; promadr[0] ; output ; LVTTL ; ; Row I/O ; N ;
; 21 ; 18 ; 1 ; promadr[6] ; output ; LVTTL ; ; Row I/O ; N ;
; 22 ; ; 1 ; VCCIO1 ; power ; ; 3.3V ; -- ; ;
; 23 ; 28 ; 1 ; sel[0] ; input ; LVTTL ; ; Row I/O ; N ;
; 24 ; 29 ; 1 ; *~nCSO~ / GND* ; output ; LVTTL ; ; Row I/O ; N ;
; 25 ; 30 ; 1 ; ^DATA0 ; input ; ; ; -- ; ;
; 26 ; 31 ; 1 ; ^nCONFIG ; ; ; ; -- ; ;
; 27 ; ; 1 ; VCCA_PLL1 ; power ; ; 1.5V ; -- ; ;
; 28 ; 32 ; 1 ; GND+ ; ; ; ; Row I/O ; ;
; 29 ; 33 ; 1 ; sclk ; input ; LVTTL ; ; Row I/O ; N ;
; 30 ; ; 1 ; GNDA_PLL1 ; gnd ; ; ; -- ; ;
; 31 ; ; 1 ; GNDG_PLL1 ; gnd ; ; ; -- ; ;
; 32 ; 34 ; 1 ; ^nCEO ; ; ; ; -- ; ;
; 33 ; 35 ; 1 ; ^nCE ; ; ; ; -- ; ;
; 34 ; 36 ; 1 ; ^MSEL0 ; ; ; ; -- ; ;
; 35 ; 37 ; 1 ; ^MSEL1 ; ; ; ; -- ; ;
; 36 ; 38 ; 1 ; ^DCLK ; bidir ; ; ; -- ; ;
; 37 ; 39 ; 1 ; *~ASDO~ / GND* ; output ; LVTTL ; ; Row I/O ; N ;
; 38 ; 40 ; 1 ; sel[1] ; input ; LVTTL ; ; Row I/O ; N ;
; 39 ; 41 ; 1 ; sclkm ; input ; LVTTL ; ; Row I/O ; N ;
; 40 ; ; 1 ; GND ; gnd ; ; ; -- ; ;
; 41 ; 52 ; 1 ; prom_data[8] ; input ; LVTTL ; ; Row I/O ; N ;
; 42 ; 53 ; 1 ; clear ; input ; LVTTL ; ; Row I/O ; N ;
; 43 ; 54 ; 1 ; promadr[3] ; output ; LVTTL ; ; Row I/O ; N ;
; 44 ; 55 ; 1 ; db[7] ; output ; LVTTL ; ; Row I/O ; N ;
; 45 ; 56 ; 1 ; d_i ; output ; LVTTL ; ; Row I/O ; N ;
; 46 ; 57 ; 1 ; datai[7] ; input ; LVTTL ; ; Row I/O ; N ;
; 47 ; 58 ; 1 ; start ; input ; LVTTL ; ; Row I/O ; N ;
; 48 ; 59 ; 1 ; datai[3] ; input ; LVTTL ; ; Row I/O ; N ;
; 49 ; 60 ; 1 ; db[3] ; output ; LVTTL ; ; Row I/O ; N ;
; 50 ; 61 ; 1 ; prom_data[1] ; input ; LVTTL ; ; Row I/O ; N ;
; 51 ; ; 1 ; VCCIO1 ; power ; ; 3.3V ; -- ; ;
; 52 ; ; 1 ; GND ; gnd ; ; ; -- ; ;
; 53 ; 62 ; 1 ; datai[4] ; input ; LVTTL ; ; Row I/O ; N ;
; 54 ; 63 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 55 ; 64 ; 1 ; datai[6] ; input ; LVTTL ; ; Row I/O ; N ;
; 56 ; 65 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 57 ; 66 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 58 ; 67 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 59 ; 68 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 60 ; 69 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 61 ; 70 ; 4 ; GND* ; ; ; ; Column I/O ; ;
; 62 ; 71 ; 4 ; GND* ; ; ; ; Column I/O ; ;
; 63 ; 72 ; 4 ; prom_data[3] ; input ; LVTTL ; ; Column I/O ; N ;
; 64 ; 73 ; 4 ; GND* ; ; ; ; Column I/O ; ;
; 65 ; 74 ; 4 ; GND* ; ; ; ; Column I/O ; ;
; 66 ; 75 ; 4 ; prom_data[6] ; input ; LVTTL ; ; Column I/O ; N ;
; 67 ; 76 ; 4 ; db[4] ; output ; LVTTL ; ; Column I/O ; N ;
; 68 ; 77 ; 4 ; prom_data[4] ; input ; LVTTL ; ; Column I/O ; N ;
; 69 ; ; 1 ; GND ; gnd ; ; ; -- ; ;
; 70 ; ; 4 ; VCCIO4 ; power ; ; 3.3V ; -- ; ;
; 71 ; ; 1 ; GND ; gnd ; ; ; -- ; ;
; 72 ; ; ; VCCINT ; power ; ; 1.5V ; -- ; ;
; 73 ; 78 ; 4 ; tmdt ; output ; LVTTL ; ; Column I/O ; N ;
; 74 ; 79 ; 4 ; mode ; input ; LVTTL ; ; Column I/O ; N ;
; 75 ; 80 ; 4 ; db[0] ; output ; LVTTL ; ; Column I/O ; N ;
; 76 ; 81 ; 4 ; datai[0] ; input ; LVTTL ; ; Column I/O ; N ;
; 77 ; 82 ; 4 ; promadr[5] ; output ; LVTTL ; ; Column I/O ; N ;
; 78 ; 83 ; 4 ; prom_data[0] ; input ; LVTTL ; ; Column I/O ; N ;
; 79 ; 84 ; 4 ; db[6] ; output ; LVTTL ; ; Column I/O ; N ;
; 80 ; ; 1 ; GND ; gnd ; ; ; -- ; ;
; 81 ; ; ; VCCINT ; power ; ; 1.5V ; -- ; ;
; 82 ; 86 ; 4 ; prom_data[7] ; input ; LVTTL ; ; Column I/O ; N ;
; 83 ; 87 ; 4 ; datai[2] ; input ; LVTTL ; ; Column I/O ; N ;
; 84 ; 88 ; 4 ; prom_data[5] ; input ; LVTTL ; ; Column I/O ; N ;
; 85 ; 89 ; 4 ; db[1] ; output ; LVTTL ; ; Column I/O ; N ;
; 86 ; 90 ; 4 ; datai[5] ; input ; LVTTL ; ; Column I/O ; N ;
; 87 ; 91 ; 4 ; datai[1] ; input ; LVTTL ; ; Column I/O ; N ;
; 88 ; 92 ; 4 ; prom_data[2] ; input ; LVTTL ; ; Column I/O ; N ;
; 89 ; ; 1 ; GND ; gnd ; ; ; -- ; ;
; 90 ; ; ; VCCINT ; power ; ; 1.5V ; -- ; ;
; 91 ; ; 1 ; GND ; gnd ; ; ; -- ; ;
; 92 ; ; 4 ; VCCIO4 ; power ; ; 3.3V ; -- ; ;
; 93 ; 100 ; 4 ; db[5] ; output ; LVTTL ; ; Column I/O ; N ;
; 94 ; 103 ; 4 ; GND* ; ; ; ; Column I/O ; ;
; 95 ; 104 ; 4 ; GND* ; ; ; ; Column I/O ; ;
; 96 ; ; 1 ; GND ; gnd ; ; ; -- ; ;
; 97 ; ; ; VCCINT ; power ; ; 1.5V ; -- ; ;
; 98 ; 106 ; 4 ; GND* ; ; ; ; Column I/O ; ;
; 99 ; 107 ; 4 ; GND* ; ; ; ; Column I/O ; ;
; 100 ; 108 ; 4 ; GND* ; ; ; ; Column I/O ; ;
; 101 ; 109 ; 4 ; GND* ; ; ; ; Column I/O ; ;
; 102 ; ; 1 ; GND ; gnd ; ; ; -- ; ;
; 103 ; ; ; VCCINT ; power ; ; 1.5V ; -- ; ;
; 104 ; 118 ; 4 ; GND* ; ; ; ; Column I/O ; ;
; 105 ; 119 ; 4 ; GND* ; ; ; ; Column I/O ; ;
; 106 ; 120 ; 4 ; GND* ; ; ; ; Column I/O ; ;
; 107 ; 121 ; 4 ; GND* ; ; ; ; Column I/O ; ;
; 108 ; 122 ; 4 ; GND* ; ; ; ; Column I/O ; ;
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