?? clock.fit.rpt
字號:
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The pin-out file can be found in E:/Cindy/DevelopBoard/Mars-7128/示例程序/Verilog/綜合實驗/數字時鐘/clock.pin.
+---------------------------------------------------+
; Fitter Resource Usage Summary ;
+-------------------------------+-------------------+
; Resource ; Usage ;
+-------------------------------+-------------------+
; Logic cells ; 95 / 128 ( 74 % ) ;
; Registers ; 74 / 128 ( 57 % ) ;
; Number of pterms used ; 224 ;
; User inserted logic elements ; 0 ;
; I/O pins ; 22 / 68 ( 32 % ) ;
; -- Clock pins ; 1 / 2 ( 50 % ) ;
; -- Dedicated input pins ; 1 / 2 ( 50 % ) ;
; Global signals ; 2 ;
; Shareable expanders ; 4 / 128 ( 3 % ) ;
; Parallel expanders ; 8 / 120 ( 6 % ) ;
; Cells using turbo bit ; 95 / 128 ( 74 % ) ;
; Maximum fan-out node ; clk ;
; Maximum fan-out ; 74 ;
; Total fan-out ; 1584 ;
; Average fan-out ; 13.09 ;
+-------------------------------+-------------------+
+--------------------------------------------------------------------------------------------------------------------------------------------+
; Input Pins ;
+------+-------+----------+-----+-----------------------+--------------------+--------+----------------+--------------+----------------------+
; Name ; Pin # ; I/O Bank ; LAB ; Combinational Fan-Out ; Registered Fan-Out ; Global ; Input Register ; I/O Standard ; Location assigned by ;
+------+-------+----------+-----+-----------------------+--------------------+--------+----------------+--------------+----------------------+
; clk ; 83 ; -- ; -- ; 74 ; 0 ; yes ; no ; TTL ; User ;
; rst ; 1 ; -- ; -- ; 74 ; 0 ; yes ; no ; TTL ; User ;
+------+-------+----------+-----+-----------------------+--------------------+--------+----------------+--------------+----------------------+
+---------------------------------------------------------------------------------------------------------------------------------------------------------+
; Output Pins ;
+------------+-------+----------+-----+-----------------+----------------+------------+---------------+--------------+----------------------+-------------+
; Name ; Pin # ; I/O Bank ; LAB ; Output Register ; Slow Slew Rate ; Open Drain ; TRI Primitive ; I/O Standard ; Location assigned by ; Load ;
+------------+-------+----------+-----+-----------------+----------------+------------+---------------+--------------+----------------------+-------------+
; dataout[0] ; 61 ; -- ; 6 ; no ; no ; no ; no ; TTL ; User ; Unspecified ;
; dataout[1] ; 64 ; -- ; 7 ; no ; no ; no ; no ; TTL ; User ; Unspecified ;
; dataout[2] ; 56 ; -- ; 6 ; no ; no ; no ; no ; TTL ; User ; Unspecified ;
; dataout[3] ; 58 ; -- ; 6 ; no ; no ; no ; no ; TTL ; User ; Unspecified ;
; dataout[4] ; 60 ; -- ; 6 ; no ; no ; no ; no ; TTL ; User ; Unspecified ;
; dataout[5] ; 63 ; -- ; 7 ; no ; no ; no ; no ; TTL ; User ; Unspecified ;
; dataout[6] ; 55 ; -- ; 6 ; no ; no ; no ; no ; TTL ; User ; Unspecified ;
; dataout[7] ; 57 ; -- ; 6 ; no ; no ; no ; no ; TTL ; User ; Unspecified ;
; en[0] ; 75 ; -- ; 8 ; no ; no ; no ; no ; TTL ; User ; Unspecified ;
; en[1] ; 74 ; -- ; 8 ; no ; no ; no ; no ; TTL ; User ; Unspecified ;
; en[2] ; 73 ; -- ; 8 ; no ; no ; no ; no ; TTL ; User ; Unspecified ;
; en[3] ; 70 ; -- ; 7 ; no ; no ; no ; no ; TTL ; User ; Unspecified ;
; en[4] ; 69 ; -- ; 7 ; no ; no ; no ; no ; TTL ; User ; Unspecified ;
; en[5] ; 68 ; -- ; 7 ; no ; no ; no ; no ; TTL ; User ; Unspecified ;
; en[6] ; 67 ; -- ; 7 ; no ; no ; no ; no ; TTL ; User ; Unspecified ;
; en[7] ; 65 ; -- ; 7 ; no ; no ; no ; no ; TTL ; User ; Unspecified ;
+------------+-------+----------+-----+-----------------+----------------+------------+---------------+--------------+----------------------+-------------+
+-------------------------------------------------------------------------------------------------------+
; All Package Pins ;
+----------+------------+----------+----------------+--------+--------------+---------+-----------------+
; Location ; Pad Number ; I/O Bank ; Pin Name/Usage ; Dir. ; I/O Standard ; Voltage ; User Assignment ;
+----------+------------+----------+----------------+--------+--------------+---------+-----------------+
; 1 ; 0 ; -- ; rst ; input ; TTL ; ; Y ;
; 2 ; 1 ; -- ; GND+ ; ; ; ; ;
; 3 ; 2 ; -- ; VCCINT ; power ; ; 5.0V ; ;
; 4 ; 3 ; -- ; RESERVED_INPUT ; ; ; ; ;
; 5 ; 4 ; -- ; RESERVED_INPUT ; ; ; ; ;
; 6 ; 5 ; -- ; RESERVED_INPUT ; ; ; ; ;
; 7 ; 6 ; -- ; GND ; gnd ; ; ; ;
; 8 ; 7 ; -- ; RESERVED_INPUT ; ; ; ; ;
; 9 ; 8 ; -- ; RESERVED_INPUT ; ; ; ; ;
; 10 ; 9 ; -- ; RESERVED_INPUT ; ; ; ; ;
; 11 ; 10 ; -- ; RESERVED_INPUT ; ; ; ; ;
; 12 ; 11 ; -- ; RESERVED_INPUT ; ; ; ; ;
; 13 ; 12 ; -- ; VCCIO ; power ; ; 5.0V ; ;
; 14 ; 13 ; -- ; +TDI ; input ; TTL ; ; N ;
; 15 ; 14 ; -- ; RESERVED_INPUT ; ; ; ; ;
; 16 ; 15 ; -- ; RESERVED_INPUT ; ; ; ; ;
; 17 ; 16 ; -- ; RESERVED_INPUT ; ; ; ; ;
; 18 ; 17 ; -- ; RESERVED_INPUT ; ; ; ; ;
; 19 ; 18 ; -- ; GND ; gnd ; ; ; ;
; 20 ; 19 ; -- ; RESERVED_INPUT ; ; ; ; ;
; 21 ; 20 ; -- ; RESERVED_INPUT ; ; ; ; ;
; 22 ; 21 ; -- ; RESERVED_INPUT ; ; ; ; ;
; 23 ; 22 ; -- ; +TMS ; input ; TTL ; ; N ;
; 24 ; 23 ; -- ; RESERVED_INPUT ; ; ; ; ;
; 25 ; 24 ; -- ; RESERVED_INPUT ; ; ; ; ;
; 26 ; 25 ; -- ; VCCIO ; power ; ; 5.0V ; ;
; 27 ; 26 ; -- ; RESERVED_INPUT ; ; ; ; ;
; 28 ; 27 ; -- ; RESERVED_INPUT ; ; ; ; ;
; 29 ; 28 ; -- ; RESERVED_INPUT ; ; ; ; ;
; 30 ; 29 ; -- ; RESERVED_INPUT ; ; ; ; ;
; 31 ; 30 ; -- ; RESERVED_INPUT ; ; ; ; ;
; 32 ; 31 ; -- ; GND ; gnd ; ; ; ;
; 33 ; 32 ; -- ; RESERVED_INPUT ; ; ; ; ;
; 34 ; 33 ; -- ; RESERVED_INPUT ; ; ; ; ;
; 35 ; 34 ; -- ; RESERVED_INPUT ; ; ; ; ;
; 36 ; 35 ; -- ; RESERVED_INPUT ; ; ; ; ;
; 37 ; 36 ; -- ; RESERVED_INPUT ; ; ; ; ;
; 38 ; 37 ; -- ; VCCIO ; power ; ; 5.0V ; ;
; 39 ; 38 ; -- ; RESERVED_INPUT ; ; ; ; ;
; 40 ; 39 ; -- ; RESERVED_INPUT ; ; ; ; ;
; 41 ; 40 ; -- ; RESERVED_INPUT ; ; ; ; ;
; 42 ; 41 ; -- ; GND ; gnd ; ; ; ;
; 43 ; 42 ; -- ; VCCINT ; power ; ; 5.0V ; ;
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