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?? overflow_test.flow.rpt

?? 基于FPGA的技術溢出研究程序
?? RPT
字號:
Flow report for overflow_test
Fri Jun 29 01:28:50 2007
Version 6.0 Build 202 06/20/2006 Service Pack 1 SJ Full Version


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; Table of Contents ;
---------------------
  1. Legal Notice
  2. Flow Summary
  3. Flow Settings
  4. Flow Non-Default Global Settings
  5. Flow Elapsed Time
  6. Flow Log



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; Legal Notice ;
----------------
Copyright (C) 1991-2006 Altera Corporation
Your use of Altera Corporation's design tools, logic functions 
and other software and tools, and its AMPP partner logic 
functions, and any output files any of the foregoing 
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programming logic devices manufactured by Altera and sold by 
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+------------------------------------------------------------------------------------+
; Flow Summary                                                                       ;
+------------------------------------+-----------------------------------------------+
; Flow Status                        ; Successful - Fri Jun 29 01:28:50 2007         ;
; Quartus II Version                 ; 6.0 Build 202 06/20/2006 SP 1 SJ Full Version ;
; Revision Name                      ; overflow_test                                 ;
; Top-level Entity Name              ; overflow_test                                 ;
; Family                             ; Cyclone II                                    ;
; Device                             ; EP2C5T144C8                                   ;
; Timing Models                      ; Final                                         ;
; Met timing requirements            ; Yes                                           ;
; Total logic elements               ; 32 / 4,608 ( < 1 % )                          ;
; Total registers                    ; 32                                            ;
; Total pins                         ; 26 / 89 ( 29 % )                              ;
; Total virtual pins                 ; 0                                             ;
; Total memory bits                  ; 0 / 119,808 ( 0 % )                           ;
; Embedded Multiplier 9-bit elements ; 0 / 26 ( 0 % )                                ;
; Total PLLs                         ; 0 / 2 ( 0 % )                                 ;
+------------------------------------+-----------------------------------------------+


+-----------------------------------------+
; Flow Settings                           ;
+-------------------+---------------------+
; Option            ; Setting             ;
+-------------------+---------------------+
; Start date & time ; 06/29/2007 01:28:33 ;
; Main task         ; Compilation         ;
; Revision Name     ; overflow_test       ;
+-------------------+---------------------+


+--------------------------------------------------------------------+
; Flow Non-Default Global Settings                                   ;
+-----------------+-------+---------------+-------------+------------+
; Assignment Name ; Value ; Default Value ; Entity Name ; Section Id ;
+-----------------+-------+---------------+-------------+------------+


+-------------------------------------+
; Flow Elapsed Time                   ;
+----------------------+--------------+
; Module Name          ; Elapsed Time ;
+----------------------+--------------+
; Analysis & Synthesis ; 00:00:02     ;
; Fitter               ; 00:00:07     ;
; Assembler            ; 00:00:03     ;
; Timing Analyzer      ; 00:00:01     ;
; Total                ; 00:00:13     ;
+----------------------+--------------+


------------
; Flow Log ;
------------
quartus_map --read_settings_files=on --write_settings_files=off overflow_test -c overflow_test
quartus_fit --read_settings_files=off --write_settings_files=off overflow_test -c overflow_test
quartus_asm --read_settings_files=off --write_settings_files=off overflow_test -c overflow_test
quartus_tan --read_settings_files=off --write_settings_files=off overflow_test -c overflow_test --timing_analysis_only



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