?? data_mux.fit.rpt
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Fitter report for data_mux
Mon Jul 17 22:48:42 2006
Version 4.2 Build 157 12/07/2004 SJ Full Version
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; Table of Contents ;
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1. Legal Notice
2. Fitter Summary
3. Fitter Settings
4. Fitter Device Options
5. Fitter Equations
6. Pin-Out File
7. Fitter Resource Usage Summary
8. Input Pins
9. Output Pins
10. All Package Pins
11. I/O Standard
12. Dedicated Inputs I/O
13. Output Pin Default Load For Reported TCO
14. Fitter Resource Utilization by Entity
15. Non-Global High Fan-Out Signals
16. Interconnect Usage Summary
17. LAB Macrocells
18. Parallel Expander
19. Logic Cell Interconnection
20. Fitter Messages
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; Legal Notice ;
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Copyright (C) 1991-2004 Altera Corporation
Any megafunction design, and related netlist (encrypted or decrypted),
support information, device programming or simulation file, and any other
associated documentation or information provided by Altera or a partner
under Altera's Megafunction Partnership Program may be used only
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licensors. No other licenses, including any licenses needed under any third
party's intellectual property, are provided herein.
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; Fitter Summary ;
+-----------------------+------------------------------------------+
; Fitter Status ; Successful - Mon Jul 17 22:48:42 2006 ;
; Quartus II Version ; 4.2 Build 157 12/07/2004 SJ Full Version ;
; Revision Name ; data_mux ;
; Top-level Entity Name ; data_mux ;
; Family ; MAX7000S ;
; Device ; EPM7032SLC44-5 ;
; Timing Models ; Final ;
; Total macrocells ; 8 / 32 ( 25 % ) ;
; Total pins ; 35 / 36 ( 97 % ) ;
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+--------------------------------------------------------------------------------------+
; Fitter Settings ;
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; Option ; Setting ; Default Value ;
+--------------------------------------------+--------------------+--------------------+
; Device ; AUTO ; ;
; Use smart compilation ; Normal ; Normal ;
; Optimize Timing ; Normal compilation ; Normal compilation ;
; Optimize IOC Register Placement for Timing ; On ; On ;
; Limit to One Fitting Attempt ; Off ; Off ;
; Fitter Initial Placement Seed ; 1 ; 1 ;
; Slow Slew Rate ; Off ; Off ;
; Fitter Effort ; Auto Fit ; Auto Fit ;
+--------------------------------------------+--------------------+--------------------+
+----------------------------------------------------------------------------------------+
; Fitter Device Options ;
+----------------------------------------------+-----------------------------------------+
; Option ; Setting ;
+----------------------------------------------+-----------------------------------------+
; Enable user-supplied start-up clock (CLKUSR) ; Off ;
; Enable device-wide reset (DEV_CLRn) ; Off ;
; Enable device-wide output enable (DEV_OE) ; Off ;
; Enable INIT_DONE output ; Off ;
; Configuration scheme ; Passive Serial ;
; Reserve all unused pins ; As output driving an unspecified signal ;
; Security bit ; Off ;
; Base pin-out file on sameframe device ; Off ;
+----------------------------------------------+-----------------------------------------+
+------------------+
; Fitter Equations ;
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The equations can be found in E:/戴仙金/資料/Verilog書/源代碼/cymometer/data_mux/data_mux.fit.eqn.
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; Pin-Out File ;
+--------------+
The pin-out file can be found in E:/戴仙金/資料/Verilog書/源代碼/cymometer/data_mux/data_mux.pin.
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; Fitter Resource Usage Summary ;
+-------------------------------+------------------+
; Resource ; Usage ;
+-------------------------------+------------------+
; Logic cells ; 8 / 32 ( 25 % ) ;
; Registers ; 0 / 32 ( 0 % ) ;
; Number of pterms used ; 24 ;
; User inserted logic elements ; 0 ;
; I/O pins ; 35 / 36 ( 97 % ) ;
; -- Clock pins ; 2 / 2 ( 100 % ) ;
; -- Dedicated input pins ; 2 / 2 ( 100 % ) ;
; Global signals ; 0 ;
; Shareable expanders ; 0 / 32 ( 0 % ) ;
; Parallel expanders ; 4 / 30 ( 13 % ) ;
; Cells using turbo bit ; 8 / 32 ( 25 % ) ;
; Maximum fan-out node ; disp_select[2] ;
; Maximum fan-out ; 8 ;
; Total fan-out ; 56 ;
; Average fan-out ; 1.30 ;
+-------------------------------+------------------+
+------------------------------------------------------------------------------------------------------------------------------------------------------+
; Input Pins ;
+----------------+-------+----------+-----+-----------------------+--------------------+--------+----------------+--------------+----------------------+
; Name ; Pin # ; I/O Bank ; LAB ; Combinational Fan-Out ; Registered Fan-Out ; Global ; Input Register ; I/O Standard ; Location assigned by ;
+----------------+-------+----------+-----+-----------------------+--------------------+--------+----------------+--------------+----------------------+
; A0[0] ; 29 ; -- ; 2 ; 1 ; 0 ; no ; no ; TTL ; Fitter ;
; A0[1] ; 18 ; -- ; 1 ; 1 ; 0 ; no ; no ; TTL ; Fitter ;
; A0[2] ; 19 ; -- ; 1 ; 1 ; 0 ; no ; no ; TTL ; Fitter ;
; A0[3] ; 25 ; -- ; 2 ; 1 ; 0 ; no ; no ; TTL ; Fitter ;
; A1[0] ; 37 ; -- ; 2 ; 1 ; 0 ; no ; no ; TTL ; Fitter ;
; A1[1] ; 34 ; -- ; 2 ; 1 ; 0 ; no ; no ; TTL ; Fitter ;
; A1[2] ; 12 ; -- ; 1 ; 1 ; 0 ; no ; no ; TTL ; Fitter ;
; A1[3] ; 31 ; -- ; 2 ; 1 ; 0 ; no ; no ; TTL ; Fitter ;
; A2[0] ; 4 ; -- ; 1 ; 1 ; 0 ; no ; no ; TTL ; Fitter ;
; A2[1] ; 43 ; -- ; -- ; 1 ; 0 ; no ; no ; TTL ; Fitter ;
; A2[2] ; 40 ; -- ; 2 ; 1 ; 0 ; no ; no ; TTL ; Fitter ;
; A2[3] ; 1 ; -- ; -- ; 1 ; 0 ; no ; no ; TTL ; Fitter ;
; A3[0] ; 2 ; -- ; -- ; 1 ; 0 ; no ; no ; TTL ; Fitter ;
; A3[1] ; 28 ; -- ; 2 ; 1 ; 0 ; no ; no ; TTL ; Fitter ;
; A3[2] ; 27 ; -- ; 2 ; 1 ; 0 ; no ; no ; TTL ; Fitter ;
; A3[3] ; 26 ; -- ; 2 ; 1 ; 0 ; no ; no ; TTL ; Fitter ;
; A4[0] ; 36 ; -- ; 2 ; 1 ; 0 ; no ; no ; TTL ; Fitter ;
; A4[1] ; 9 ; -- ; 1 ; 1 ; 0 ; no ; no ; TTL ; Fitter ;
; A4[2] ; 39 ; -- ; 2 ; 1 ; 0 ; no ; no ; TTL ; Fitter ;
; A4[3] ; 6 ; -- ; 1 ; 1 ; 0 ; no ; no ; TTL ; Fitter ;
; A5[0] ; 20 ; -- ; 1 ; 1 ; 0 ; no ; no ; TTL ; Fitter ;
; A5[1] ; 17 ; -- ; 1 ; 1 ; 0 ; no ; no ; TTL ; Fitter ;
; A5[2] ; 16 ; -- ; 1 ; 1 ; 0 ; no ; no ; TTL ; Fitter ;
; A5[3] ; 33 ; -- ; 2 ; 1 ; 0 ; no ; no ; TTL ; Fitter ;
; disp_select[0] ; 44 ; -- ; -- ; 8 ; 0 ; no ; no ; TTL ; Fitter ;
; disp_select[1] ; 21 ; -- ; 1 ; 8 ; 0 ; no ; no ; TTL ; Fitter ;
; disp_select[2] ; 24 ; -- ; 2 ; 8 ; 0 ; no ; no ; TTL ; Fitter ;
+----------------+-------+----------+-----+-----------------------+--------------------+--------+----------------+--------------+----------------------+
+-------------------------------------------------------------------------------------------------------------------------------------+
; Output Pins ;
+------+-------+----------+-----+-----------------+----------------+------------+---------------+--------------+----------------------+
; Name ; Pin # ; I/O Bank ; LAB ; Output Register ; Slow Slew Rate ; Open Drain ; TRI Primitive ; I/O Standard ; Location assigned by ;
+------+-------+----------+-----+-----------------+----------------+------------+---------------+--------------+----------------------+
; Q[0] ; 5 ; -- ; 1 ; no ; no ; no ; no ; TTL ; Fitter ;
; Q[1] ; 8 ; -- ; 1 ; no ; no ; no ; no ; TTL ; Fitter ;
; Q[2] ; 14 ; -- ; 1 ; no ; no ; no ; no ; TTL ; Fitter ;
; Q[3] ; 11 ; -- ; 1 ; no ; no ; no ; no ; TTL ; Fitter ;
+------+-------+----------+-----+-----------------+----------------+------------+---------------+--------------+----------------------+
+-------------------------------------------------------------------------------------------------------+
; All Package Pins ;
+----------+------------+----------+----------------+--------+--------------+---------+-----------------+
; Location ; Pad Number ; I/O Bank ; Pin Name/Usage ; Dir. ; I/O Standard ; Voltage ; User Assignment ;
+----------+------------+----------+----------------+--------+--------------+---------+-----------------+
; 1 ; 0 ; -- ; A2[3] ; input ; TTL ; ; N ;
; 2 ; 1 ; -- ; A3[0] ; input ; TTL ; ; N ;
; 3 ; 2 ; -- ; VCC ; power ; ; ; ;
; 4 ; 3 ; -- ; A2[0] ; input ; TTL ; ; N ;
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