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?? 以兩種結構編寫的VHDL驅動LED 已通過調試
?? RPT
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字號:
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+----------------------------------------------------------------------------+
; LAB External Interconnect                                                  ;
+----------------------------------------------+-----------------------------+
; LAB External Interconnects  (Average = 5.38) ; Number of LABs  (Total = 3) ;
+----------------------------------------------+-----------------------------+
; 0 - 1                                        ; 5                           ;
; 2 - 3                                        ; 0                           ;
; 4 - 5                                        ; 0                           ;
; 6 - 7                                        ; 1                           ;
; 8 - 9                                        ; 0                           ;
; 10 - 11                                      ; 1                           ;
; 12 - 13                                      ; 0                           ;
; 14 - 15                                      ; 0                           ;
; 16 - 17                                      ; 0                           ;
; 18 - 19                                      ; 0                           ;
; 20 - 21                                      ; 0                           ;
; 22 - 23                                      ; 0                           ;
; 24 - 25                                      ; 0                           ;
; 26 - 27                                      ; 1                           ;
+----------------------------------------------+-----------------------------+


+----------------------------------------------------------------------+
; LAB Macrocells                                                       ;
+----------------------------------------+-----------------------------+
; Number of Macrocells  (Average = 3.63) ; Number of LABs  (Total = 3) ;
+----------------------------------------+-----------------------------+
; 0                                      ; 5                           ;
; 1                                      ; 0                           ;
; 2                                      ; 0                           ;
; 3                                      ; 0                           ;
; 4                                      ; 1                           ;
; 5                                      ; 0                           ;
; 6                                      ; 0                           ;
; 7                                      ; 0                           ;
; 8                                      ; 0                           ;
; 9                                      ; 1                           ;
; 10                                     ; 0                           ;
; 11                                     ; 0                           ;
; 12                                     ; 0                           ;
; 13                                     ; 0                           ;
; 14                                     ; 0                           ;
; 15                                     ; 0                           ;
; 16                                     ; 1                           ;
+----------------------------------------+-----------------------------+


+-------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Logic Cell Interconnection                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                              ;
+-----+------------+--------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+---------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; LAB ; Logic Cell ; Input                                                                                                                                                                                                                                                                                                                                                              ; Output                                                                                                                                                                                                                                                                                                                                                                          ;
+-----+------------+--------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+---------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
;  A  ; LC1        ; clkq, ledx:u1|temp[1], ledx:u1|temp[0]                                                                                                                                                                                                                                                                                                                             ; ledx:u1|temp[0], ledx:u1|temp[1], ledx:u1|temp[2], ledx:u1|temp[3], ledx:u1|temp[4], ledx:u1|temp[8], ledx:u1|temp[5], ledx:u1|temp[9], ledx:u1|temp[16], ledx:u1|temp[6], ledx:u1|temp[10], ledx:u1|temp[17], ledx:u1|temp[7], ledx:u1|temp[11], ledx:u1|temp[18], ledx:u1|temp[12], ledx:u1|temp[13], ledx:u1|temp[14], ledx:u1|temp[15], ledx:u1|temp[19], ledx:u1|clk~73bal ;
;  A  ; LC2        ; clkq, ledx:u1|temp[2], ledx:u1|temp[1], ledx:u1|temp[0]                                                                                                                                                                                                                                                                                                            ; ledx:u1|temp[0], ledx:u1|temp[2], ledx:u1|temp[3], ledx:u1|temp[4], ledx:u1|temp[8], ledx:u1|temp[5], ledx:u1|temp[9], ledx:u1|temp[16], ledx:u1|temp[6], ledx:u1|temp[10], ledx:u1|temp[17], ledx:u1|temp[7], ledx:u1|temp[11], ledx:u1|temp[18], ledx:u1|temp[12], ledx:u1|temp[13], ledx:u1|temp[14], ledx:u1|temp[15], ledx:u1|temp[19], ledx:u1|clk~73bal                  ;
;  A  ; LC3        ; clkq, ledx:u1|temp[3], ledx:u1|temp[2], ledx:u1|temp[1], ledx:u1|temp[0]                                                                                                                                                                                                                                                                                           ; ledx:u1|temp[0], ledx:u1|temp[3], ledx:u1|temp[4], ledx:u1|temp[8], ledx:u1|temp[5], ledx:u1|temp[9], ledx:u1|temp[16], ledx:u1|temp[6], ledx:u1|temp[10], ledx:u1|temp[17], ledx:u1|temp[7], ledx:u1|temp[11], ledx:u1|temp[18], ledx:u1|temp[12], ledx:u1|temp[13], ledx:u1|temp[14], ledx:u1|temp[15], ledx:u1|temp[19], ledx:u1|clk~73bal                                   ;
;  A  ; LC4        ; clkq, ledx:u1|temp[4], ledx:u1|temp[3], ledx:u1|temp[2], ledx:u1|temp[1], ledx:u1|temp[0]                                                                                                                                                                                                                                                                          ; ledx:u1|temp[0], ledx:u1|temp[4], ledx:u1|temp[8], ledx:u1|temp[5], ledx:u1|temp[9], ledx:u1|temp[16], ledx:u1|temp[6], ledx:u1|temp[10], ledx:u1|temp[17], ledx:u1|temp[7], ledx:u1|temp[11], ledx:u1|temp[18], ledx:u1|temp[12], ledx:u1|temp[13], ledx:u1|temp[14], ledx:u1|temp[15], ledx:u1|temp[19], ledx:u1|clk~73bal                                                    ;
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;  A  ; LC5        ; clkq, ledx:u1|temp[4], ledx:u1|temp[3], ledx:u1|temp[2], ledx:u1|temp[1], ledx:u1|temp[0], ledx:u1|temp[5]                                                                                                                                                                                                                                                         ; ledx:u1|temp[0], ledx:u1|temp[8], ledx:u1|temp[5], ledx:u1|temp[9], ledx:u1|temp[16], ledx:u1|temp[6], ledx:u1|temp[10], ledx:u1|temp[17], ledx:u1|temp[7], ledx:u1|temp[11], ledx:u1|temp[18], ledx:u1|temp[12], ledx:u1|temp[13], ledx:u1|temp[14], ledx:u1|temp[15], ledx:u1|temp[19], ledx:u1|clk~73bal                                                                     ;
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;  C  ; LC44       ; clkq, ledx:u1|temp[14], ledx:u1|temp[13], ledx:u1|temp[12], ledx:u1|temp[11], ledx:u1|temp[10], ledx:u1|temp[9], ledx:u1|temp[6], ledx:u1|temp[7], ledx:u1|temp[4], ledx:u1|temp[5], ledx:u1|temp[3], ledx:u1|temp[2], ledx:u1|temp[0], ledx:u1|temp[1], ledx:u1|temp[8], ledx:u1|temp[15]                                                                         ; ledx:u1|temp[0], ledx:u1|temp[16], ledx:u1|temp[17], ledx:u1|temp[18], ledx:u1|temp[15], ledx:u1|temp[19], ledx:u1|clk~73bal                                                                                                                                                                                                                                                    ;
;  C  ; LC36       ; clkq, ledx:u1|temp[18], ledx:u1|temp[17], ledx:u1|temp[14], ledx:u1|temp[15], ledx:u1|temp[12], ledx:u1|temp[13], ledx:u1|temp[10], ledx:u1|temp[11], ledx:u1|temp[8], ledx:u1|temp[9], ledx:u1|temp[6], ledx:u1|temp[7], ledx:u1|temp[4], ledx:u1|temp[5], ledx:u1|temp[3], ledx:u1|temp[2], ledx:u1|temp[0], ledx:u1|temp[1], ledx:u1|temp[16]                   ; ledx:u1|temp[0], ledy:u2|temp[0], ledy:u2|temp[1], ledy:u2|temp[2], ledy:u2|temp[3], ledy:u2|temp[4], ledy:u2|temp[5], ledy:u2|temp[6], ledy:u2|temp[7]                                                                                                                                                                                                                         ;
;  C  ; LC38       ; ledy:u2|temp[7], rst, ledx:u1|clk~73bal, ledx:u1|temp[19]                                                                                                                                                                                                                                                                                                          ; q1[0], ledy:u2|temp[1]                                                                                                                                                                                                                                                                                                                                                          ;
;  C  ; LC37       ; ledy:u2|temp[0], rst, ledx:u1|clk~73bal, ledx:u1|temp[19]                                                                                                                                                                                                                                                                                                          ; q1[1], ledy:u2|temp[2]                                                                                                                                                                                                                                                                                                                                                          ;
;  C  ; LC35       ; ledy:u2|temp[1], rst, ledx:u1|clk~73bal, ledx:u1|temp[19]                                                                                                                                                                                                                                                                                                          ; q1[2], ledy:u2|temp[3]                                                                                                                                                                                                                                                                                                                                                          ;
;  C  ; LC33       ; ledy:u2|temp[2], rst, ledx:u1|clk~73bal, ledx:u1|temp[19]                                                                                                                                                                                                                                                                                                          ; q1[3], ledy:u2|temp[4]                                                                                                                                                                                                                                                                                                                                                          ;
;  C  ; LC40       ; ledx:u1|temp[3], ledx:u1|temp[2], ledx:u1|temp[1], ledx:u1|temp[0], ledx:u1|temp[4], ledx:u1|temp[5], ledx:u1|temp[6], ledx:u1|temp[7], ledx:u1|temp[8], ledx:u1|temp[9], ledx:u1|temp[10], ledx:u1|temp[11], ledx:u1|temp[12], ledx:u1|temp[13], ledx:u1|temp[14], ledx:u1|temp[15], ledx:u1|temp[16], ledx:u1|temp[17], ledx:u1|temp[18]                         ; ledy:u2|temp[0], ledy:u2|temp[1], ledy:u2|temp[2], ledy:u2|temp[3], ledy:u2|temp[4], ledy:u2|temp[5], ledy:u2|temp[6], ledy:u2|temp[7]                                                                                                                                                                                                                                          ;
;  D  ; LC64       ; ledy:u2|temp[3], rst, ledx:u1|clk~73bal, ledx:u1|temp[19]                                                                                                                                                                                                                                                                                                          ; q1[4], ledy:u2|temp[5]                                                                                                                                                                                                                                                                                                                                                          ;
;  D  ; LC62       ; ledy:u2|temp[4], rst, ledx:u1|clk~73bal, ledx:u1|temp[19]                                                                                                                                                                                                                                                                                                          ; q1[5], ledy:u2|temp[6]                                                                                                                                                                                                                                                                                                                                                          ;
;  D  ; LC61       ; ledy:u2|temp[5], rst, ledx:u1|clk~73bal, ledx:u1|temp[19]                                                                                                                                                                                                                                                                                                          ; q1[6], ledy:u2|temp[7]                                                                                                                                                                                                                                                                                                                                                          ;
;  D  ; LC59       ; ledy:u2|temp[6], rst, ledx:u1|clk~73bal, ledx:u1|temp[19]                                                                                                                                                                                                                                                                                                          ; ledy:u2|temp[0], q1[7]                                                                                                                                                                                                                                                                                                                                                          ;
+-----+------------+--------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+---------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+


+----------------------------------------------------------------------------------------+
; Fitter Device Options                                                                  ;
+----------------------------------------------+-----------------------------------------+
; Option                                       ; Setting                                 ;
+----------------------------------------------+-----------------------------------------+
; Enable user-supplied start-up clock (CLKUSR) ; Off                                     ;
; Enable device-wide reset (DEV_CLRn)          ; Off                                     ;
; Enable device-wide output enable (DEV_OE)    ; Off                                     ;
; Enable INIT_DONE output                      ; Off                                     ;
; Configuration scheme                         ; Passive Serial                          ;
; Reserve all unused pins                      ; As output driving an unspecified signal ;
; Security bit                                 ; Off                                     ;
; Base pin-out file on sameframe device        ; Off                                     ;
+----------------------------------------------+-----------------------------------------+


+-----------------+
; Fitter Messages ;
+-----------------+
Info: *******************************************************************
Info: Running Quartus II Fitter
    Info: Version 6.0 Build 178 04/27/2006 SJ Full Version
    Info: Processing started: Thu Jan 17 13:57:27 2008
Info: Command: quartus_fit --read_settings_files=off --write_settings_files=off led -c led
Info: Selected device EPM3128ATC100-10 for design "led"
Info: Quartus II Fitter was successful. 0 errors, 0 warnings
    Info: Processing ended: Thu Jan 17 13:57:28 2008
    Info: Elapsed time: 00:00:01


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