?? dds.fit.rpt
字號:
; 120 ; 96 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 121 ; 97 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 122 ; 98 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 123 ; 99 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 124 ; 100 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 125 ; 101 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 126 ; 102 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 127 ; 103 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 128 ; 104 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 129 ; 105 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 130 ; 106 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 131 ; 107 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 132 ; 108 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 133 ; 109 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 134 ; 110 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 135 ; ; ; VCCINT ; power ; ; 1.5V ; -- ; ; -- ; -- ;
; 136 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; 137 ; ; 2 ; VCCIO2 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; 138 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; 139 ; 111 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 140 ; 112 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 141 ; 113 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 142 ; 114 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 143 ; 115 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 144 ; 116 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
+----------+------------+----------+-------------------------------------------+--------+--------------+---------+------------+-----------------+----------+--------------+
+------------------------------------------------------------------+
; Output Pin Default Load For Reported TCO ;
+---------------------+-------+------------------------------------+
; I/O Standard ; Load ; Termination Resistance ;
+---------------------+-------+------------------------------------+
; LVTTL ; 10 pF ; Not Available ;
; LVCMOS ; 10 pF ; Not Available ;
; 2.5 V ; 10 pF ; Not Available ;
; 1.8 V ; 10 pF ; Not Available ;
; 1.5 V ; 10 pF ; Not Available ;
; SSTL-3 Class I ; 30 pF ; 50 Ohm (Parallel), 25 Ohm (Serial) ;
; SSTL-3 Class II ; 30 pF ; 25 Ohm (Parallel), 25 Ohm (Serial) ;
; SSTL-2 Class I ; 30 pF ; 50 Ohm (Parallel), 25 Ohm (Serial) ;
; SSTL-2 Class II ; 30 pF ; 25 Ohm (Parallel), 25 Ohm (Serial) ;
; Differential SSTL-2 ; 10 pF ; (See SSTL-2) ;
; LVDS ; 4 pF ; 100 Ohm (Differential) ;
; RSDS ; 10 pF ; 100 Ohm (Differential) ;
+---------------------+-------+------------------------------------+
Note: User assignments will override these defaults. The user specified values are listed in the Output Pins and Bidir Pins tables.
+-------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Fitter Resource Utilization by Entity ;
+---------------------------------------------------------------------------------------------------+-------------+--------------+-------------+------+------+--------------+--------------+-------------------+------------------+-----------------+------------+--------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Compilation Hierarchy Node ; Logic Cells ; LC Registers ; Memory Bits ; M4Ks ; Pins ; Virtual Pins ; LUT-Only LCs ; Register-Only LCs ; LUT/Register LCs ; Carry Chain LCs ; Packed LCs ; Full Hierarchy Name ;
+---------------------------------------------------------------------------------------------------+-------------+--------------+-------------+------+------+--------------+--------------+-------------------+------------------+-----------------+------------+--------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; |dds ; 670 (1) ; 575 ; 47104 ; 12 ; 19 ; 0 ; 95 (1) ; 215 (0) ; 360 (0) ; 97 (0) ; 55 (0) ; |dds ;
; |add_fcw:inst| ; 20 (20) ; 20 ; 0 ; 0 ; 0 ; 0 ; 0 (0) ; 10 (10) ; 10 (10) ; 10 (10) ; 0 (0) ; |dds|add_fcw:inst ;
; |add_pcw:inst1| ; 10 (10) ; 10 ; 0 ; 0 ; 0 ; 0 ; 0 (0) ; 0 (0) ; 10 (10) ; 10 (10) ; 0 (0) ; |dds|add_pcw:inst1 ;
; |delta:inst6| ; 0 (0) ; 0 ; 2048 ; 1 ; 0 ; 0 ; 0 (0) ; 0 (0) ; 0 (0) ; 0 (0) ; 0 (0) ; |dds|delta:inst6 ;
; |altsyncram:altsyncram_component| ; 0 (0) ; 0 ; 2048 ; 1 ; 0 ; 0 ; 0 (0) ; 0 (0) ; 0 (0) ; 0 (0) ; 0 (0) ; |dds|delta:inst6|altsyncram:altsyncram_component ;
; |altsyncram_hq31:auto_generated| ; 0 (0) ; 0 ; 2048 ; 1 ; 0 ; 0 ; 0 (0) ; 0 (0) ; 0 (0) ; 0 (0) ; 0 (0) ; |dds|delta:inst6|altsyncram:altsyncram_component|altsyncram_hq31:auto_generated ;
; |delta:inst9| ; 0 (0) ; 0 ; 2048 ; 1 ; 0 ; 0 ; 0 (0) ; 0 (0) ; 0 (0) ; 0 (0) ; 0 (0) ; |dds|delta:inst9 ;
; |altsyncram:altsyncram_component| ; 0 (0) ; 0 ; 2048 ; 1 ; 0 ; 0 ; 0 (0) ; 0 (0) ; 0 (0) ; 0 (0) ; 0 (0) ; |dds|delta:inst9|altsyncram:altsyncram_component ;
; |altsyncram_hq31:auto_generated| ; 0 (0) ; 0 ; 2048 ; 1 ; 0 ; 0 ; 0 (0) ; 0 (0) ; 0 (0) ; 0 (0) ; 0 (0) ; |dds|delta:inst9|altsyncram:altsyncram_component|altsyncram_hq31:auto_generated ;
; |fangbo:inst10| ; 9 (9) ; 9 ; 0 ; 0 ; 0 ; 0 ; 0 (0) ; 0 (0) ; 9 (9) ; 8 (8) ; 0 (0) ; |dds|fangbo:inst10 ;
; |frediv:inst13| ; 6 (6) ; 5 ; 0 ; 0 ; 0 ; 0 ; 1 (1) ; 0 (0) ; 5 (5) ; 0 (0) ; 0 (0) ; |dds|frediv:inst13 ;
; |frediv:inst14| ; 6 (6) ; 5 ; 0 ; 0 ; 0 ; 0 ; 1 (1) ; 0 (0) ; 5 (5) ; 0 (0) ; 0 (0) ; |dds|frediv:inst14 ;
; |juchi_address:inst8| ; 8 (8) ; 8 ; 0 ; 0 ; 0 ; 0 ; 0 (0) ; 8 (8) ; 0 (0) ; 0 (0) ; 0 (0) ; |dds|juchi_address:inst8 ;
; |keyscan:inst16| ; 24 (24) ; 19 ; 0 ; 0 ; 0 ; 0 ; 5 (5) ; 0 (0) ; 19 (19) ; 16 (16) ; 0 (0) ; |dds|keyscan:inst16 ;
; |selectwave:inst11| ; 8 (8) ; 0 ; 0 ; 0 ; 0 ; 0 ; 8 (8) ; 0 (0) ; 0 (0) ; 0 (0) ; 0 (0) ; |dds|selectwave:inst11 ;
; |sin_add:inst2| ; 9 (9) ; 9 ; 0 ; 0 ; 0 ; 0 ; 0 (0) ; 1 (1) ; 8 (8) ; 0 (0) ; 0 (0) ; |dds|sin_add:inst2 ;
; |sin_out:inst4| ; 8 (8) ; 8 ; 0 ; 0 ; 0 ; 0 ; 0 (0) ; 0 (0) ; 8 (8) ; 0 (0) ; 0 (0) ; |dds|sin_out:inst4 ;
; |sinrom:inst3| ; 0 (0) ; 0 ; 2048 ; 0 ; 0 ; 0 ; 0 (0) ; 0 (0) ; 0 (0) ; 0 (0) ; 0 (0) ; |dds|sinrom:inst3 ;
; |altsyncram:altsyncram_component| ; 0 (0) ; 0 ; 2048 ; 0 ; 0 ; 0 ; 0 (0) ; 0 (0) ; 0 (0) ; 0 (0) ; 0 (0) ; |dds|sinrom:inst3|altsyncram:altsyncram_component ;
; |altsyncram_hk31:auto_generated| ; 0 (0) ; 0 ; 2048 ; 0 ; 0 ; 0 ; 0 (0) ; 0 (0) ; 0 (0) ; 0 (0) ; 0 (0) ; |dds|sinrom:inst3|altsyncram:altsyncram_component|altsyncram_hk31:auto_generated ;
; |sld_hub:sld_hub_inst| ; 107 (25) ; 73 ; 0 ; 0 ; 0 ; 0 ; 34 (18) ; 13 (0) ; 60 (7) ; 5 (0) ; 5 (5) ; |dds|sld_hub:sld_hub_inst ;
; |lpm_decode:instruction_decoder| ; 5 (0) ; 5 ; 0 ; 0 ; 0 ; 0 ; 0 (0) ; 0 (0) ; 5 (0) ; 0 (0) ; 0 (0) ; |dds|sld_hub:sld_hub_inst|lpm_decode:instruction_decoder ;
; |decode_ogi:auto_generated| ; 5 (5) ; 5 ; 0 ; 0 ; 0 ; 0 ; 0 (0) ; 0 (0) ; 5 (5) ; 0 (0) ; 0 (0) ; |dds|sld_hub:sld_hub_inst|lpm_decode:instruction_decoder|decode_ogi:auto_generated ;
; |lpm_shiftreg:jtag_ir_register| ; 10 (10) ; 10 ; 0 ; 0 ; 0 ; 0 ; 0 (0) ; 8 (8) ; 2 (2) ; 0 (0) ; 0 (0) ; |dds|sld_hub:sld_hub_inst|lpm_shiftreg:jtag_ir_register ;
; |sld_dffex:BROADCAST| ; 1 (1) ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 (0) ; 0 (0) ; 1 (1) ; 0 (0) ; 0 (0) ; |dds|sld_hub:sld_hub_inst|sld_dffex:BROADCAST ;
; |sld_dffex:IRF_ENA_0| ; 1 (1) ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 (0) ; 0 (0) ; 1 (1) ; 0 (0) ; 0 (0) ; |dds|sld_hub:sld_hub_inst|sld_dffex:IRF_ENA_0 ;
; |sld_dffex:IRF_ENA| ; 1 (1) ; 1 ; 0 ; 0 ; 0 ; 0 ; 0 (0) ; 0 (0) ; 1 (1) ; 0 (0) ; 0 (0) ; |dds|sld_hub:sld_hub_inst|sld_dffex:IRF_ENA ?? 快捷鍵說明
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