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?? dds.flow.rpt

?? verilog編寫基于fpga的DDS實現
?? RPT
字號:
Flow report for dds
Tue Jul 10 16:41:32 2007
Version 6.0 Build 178 04/27/2006 SJ Full Version


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; Table of Contents ;
---------------------
  1. Legal Notice
  2. Flow Summary
  3. Flow Settings
  4. Flow Non-Default Global Settings
  5. Flow Elapsed Time
  6. Flow Log



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; Legal Notice ;
----------------
Copyright (C) 1991-2006 Altera Corporation
Your use of Altera Corporation's design tools, logic functions 
and other software and tools, and its AMPP partner logic 
functions, and any output files any of the foregoing 
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+--------------------------------------------------------------------+
; Flow Summary                                                       ;
+-------------------------+------------------------------------------+
; Flow Status             ; Successful - Tue Jul 10 16:41:32 2007    ;
; Quartus II Version      ; 6.0 Build 178 04/27/2006 SJ Full Version ;
; Revision Name           ; dds                                      ;
; Top-level Entity Name   ; dds                                      ;
; Family                  ; Cyclone                                  ;
; Device                  ; EP1C12Q240C8                             ;
; Timing Models           ; Final                                    ;
; Met timing requirements ; N/A                                      ;
; Total logic elements    ; 275                                      ;
; Total pins              ; 59                                       ;
; Total virtual pins      ; 0                                        ;
; Total memory bits       ; 153,600                                  ;
; Total PLLs              ; 0                                        ;
+-------------------------+------------------------------------------+


+-----------------------------------------+
; Flow Settings                           ;
+-------------------+---------------------+
; Option            ; Setting             ;
+-------------------+---------------------+
; Start date & time ; 07/10/2007 16:41:22 ;
; Main task         ; Compilation         ;
; Revision Name     ; dds                 ;
+-------------------+---------------------+


+-------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Flow Non-Default Global Settings                                                                                                                                        ;
+-----------------+------------------------------------------------------------------------------------------------------------+---------------+-------------+------------+
; Assignment Name ; Value                                                                                                      ; Default Value ; Entity Name ; Section Id ;
+-----------------+------------------------------------------------------------------------------------------------------------+---------------+-------------+------------+
; USER_LIBRARIES  ; C:/altera/megacore/ed8b10b-v1.6.1/lib/;C:\altera\megacore/;C:\Documents and Settings\Administrator\桌面\b/ ; --            ; --          ; --         ;
+-----------------+------------------------------------------------------------------------------------------------------------+---------------+-------------+------------+


+-------------------------------------+
; Flow Elapsed Time                   ;
+----------------------+--------------+
; Module Name          ; Elapsed Time ;
+----------------------+--------------+
; Analysis & Synthesis ; 00:00:11     ;
; Total                ; 00:00:11     ;
+----------------------+--------------+


------------
; Flow Log ;
------------
quartus_map --read_settings_files=on --write_settings_files=off dds -c dds



?? 快捷鍵說明

復制代碼 Ctrl + C
搜索代碼 Ctrl + F
全屏模式 F11
切換主題 Ctrl + Shift + D
顯示快捷鍵 ?
增大字號 Ctrl + =
減小字號 Ctrl + -
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