?? mcucpld.fit.rpt
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Fitter report for MCUCPLD
Fri Sep 19 10:56:10 2008
Quartus II Version 7.2 Build 151 09/26/2007 SJ Full Version
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; Table of Contents ;
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1. Legal Notice
2. Fitter Summary
3. Fitter Settings
4. Pin-Out File
5. Fitter Resource Usage Summary
6. Input Pins
7. Output Pins
8. All Package Pins
9. Output Pin Default Load For Reported TCO
11. Non-Global High Fan-Out Signals
12. Interconnect Usage Summary
13. LAB External Interconnect
14. LAB Macrocells
15. Logic Cell Interconnection
16. Fitter Device Options
17. Fitter Messages
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; Legal Notice ;
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Copyright (C) 1991-2007 Altera Corporation
Your use of Altera Corporation's design tools, logic functions
and other software and tools, and its AMPP partner logic
functions, and any output files from any of the foregoing
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programming logic devices manufactured by Altera and sold by
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applicable agreement for further details.
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; Fitter Summary ;
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; Fitter Status ; Successful - Fri Sep 19 10:56:10 2008 ;
; Quartus II Version ; 7.2 Build 151 09/26/2007 SJ Full Version ;
; Revision Name ; MCUCPLD ;
; Top-level Entity Name ; MCUCPLD ;
; Family ; MAX7000S ;
; Device ; EPM7128SLC84-10 ;
; Timing Models ; Final ;
; Total macrocells ; 32 / 128 ( 25 % ) ;
; Total pins ; 46 / 68 ( 68 % ) ;
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; Fitter Settings ;
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; Option ; Setting ; Default Value ;
+--------------------------------------------------+-----------------+---------------+
; Device ; EPM7128SLC84-10 ; ;
; Use smart compilation ; Off ; Off ;
; Use TimeQuest Timing Analyzer ; Off ; Off ;
; Equivalent RAM and MLAB Paused Read Capabilities ; Care ; Care ;
; Optimize IOC Register Placement for Timing ; On ; On ;
; Limit to One Fitting Attempt ; Off ; Off ;
; Fitter Initial Placement Seed ; 1 ; 1 ;
; Slow Slew Rate ; Off ; Off ;
; Fitter Effort ; Auto Fit ; Auto Fit ;
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; Pin-Out File ;
+--------------+
The pin-out file can be found in C:/Documents and Settings/wangqinbo/桌面/MCUCPLD/MCUCPLD.pin.
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; Fitter Resource Usage Summary ;
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; Resource ; Usage ;
+-----------------------------------+-------------------+
; Logic cells ; 32 / 128 ( 25 % ) ;
; Registers ; 0 / 128 ( 0 % ) ;
; Number of pterms used ; 128 ;
; User inserted logic elements ; 0 ;
; I/O pins ; 46 / 68 ( 68 % ) ;
; -- Clock pins ; 0 / 2 ( 0 % ) ;
; -- Dedicated input pins ; 0 / 2 ( 0 % ) ;
; Global signals ; 0 ;
; Shareable expanders ; 0 / 128 ( 0 % ) ;
; Parallel expanders ; 0 / 120 ( 0 % ) ;
; Cells using turbo bit ; 32 / 128 ( 25 % ) ;
; Maximum fan-out node ; PSel[0] ;
; Maximum fan-out ; 32 ;
; Highest non-global fan-out signal ; PSel[0] ;
; Highest non-global fan-out ; 32 ;
; Total fan-out ; 160 ;
; Average fan-out ; 2.05 ;
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; Input Pins ;
+---------+-------+----------+-----+-----------------------+--------------------+--------+----------------+--------------+----------------------+
; Name ; Pin # ; I/O Bank ; LAB ; Combinational Fan-Out ; Registered Fan-Out ; Global ; Input Register ; I/O Standard ; Location assigned by ;
+---------+-------+----------+-----+-----------------------+--------------------+--------+----------------+--------------+----------------------+
; PP[0] ; 4 ; -- ; 1 ; 4 ; 0 ; no ; no ; TTL ; User ;
; PP[1] ; 5 ; -- ; 1 ; 4 ; 0 ; no ; no ; TTL ; User ;
; PP[2] ; 6 ; -- ; 1 ; 4 ; 0 ; no ; no ; TTL ; User ;
; PP[3] ; 8 ; -- ; 1 ; 4 ; 0 ; no ; no ; TTL ; User ;
; PP[4] ; 9 ; -- ; 1 ; 4 ; 0 ; no ; no ; TTL ; User ;
; PP[5] ; 10 ; -- ; 1 ; 4 ; 0 ; no ; no ; TTL ; User ;
; PP[6] ; 11 ; -- ; 1 ; 4 ; 0 ; no ; no ; TTL ; User ;
; PP[7] ; 12 ; -- ; 1 ; 4 ; 0 ; no ; no ; TTL ; User ;
; PSel[0] ; 15 ; -- ; 2 ; 32 ; 0 ; no ; no ; TTL ; User ;
; PSel[1] ; 16 ; -- ; 2 ; 32 ; 0 ; no ; no ; TTL ; User ;
+---------+-------+----------+-----+-----------------------+--------------------+--------+----------------+--------------+----------------------+
+----------------------------------------------------------------------------------------------------------------------------------------------+
; Output Pins ;
+-------+-------+----------+-----+-----------------+----------------+------------+---------------+--------------+----------------------+-------+
; Name ; Pin # ; I/O Bank ; LAB ; Output Register ; Slow Slew Rate ; Open Drain ; TRI Primitive ; I/O Standard ; Location assigned by ; Load ;
+-------+-------+----------+-----+-----------------+----------------+------------+---------------+--------------+----------------------+-------+
; PA[0] ; 81 ; -- ; 8 ; no ; no ; no ; no ; TTL ; User ; 10 pF ;
; PA[1] ; 80 ; -- ; 8 ; no ; no ; no ; no ; TTL ; User ; 10 pF ;
; PA[2] ; 79 ; -- ; 8 ; no ; no ; no ; no ; TTL ; User ; 10 pF ;
; PA[3] ; 77 ; -- ; 8 ; no ; no ; no ; no ; TTL ; User ; 10 pF ;
; PA[4] ; 76 ; -- ; 8 ; no ; no ; no ; no ; TTL ; User ; 10 pF ;
; PA[5] ; 75 ; -- ; 8 ; no ; no ; no ; no ; TTL ; User ; 10 pF ;
; PA[6] ; 74 ; -- ; 8 ; no ; no ; no ; no ; TTL ; User ; 10 pF ;
; PA[7] ; 73 ; -- ; 8 ; no ; no ; no ; no ; TTL ; User ; 10 pF ;
; PB[0] ; 70 ; -- ; 7 ; no ; no ; no ; no ; TTL ; User ; 10 pF ;
; PB[1] ; 69 ; -- ; 7 ; no ; no ; no ; no ; TTL ; User ; 10 pF ;
; PB[2] ; 68 ; -- ; 7 ; no ; no ; no ; no ; TTL ; User ; 10 pF ;
; PB[3] ; 67 ; -- ; 7 ; no ; no ; no ; no ; TTL ; User ; 10 pF ;
; PB[4] ; 65 ; -- ; 7 ; no ; no ; no ; no ; TTL ; User ; 10 pF ;
; PB[5] ; 64 ; -- ; 7 ; no ; no ; no ; no ; TTL ; User ; 10 pF ;
; PB[6] ; 63 ; -- ; 7 ; no ; no ; no ; no ; TTL ; User ; 10 pF ;
; PB[7] ; 61 ; -- ; 6 ; no ; no ; no ; no ; TTL ; User ; 10 pF ;
; PC[0] ; 44 ; -- ; 5 ; no ; no ; no ; no ; TTL ; User ; 10 pF ;
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