?? lcdcont.tan.rpt
字號:
; Report Combined Fast/Slow Timing ; Off ; ; ; ;
; Ignore Clock Settings ; Off ; ; ; ;
; Analyze latches as synchronous elements ; Off ; ; ; ;
; Enable Recovery/Removal analysis ; Off ; ; ; ;
; Enable Clock Latency ; Off ; ; ; ;
; Use TimeQuest Timing Analyzer ; Off ; ; ; ;
; Number of source nodes to report per destination node ; 10 ; ; ; ;
; Number of destination nodes to report ; 10 ; ; ; ;
; Number of paths to report ; 200 ; ; ; ;
; Report Minimum Timing Checks ; Off ; ; ; ;
; Use Fast Timing Models ; Off ; ; ; ;
; Report IO Paths Separately ; Off ; ; ; ;
; Perform Multicorner Analysis ; Off ; ; ; ;
; Reports the worst-case path for each clock domain and analysis ; Off ; ; ; ;
+----------------------------------------------------------------+--------------------+------+----+-------------+
+------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Clock Settings Summary ;
+-----------------+--------------------+----------+------------------+---------------+--------------+----------+-----------------------+---------------------+--------+--------------+
; Clock Node Name ; Clock Setting Name ; Type ; Fmax Requirement ; Early Latency ; Late Latency ; Based on ; Multiply Base Fmax by ; Divide Base Fmax by ; Offset ; Phase offset ;
+-----------------+--------------------+----------+------------------+---------------+--------------+----------+-----------------------+---------------------+--------+--------------+
; clk ; ; User Pin ; None ; 0.000 ns ; 0.000 ns ; -- ; N/A ; N/A ; N/A ; ;
+-----------------+--------------------+----------+------------------+---------------+--------------+----------+-----------------------+---------------------+--------+--------------+
+------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Clock Setup: 'clk' ;
+-----------------------------------------+-----------------------------------------------------+--------------------------------+---------------------------------+------------+----------+-----------------------------+---------------------------+-------------------------+
; Slack ; Actual fmax (period) ; From ; To ; From Clock ; To Clock ; Required Setup Relationship ; Required Longest P2P Time ; Actual Longest P2P Time ;
+-----------------------------------------+-----------------------------------------------------+--------------------------------+---------------------------------+------------+----------+-----------------------------+---------------------------+-------------------------+
; N/A ; 110.93 MHz ( period = 9.015 ns ) ; lcd0:mylcd|count1[1] ; lcd0:mylcd|lcd_data[1] ; clk ; clk ; None ; None ; 8.306 ns ;
; N/A ; 111.00 MHz ( period = 9.009 ns ) ; lcd0:mylcd|count1[1] ; lcd0:mylcd|lcd_data[3] ; clk ; clk ; None ; None ; 8.300 ns ;
; N/A ; 113.96 MHz ( period = 8.775 ns ) ; lcd0:mylcd|count[2] ; lcd0:mylcd|lcd_data[0] ; clk ; clk ; None ; None ; 8.066 ns ;
; N/A ; 115.51 MHz ( period = 8.657 ns ) ; lcd0:mylcd|count1[0] ; lcd0:mylcd|lcd_data[1] ; clk ; clk ; None ; None ; 7.948 ns ;
; N/A ; 115.59 MHz ( period = 8.651 ns ) ; lcd0:mylcd|count1[0] ; lcd0:mylcd|lcd_data[3] ; clk ; clk ; None ; None ; 7.942 ns ;
; N/A ; 115.87 MHz ( period = 8.630 ns ) ; lcd0:mylcd|count[0] ; lcd0:mylcd|lcd_data[0] ; clk ; clk ; None ; None ; 7.921 ns ;
; N/A ; 116.28 MHz ( period = 8.600 ns ) ; lcd0:mylcd|count1[1] ; lcd0:mylcd|lcd_data[0] ; clk ; clk ; None ; None ; 7.891 ns ;
; N/A ; 117.36 MHz ( period = 8.521 ns ) ; lcd0:mylcd|count1[4] ; lcd0:mylcd|lcd_data[1] ; clk ; clk ; None ; None ; 7.812 ns ;
; N/A ; 117.44 MHz ( period = 8.515 ns ) ; lcd0:mylcd|count1[4] ; lcd0:mylcd|lcd_data[3] ; clk ; clk ; None ; None ; 7.806 ns ;
; N/A ; 118.02 MHz ( period = 8.473 ns ) ; lcd0:mylcd|count[2] ; lcd0:mylcd|lcd_data[1] ; clk ; clk ; None ; None ; 7.764 ns ;
; N/A ; 118.12 MHz ( period = 8.466 ns ) ; lcd0:mylcd|count[2] ; lcd0:mylcd|lcd_data[3] ; clk ; clk ; None ; None ; 7.757 ns ;
; N/A ; 118.32 MHz ( period = 8.452 ns ) ; lcd0:mylcd|count[3] ; lcd0:mylcd|lcd_data[0] ; clk ; clk ; None ; None ; 7.743 ns ;
; N/A ; 118.82 MHz ( period = 8.416 ns ) ; lcd0:mylcd|count1[2] ; lcd0:mylcd|lcd_data[3] ; clk ; clk ; None ; None ; 7.707 ns ;
; N/A ; 118.84 MHz ( period = 8.415 ns ) ; lcd0:mylcd|count1[5] ; lcd0:mylcd|lcd_data[1] ; clk ; clk ; None ; None ; 7.706 ns ;
; N/A ; 118.92 MHz ( period = 8.409 ns ) ; lcd0:mylcd|count1[5] ; lcd0:mylcd|lcd_data[3] ; clk ; clk ; None ; None ; 7.700 ns ;
; N/A ; 120.08 MHz ( period = 8.328 ns ) ; lcd0:mylcd|count[0] ; lcd0:mylcd|lcd_data[1] ; clk ; clk ; None ; None ; 7.619 ns ;
; N/A ; 120.18 MHz ( period = 8.321 ns ) ; lcd0:mylcd|count[0] ; lcd0:mylcd|lcd_data[3] ; clk ; clk ; None ; None ; 7.612 ns ;
; N/A ; 120.86 MHz ( period = 8.274 ns ) ; lcd0:mylcd|count1[1] ; lcd0:mylcd|lcd_data[2] ; clk ; clk ; None ; None ; 7.565 ns ;
; N/A ; 121.33 MHz ( period = 8.242 ns ) ; lcd0:mylcd|count1[0] ; lcd0:mylcd|lcd_data[0] ; clk ; clk ; None ; None ; 7.533 ns ;
; N/A ; 121.54 MHz ( period = 8.228 ns ) ; lcd0:mylcd|count[2] ; lcd0:mylcd|lcd_data[5] ; clk ; clk ; None ; None ; 7.519 ns ;
; N/A ; 121.67 MHz ( period = 8.219 ns ) ; lcd0:mylcd|count[2] ; lcd0:mylcd|lcd_data[7] ; clk ; clk ; None ; None ; 7.510 ns ;
; N/A ; 122.26 MHz ( period = 8.179 ns ) ; lcd0:mylcd|count[2] ; lcd0:mylcd|lcd_data[2] ; clk ; clk ; None ; None ; 7.470 ns ;
; N/A ; 122.70 MHz ( period = 8.150 ns ) ; lcd0:mylcd|count[3] ; lcd0:mylcd|lcd_data[1] ; clk ; clk ; None ; None ; 7.441 ns ;
; N/A ; 122.73 MHz ( period = 8.148 ns ) ; lcd0:mylcd|state.write1 ; lcd0:mylcd|lcd_data[1] ; clk ; clk ; None ; None ; 7.439 ns ;
; N/A ; 122.80 MHz ( period = 8.143 ns ) ; lcd0:mylcd|count[3] ; lcd0:mylcd|lcd_data[3] ; clk ; clk ; None ; None ; 7.434 ns ;
; N/A ; 122.82 MHz ( period = 8.142 ns ) ; lcd0:mylcd|state.write1 ; lcd0:mylcd|lcd_data[3] ; clk ; clk ; None ; None ; 7.433 ns ;
; N/A ; 122.97 MHz ( period = 8.132 ns ) ; lcd0:mylcd|count[2] ; lcd0:mylcd|lcd_data[4] ; clk ; clk ; None ; None ; 7.423 ns ;
; N/A ; 123.11 MHz ( period = 8.123 ns ) ; lcd0:mylcd|count[2] ; lcd0:mylcd|count[3] ; clk ; clk ; None ; None ; 7.414 ns ;
; N/A ; 123.11 MHz ( period = 8.123 ns ) ; lcd0:mylcd|count[2] ; lcd0:mylcd|count[2] ; clk ; clk ; None ; None ; 7.414 ns ;
; N/A ; 123.11 MHz ( period = 8.123 ns ) ; lcd0:mylcd|count[2] ; lcd0:mylcd|count[0] ; clk ; clk ; None ; None ; 7.414 ns ;
; N/A ; 123.11 MHz ( period = 8.123 ns ) ; lcd0:mylcd|count[2] ; lcd0:mylcd|count[1] ; clk ; clk ; None ; None ; 7.414 ns ;
; N/A ; 123.37 MHz ( period = 8.106 ns ) ; lcd0:mylcd|count1[4] ; lcd0:mylcd|lcd_data[0] ; clk ; clk ; None ; None ; 7.397 ns ;
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