?? cpu.pin
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-- not intended for use as a Quartus II input file. This file cannot be used
-- to make Quartus II pin assignments - for instructions on how to make pin
-- assignments, please see Quartus II help.
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------------------------------------------------------------------------------
-- NC : No Connect. This pin has no internal connection to the device.
-- VCC_INT : Dedicated power pin, which MUST be connected to VCC (2.5V).
-- VCC_IO : Dedicated power pin, which MUST be connected to VCC (Refer to
-- the table below for voltage).
-- GND : Dedicated ground pin, which MUST be connected to GND.
-- GND+ : Unused input. This pin should be connected to GND. It may also
-- be connected to a valid signal on the board (low, high, or
-- toggling) if that signal is required for a different revision
-- of the design.
-- GND* : Unused I/O pin. This pin can either be left unconnected or
-- connected to GND. Connecting this pin to GND will improve the
-- device's immunity to noise.
------------------------------------------------------------------------------
Quartus II Version 5.0 Build 148 04/26/2005 SJ Full Version
CHIP "cpu" ASSIGNED TO AN: EP1K100QC208-3
Pin Name/Usage : Location : Dir. : I/O Standard : Voltage : I/O Bank : User Assignment
-------------------------------------------------------------------------------------------------------------
TCK : 1 : input : : : :
CONF_DONE : 2 : bidir : : : :
nCEO : 3 : output : : : :
TDO : 4 : output : : : :
VCC_IO : 5 : power : : 3.3V : :
GND : 6 : gnd : : : :
z_flag : 7 : bidir : LVTTL/LVCMOS : : : Y
load_PC : 8 : bidir : LVTTL/LVCMOS : : : Y
ALU_sub : 9 : bidir : LVTTL/LVCMOS : : : Y
GND* : 10 : : : : :
ALU_add : 11 : bidir : LVTTL/LVCMOS : : : Y
ALU_ACC : 12 : bidir : LVTTL/LVCMOS : : : Y
load_ACC : 13 : bidir : LVTTL/LVCMOS : : : Y
load_MDR : 14 : bidir : LVTTL/LVCMOS : : : Y
ACC_bus : 15 : bidir : LVTTL/LVCMOS : : : Y
GND* : 16 : : : : :
Addr_bus : 17 : bidir : LVTTL/LVCMOS : : : Y
load_IR : 18 : bidir : LVTTL/LVCMOS : : : Y
GND* : 19 : : : : :
GND : 20 : gnd : : : :
VCC_INT : 21 : power : : 2.5V : :
VCC_IO : 22 : power : : 3.3V : :
GND : 23 : gnd : : : :
MDR_bus : 24 : bidir : LVTTL/LVCMOS : : : Y
R_NW : 25 : bidir : LVTTL/LVCMOS : : : Y
CS : 26 : input : LVTTL/LVCMOS : : : Y
INC_PC : 27 : bidir : LVTTL/LVCMOS : : : Y
load_MAR : 28 : bidir : LVTTL/LVCMOS : : : Y
PC_bus : 29 : bidir : LVTTL/LVCMOS : : : Y
GND* : 30 : : : : :
GND* : 31 : : : : :
GND : 32 : gnd : : : :
VCC_INT : 33 : power : : 2.5V : :
VCC_IO : 34 : power : : 3.3V : :
GND : 35 : gnd : : : :
GND* : 36 : : : : :
GND* : 37 : : : : :
GND* : 38 : : : : :
GND* : 39 : : : : :
GND* : 40 : : : : :
GND* : 41 : : : : :
VCC_IO : 42 : power : : 3.3V : :
GND : 43 : gnd : : : :
GND* : 44 : : : : :
GND* : 45 : : : : :
GND* : 46 : : : : :
GND* : 47 : : : : :
VCC_INT : 48 : power : : 2.5V : :
GND : 49 : gnd : : : :
TMS : 50 : input : : : :
TRST : 51 : input : : : :
nSTATUS : 52 : bidir : : : :
mode[0] : 53 : input : LVTTL/LVCMOS : : : Y
mode[1] : 54 : input : LVTTL/LVCMOS : : : Y
mode[2] : 55 : input : LVTTL/LVCMOS : : : Y
GND* : 56 : : : : :
GND* : 57 : : : : :
GND* : 58 : : : : :
GND : 59 : gnd : : : :
GND* : 60 : : : : :
GND* : 61 : : : : :
GND* : 62 : : : : :
GND* : 63 : : : : :
GND* : 64 : : : : :
GND* : 65 : : : : :
VCC_IO : 66 : power : : 3.3V : :
mem_addr[0] : 67 : input : LVTTL/LVCMOS : : : Y
mem_addr[1] : 68 : input : LVTTL/LVCMOS : : : Y
mem_addr[2] : 69 : input : LVTTL/LVCMOS : : : Y
mem_addr[3] : 70 : input : LVTTL/LVCMOS : : : Y
mem_addr[4] : 71 : input : LVTTL/LVCMOS : : : Y
VCC_INT : 72 : power : : 2.5V : :
GND* : 73 : : : : :
GND* : 74 : : : : :
GND* : 75 : : : : :
GND : 76 : gnd : : : :
VCC_CKLK : 77 : power : : 2.5V : :
GND+ : 78 : : : : :
clock : 79 : input : LVTTL/LVCMOS : : : Y
GND+ : 80 : : : : :
GND_CKLK : 81 : gnd : : : :
GND : 82 : gnd : : : :
reset : 83 : input : LVTTL/LVCMOS : : : Y
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