?? dividend4.tan.rpt
字號:
; N/A ; 39.06 MHz ( period = 25.600 ns ) ; sub_5:u3|differin[0] ; remainder[0]~reg0 ; clk ; clk ; None ; None ; 4.400 ns ;
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; N/A ; 39.06 MHz ( period = 25.600 ns ) ; sub_5:u3|differin[2] ; remainder[2]~reg0 ; clk ; clk ; None ; None ; 4.400 ns ;
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; N/A ; 39.37 MHz ( period = 25.400 ns ) ; shift:u4|shiftin[3] ; quotient[3]~reg0 ; clk ; clk ; None ; None ; 4.400 ns ;
; N/A ; 39.37 MHz ( period = 25.400 ns ) ; shift:u4|shiftin[0] ; quotient[0]~reg0 ; clk ; clk ; None ; None ; 4.400 ns ;
; N/A ; 73.53 MHz ( period = 13.600 ns ) ; state_graph:u5|isover ; quotient[0]~en ; clk ; clk ; None ; None ; 4.400 ns ;
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; N/A ; 95.24 MHz ( period = 10.500 ns ) ; shift:u4|shiftin[5] ; diag_c:u2|c ; clk ; clk ; None ; None ; 8.100 ns ;
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; N/A ; 144.93 MHz ( period = 6.900 ns ) ; state_graph:u5|state[0] ; state_graph:u5|state[0] ; clk ; clk ; None ; None ; 4.500 ns ;
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; N/A ; 144.93 MHz ( period = 6.900 ns ) ; state_graph:u5|state[2] ; state_graph:u5|state[2] ; clk ; clk ; None ; None ; 4.500 ns ;
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; N/A ; 144.93 MHz ( period = 6.900 ns ) ; sub_5:u3|differin[0] ; shift:u4|shiftin[5] ; clk ; clk ; None ; None ; 4.400 ns ;
; N/A ; 144.93 MHz ( period = 6.900 ns ) ; shift:u4|shiftin[1] ; shift:u4|shiftin[2] ; clk ; clk ; None ; None ; 4.500 ns ;
; N/A ; 144.93 MHz ( period = 6.900 ns ) ; diag_c:u2|c ; shift:u4|shiftin[0] ; clk ; clk ; None ; None ; 4.500 ns ;
; N/A ; 144.93 MHz ( period = 6.900 ns ) ; state_graph:u5|state[1] ; state_graph:u5|isover ; clk ; clk ; None ; None ; 4.500 ns ;
; N/A ; 144.93 MHz ( period = 6.900 ns ) ; state_graph:u5|state[0] ; state_graph:u5|isover ; clk ; clk ; None ; None ; 4.500 ns ;
; N/A ; 144.93 MHz ( period = 6.900 ns ) ; state_graph:u5|srg4:u1|srg_4[1] ; state_graph:u5|isover ; clk ; clk ; None ; None ; 4.500 ns ;
; N/A ; 144.93 MHz ( period = 6.900 ns ) ; state_graph:u5|state[2] ; state_graph:u5|isover ; clk ; clk ; None ; None ; 4.500 ns ;
; N/A ; 144.93 MHz ( period = 6.900 ns ) ; state_graph:u5|state[1] ; state_graph:u5|overflow ; clk ; clk ; None ; None ; 4.500 ns ;
; N/A ; 144.93 MHz ( period = 6.900 ns ) ; state_graph:u5|state[0] ; state_graph:u5|overflow ; clk ; clk ; None ; None ; 4.500 ns ;
; N/A ; 144.93 MHz ( period = 6.900 ns ) ; state_graph:u5|state[2] ; state_graph:u5|overflow ; clk ; clk ; None ; None ; 4.500 ns ;
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; N/A ; 147.06 MHz ( period = 6.800 ns ) ; state_graph:u5|input ; state_graph:u5|srg4:u1|srg_4[2] ; clk ; clk ; None ; None ; 4.400 ns ;
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; N/A ; 147.06 MHz ( period = 6.800 ns ) ; shift:u4|shiftin[0] ; shift:u4|shiftin[1] ; clk ; clk ; None ; None ; 4.400 ns ;
; N/A ; 147.06 MHz ( period = 6.800 ns ) ; state_graph:u5|isover ; state_graph:u5|isover ; clk ; clk ; None ; None ; 4.400 ns ;
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; N/A ; 149.25 MHz ( period = 6.700 ns ) ; shift:u4|shiftin[4] ; sub_5:u3|differin[1] ; clk ; clk ; None ; None ; 4.400 ns ;
; N/A ; 149.25 MHz ( period = 6.700 ns ) ; shift:u4|shiftin[4] ; sub_5:u3|differin[0] ; clk ; clk ; None ; None ; 4.400 ns ;
; N/A ; Restricted to 166.67 MHz ( period = 6.000 ns ) ; state_graph:u5|load ; shift:u4|shiftin[8] ; clk ; clk ; None ; None ; 4.500 ns ;
; N/A ; Restricted to 166.67 MHz ( period = 6.000 ns ) ; state_graph:u5|load ; shift:u4|shiftin[7] ; clk ; clk ; None ; None ; 4.500 ns ;
; N/A ; Restricted to 166.67 MHz ( period = 6.000 ns ) ; state_graph:u5|load ; shift:u4|shiftin[6] ; clk ; clk ; None ; None ; 4.500 ns ;
; N/A ; Restricted to 166.67 MHz ( period = 6.000 ns ) ; state_graph:u5|load ; shift:u4|shiftin[5] ; clk ; clk ; None ; None ; 4.500 ns ;
; N/A ; Restricted to 166.67 MHz ( period = 6.000 ns ) ; state_graph:u5|load ; shift:u4|shiftin[4] ; clk ; clk ; None ; None ; 4.500 ns ;
; N/A ; Restricted to 166.67 MHz ( period = 6.000 ns ) ; state_graph:u5|load ; shift:u4|shiftin[3] ; clk ; clk ; None ; None ; 4.500 ns ;
; N/A ; Restricted to 166.67 MHz ( period = 6.000 ns ) ; state_graph:u5|load ; shift:u4|shiftin[2] ; clk ; clk ; None ; None ; 4.500 ns ;
; N/A ; Restricted to 166.67 MHz ( period = 6.000 ns ) ; state_graph:u5|load ; shift:u4|shiftin[1] ; clk ; clk ; None ; None ; 4.500 ns ;
+-------+------------------------------------------------+---------------------------------+---------------------------------+------------+----------+-----------------------------+---------------------------+-------------------------+
+---------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Clock Hold: 'clk' ;
+------------------------------------------+---------------------+---------------------+------------+----------+----------------------------+----------------------------+--------------------------+
; Minimum Slack ; From ; To ; From Clock ; To Clock ; Required Hold Relationship ; Required Shortest P2P Time ; Actual Shortest P2P Time ;
+------------------------------------------+---------------------+---------------------+------------+----------+----------------------------+----------------------------+--------------------------+
; Not operational: Clock Skew > Data Delay ; state_graph:u5|load ; shift:u4|shiftin[8] ; clk ; clk ; None ; None ; 4.500 ns ;
; Not operational: Clock Skew > Data Delay ; state_graph:u5|load ; shift:u4|shiftin[7] ; clk ; clk ; None ; None ; 4.500 ns ;
; Not operational: Clock Skew > Data Delay ; state_graph:u5|load ; shift:u4|shiftin[6] ; clk ; clk ; None ; None ; 4.500 ns ;
; Not operational: Clock Skew > Data Delay ; state_graph:u5|load ; shift:u4|shiftin[5] ; clk ; clk ; None ; None ; 4.500 ns ;
; Not operational: Clock Skew > Data Delay ; state_graph:u5|load ; shift:u4|shiftin[4] ; clk ; clk ; None ; None ; 4.500 ns ;
; Not operational: Clock Skew > Data Delay ; state_graph:u5|load ; shift:u4|shiftin[3] ; clk ; clk ; None ; None ; 4.500 ns ;
; Not operational: Clock Skew > Data Delay ; state_graph:u5|load ; shift:u4|shiftin[2] ; clk ; clk ; None ; None ; 4.500 ns ;
; Not operational: Clock Skew > Data Delay ; state_graph:u5|load ; shift:u4|shiftin[1] ; clk ; clk ; None ; None ; 4.500 ns ;
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