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?? pc1.flow.rpt

?? DES加密算法的VHDL實現,采用流水線技術實現
?? RPT
字號:
Flow report for pc1
Sat Aug 04 19:09:24 2007
Quartus II Version 7.1 Build 156 04/30/2007 SJ Full Version


---------------------
; Table of Contents ;
---------------------
  1. Legal Notice
  2. Flow Summary
  3. Flow Settings
  4. Flow Non-Default Global Settings
  5. Flow Elapsed Time
  6. Flow Log



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; Legal Notice ;
----------------
Copyright (C) 1991-2007 Altera Corporation
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and other software and tools, and its AMPP partner logic 
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+--------------------------------------------------------------------+
; Flow Summary                                                       ;
+-------------------------+------------------------------------------+
; Flow Status             ; Successful - Sat Aug 04 19:09:24 2007    ;
; Quartus II Version      ; 7.1 Build 156 04/30/2007 SJ Full Version ;
; Revision Name           ; pc1                                      ;
; Top-level Entity Name   ; pc1                                      ;
; Family                  ; Cyclone                                  ;
; Met timing requirements ; Yes                                      ;
; Total logic elements    ; 0 / 4,000 ( 0 % )                        ;
; Total pins              ; 120 / 249 ( 48 % )                       ;
; Total virtual pins      ; 0                                        ;
; Total memory bits       ; 0 / 78,336 ( 0 % )                       ;
; Total PLLs              ; 0 / 2 ( 0 % )                            ;
; Device                  ; EP1C4F324C6                              ;
; Timing Models           ; Final                                    ;
+-------------------------+------------------------------------------+


+-----------------------------------------+
; Flow Settings                           ;
+-------------------+---------------------+
; Option            ; Setting             ;
+-------------------+---------------------+
; Start date & time ; 08/04/2007 19:09:08 ;
; Main task         ; Compilation         ;
; Revision Name     ; pc1                 ;
+-------------------+---------------------+


+----------------------------------------------------------------------------+
; Flow Non-Default Global Settings                                           ;
+------------------------+--------+---------------+-------------+------------+
; Assignment Name        ; Value  ; Default Value ; Entity Name ; Section Id ;
+------------------------+--------+---------------+-------------+------------+
; PARTITION_NETLIST_TYPE ; SOURCE ; --            ; --          ; Top        ;
+------------------------+--------+---------------+-------------+------------+


+----------------------------------------+
; Flow Elapsed Time                      ;
+-------------------------+--------------+
; Module Name             ; Elapsed Time ;
+-------------------------+--------------+
; Analysis & Synthesis    ; 00:00:02     ;
; Fitter                  ; 00:00:04     ;
; Assembler               ; 00:00:05     ;
; Classic Timing Analyzer ; 00:00:01     ;
; Total                   ; 00:00:12     ;
+-------------------------+--------------+


------------
; Flow Log ;
------------
quartus_map --read_settings_files=on --write_settings_files=off pc1 -c pc1
quartus_fit --read_settings_files=off --write_settings_files=off pc1 -c pc1
quartus_asm --read_settings_files=off --write_settings_files=off pc1 -c pc1
quartus_tan --read_settings_files=off --write_settings_files=off pc1 -c pc1 --timing_analysis_only



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