?? taxt.map.rpt
字號(hào):
; Allows Synchronous Control Signal Usage in Normal Mode Logic Cells ; On ; On ;
; Auto RAM Block Balancing ; On ; On ;
; Auto Resource Sharing ; Off ; Off ;
; Allow Any RAM Size For Recognition ; Off ; Off ;
; Allow Any ROM Size For Recognition ; Off ; Off ;
; Allow Any Shift Register Size For Recognition ; Off ; Off ;
; Maximum Number of M512 Memory Blocks ; -1 ; -1 ;
; Maximum Number of M4K Memory Blocks ; -1 ; -1 ;
; Maximum Number of M-RAM Memory Blocks ; -1 ; -1 ;
; Ignore translate_off and translate_on Synthesis Directives ; Off ; Off ;
; Show Parameter Settings Tables in Synthesis Report ; On ; On ;
+--------------------------------------------------------------------+--------------+---------------+
+-----------------------------------------------------------------------------------------------------------------------------------------------------------+
; Analysis & Synthesis Source Files Read ;
+----------------------------------+-----------------+------------------------------------+-----------------------------------------------------------------+
; File Name with User-Entered Path ; Used in Netlist ; File Type ; File Name with Absolute Path ;
+----------------------------------+-----------------+------------------------------------+-----------------------------------------------------------------+
; d_to_b.vhd ; yes ; User VHDL File ; E:/study/eda/TAXT/d_to_b.vhd ;
; display.vhd ; yes ; User VHDL File ; E:/study/eda/TAXT/display.vhd ;
; frq.vhd ; yes ; User VHDL File ; E:/study/eda/TAXT/frq.vhd ;
; speed.vhd ; yes ; User VHDL File ; E:/study/eda/TAXT/speed.vhd ;
; taxt.bdf ; yes ; User Block Diagram/Schematic File ; E:/study/eda/TAXT/taxt.bdf ;
; ff_1_s.vhd ; yes ; Other ; E:/study/eda/TAXT/ff_1_s.vhd ;
; ff_100_s.vhd ; yes ; Other ; E:/study/eda/TAXT/ff_100_s.vhd ;
; lpm_divide.tdf ; yes ; Megafunction ; c:/altera/quartus50/libraries/megafunctions/lpm_divide.tdf ;
; abs_divider.inc ; yes ; Other ; c:/altera/quartus50/libraries/megafunctions/abs_divider.inc ;
; sign_div_unsign.inc ; yes ; Other ; c:/altera/quartus50/libraries/megafunctions/sign_div_unsign.inc ;
; aglobal50.inc ; yes ; Other ; c:/altera/quartus50/libraries/megafunctions/aglobal50.inc ;
; db/lpm_divide_0nf.tdf ; yes ; Auto-Generated Megafunction ; E:/study/eda/TAXT/db/lpm_divide_0nf.tdf ;
; db/sign_div_unsign_2jg.tdf ; yes ; Auto-Generated Megafunction ; E:/study/eda/TAXT/db/sign_div_unsign_2jg.tdf ;
; db/alt_u_div_9od.tdf ; yes ; Auto-Generated Megafunction ; E:/study/eda/TAXT/db/alt_u_div_9od.tdf ;
; db/add_sub_ke8.tdf ; yes ; Auto-Generated Megafunction ; E:/study/eda/TAXT/db/add_sub_ke8.tdf ;
; db/add_sub_le8.tdf ; yes ; Auto-Generated Megafunction ; E:/study/eda/TAXT/db/add_sub_le8.tdf ;
; db/add_sub_me8.tdf ; yes ; Auto-Generated Megafunction ; E:/study/eda/TAXT/db/add_sub_me8.tdf ;
; db/add_sub_ne8.tdf ; yes ; Auto-Generated Megafunction ; E:/study/eda/TAXT/db/add_sub_ne8.tdf ;
; db/add_sub_oe8.tdf ; yes ; Auto-Generated Megafunction ; E:/study/eda/TAXT/db/add_sub_oe8.tdf ;
; db/add_sub_pe8.tdf ; yes ; Auto-Generated Megafunction ; E:/study/eda/TAXT/db/add_sub_pe8.tdf ;
; db/add_sub_qe8.tdf ; yes ; Auto-Generated Megafunction ; E:/study/eda/TAXT/db/add_sub_qe8.tdf ;
; db/add_sub_re8.tdf ; yes ; Auto-Generated Megafunction ; E:/study/eda/TAXT/db/add_sub_re8.tdf ;
; db/add_sub_pa8.tdf ; yes ; Auto-Generated Megafunction ; E:/study/eda/TAXT/db/add_sub_pa8.tdf ;
; db/lpm_divide_tmf.tdf ; yes ; Auto-Generated Megafunction ; E:/study/eda/TAXT/db/lpm_divide_tmf.tdf ;
; db/sign_div_unsign_vig.tdf ; yes ; Auto-Generated Megafunction ; E:/study/eda/TAXT/db/sign_div_unsign_vig.tdf ;
; db/alt_u_div_3od.tdf ; yes ; Auto-Generated Megafunction ; E:/study/eda/TAXT/db/alt_u_div_3od.tdf ;
; db/add_sub_ma8.tdf ; yes ; Auto-Generated Megafunction ; E:/study/eda/TAXT/db/add_sub_ma8.tdf ;
; db/lpm_divide_0ff.tdf ; yes ; Auto-Generated Megafunction ; E:/study/eda/TAXT/db/lpm_divide_0ff.tdf ;
+----------------------------------+-----------------+------------------------------------+-----------------------------------------------------------------+
+---------------------------------------------+
; Analysis & Synthesis Resource Usage Summary ;
+-----------------------------------+---------+
; Resource ; Usage ;
+-----------------------------------+---------+
; Total logic elements ; 804 ;
; Total combinational functions ; 793 ;
; -- Total 4-input functions ; 153 ;
; -- Total 3-input functions ; 42 ;
; -- Total 2-input functions ; 358 ;
; -- Total 1-input functions ; 154 ;
; -- Total 0-input functions ; 86 ;
; Combinational cells for routing ; 0 ;
; Total registers ; 74 ;
; Total logic cells in carry chains ; 389 ;
; I/O pins ; 17 ;
; Maximum fan-out node ; start ;
; Maximum fan-out ; 38 ;
; Total fan-out ; 2091 ;
; Average fan-out ; 2.55 ;
+-----------------------------------+---------+
+------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Analysis & Synthesis Resource Utilization by Entity ;
+-------------------------------------------+-------------+--------------+-------------+------+--------------+--------------+-------------------+------------------+-----------------+-----------------------------------------------------------------------------------------------------------------------------------------------+
; Compilation Hierarchy Node ; Logic Cells ; LC Registers ; Memory Bits ; Pins ; Virtual Pins ; LUT-Only LCs ; Register-Only LCs ; LUT/Register LCs ; Carry Chain LCs ; Full Hierarchy Name ;
+-------------------------------------------+-------------+--------------+-------------+------+--------------+--------------+-------------------+------------------+-----------------+-----------------------------------------------------------------------------------------------------------------------------------------------+
; |taxt ; 804 (0) ; 74 ; 0 ; 17 ; 0 ; 730 (0) ; 11 (0) ; 63 (0) ; 389 (0) ; |taxt ;
; |d_to_b:inst1| ; 285 (0) ; 0 ; 0 ; 0 ; 0 ; 285 (0) ; 0 (0) ; 0 (0) ; 155 (0) ; |taxt|d_to_b:inst1 ;
; |lpm_divide:div_rtl_0| ; 65 (0) ; 0 ; 0 ; 0 ; 0 ; 65 (0) ; 0 (0) ; 0 (0) ; 33 (0) ; |taxt|d_to_b:inst1|lpm_divide:div_rtl_0 ;
; |lpm_divide_0nf:auto_generated| ; 65 (0) ; 0 ; 0 ; 0 ; 0 ; 65 (0) ; 0 (0) ; 0 (0) ; 33 (0) ; |taxt|d_to_b:inst1|lpm_divide:div_rtl_0|lpm_divide_0nf:auto_generated ;
; |sign_div_unsign_2jg:divider| ; 65 (0) ; 0 ; 0 ; 0 ; 0 ; 65 (0) ; 0 (0) ; 0 (0) ; 33 (0) ; |taxt|d_to_b:inst1|lpm_divide:div_rtl_0|lpm_divide_0nf:auto_generated|sign_div_unsign_2jg:divider ;
; |alt_u_div_9od:divider| ; 65 (32) ; 0 ; 0 ; 0 ; 0 ; 65 (32) ; 0 (0) ; 0 (0) ; 33 (0) ; |taxt|d_to_b:inst1|lpm_divide:div_rtl_0|lpm_divide_0nf:auto_generated|sign_div_unsign_2jg:divider|alt_u_div_9od:divider ;
; |add_sub_qe8:add_sub_6| ; 8 (8) ; 0 ; 0 ; 0 ; 0 ; 8 (8) ; 0 (0) ; 0 (0) ; 8 (8) ; |taxt|d_to_b:inst1|lpm_divide:div_rtl_0|lpm_divide_0nf:auto_generated|sign_div_unsign_2jg:divider|alt_u_div_9od:divider|add_sub_qe8:add_sub_6 ;
; |add_sub_re8:add_sub_7| ; 9 (9) ; 0 ; 0 ; 0 ; 0 ; 9 (9) ; 0 (0) ; 0 (0) ; 9 (9) ; |taxt|d_to_b:inst1|lpm_divide:div_rtl_0|lpm_divide_0nf:auto_generated|sign_div_unsign_2jg:divider|alt_u_div_9od:divider|add_sub_re8:add_sub_7 ;
; |add_sub_re8:add_sub_8| ; 9 (9) ; 0 ; 0 ; 0 ; 0 ; 9 (9) ; 0 (0) ; 0 (0) ; 9 (9) ; |taxt|d_to_b:inst1|lpm_divide:div_rtl_0|lpm_divide_0nf:auto_generated|sign_div_unsign_2jg:divider|alt_u_div_9od:divider|add_sub_re8:add_sub_8 ;
; |add_sub_re8:add_sub_9| ; 7 (7) ; 0 ; 0 ; 0 ; 0 ; 7 (7) ; 0 (0) ; 0 (0) ; 7 (7) ; |taxt|d_to_b:inst1|lpm_divide:div_rtl_0|lpm_divide_0nf:auto_generated|sign_div_unsign_2jg:divider|alt_u_div_9od:divider|add_sub_re8:add_sub_9 ;
; |lpm_divide:div_rtl_1| ; 84 (0) ; 0 ; 0 ; 0 ; 0 ; 84 (0) ; 0 (0) ; 0 (0) ; 46 (0) ; |taxt|d_to_b:inst1|lpm_divide:div_rtl_1 ;
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; |add_sub_oe8:add_sub_5| ; 7 (7) ; 0 ; 0 ; 0 ; 0 ; 7 (7) ; 0 (0) ; 0 (0) ; 7 (7) ; |taxt|d_to_b:inst1|lpm_divide:div_rtl_1|lpm_divide_tmf:auto_generated|sign_div_unsign_vig:divider|alt_u_div_3od:divider|add_sub_oe8:add_sub_5 ;
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