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?? lab2.flow.rpt

?? 用FPGA做數碼管編碼器!只有用到7段
?? RPT
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Flow report for lab2
Mon Apr 20 17:55:54 2009
Quartus II Version 7.1 Build 156 04/30/2007 SJ Full Version


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; Table of Contents ;
---------------------
  1. Legal Notice
  2. Flow Summary
  3. Flow Settings
  4. Flow Non-Default Global Settings
  5. Flow Elapsed Time
  6. Flow Log



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; Legal Notice ;
----------------
Copyright (C) 1991-2007 Altera Corporation
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and other software and tools, and its AMPP partner logic 
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+--------------------------------------------------------------------+
; Flow Summary                                                       ;
+-------------------------+------------------------------------------+
; Flow Status             ; Successful - Mon Apr 20 17:55:54 2009    ;
; Quartus II Version      ; 7.1 Build 156 04/30/2007 SJ Full Version ;
; Revision Name           ; lab2                                     ;
; Top-level Entity Name   ; lab2                                     ;
; Family                  ; Cyclone                                  ;
; Device                  ; EP1C3T144C8                              ;
; Timing Models           ; Final                                    ;
; Met timing requirements ; Yes                                      ;
; Total logic elements    ; 7 / 2,910 ( < 1 % )                      ;
; Total pins              ; 11 / 104 ( 11 % )                        ;
; Total virtual pins      ; 0                                        ;
; Total memory bits       ; 0 / 59,904 ( 0 % )                       ;
; Total PLLs              ; 0 / 1 ( 0 % )                            ;
+-------------------------+------------------------------------------+


+-----------------------------------------+
; Flow Settings                           ;
+-------------------+---------------------+
; Option            ; Setting             ;
+-------------------+---------------------+
; Start date & time ; 04/20/2009 17:55:45 ;
; Main task         ; Compilation         ;
; Revision Name     ; lab2                ;
+-------------------+---------------------+


+----------------------------------------------------------------------------+
; Flow Non-Default Global Settings                                           ;
+------------------------+--------+---------------+-------------+------------+
; Assignment Name        ; Value  ; Default Value ; Entity Name ; Section Id ;
+------------------------+--------+---------------+-------------+------------+
; PARTITION_NETLIST_TYPE ; SOURCE ; --            ; --          ; Top        ;
+------------------------+--------+---------------+-------------+------------+


+----------------------------------------+
; Flow Elapsed Time                      ;
+-------------------------+--------------+
; Module Name             ; Elapsed Time ;
+-------------------------+--------------+
; Analysis & Synthesis    ; 00:00:01     ;
; Fitter                  ; 00:00:02     ;
; Assembler               ; 00:00:03     ;
; Classic Timing Analyzer ; 00:00:00     ;
; Total                   ; 00:00:06     ;
+-------------------------+--------------+


------------
; Flow Log ;
------------
quartus_map --read_settings_files=on --write_settings_files=off lab2 -c lab2
quartus_fit --read_settings_files=off --write_settings_files=off lab2 -c lab2
quartus_asm --read_settings_files=off --write_settings_files=off lab2 -c lab2
quartus_tan --read_settings_files=off --write_settings_files=off lab2 -c lab2 --timing_analysis_only



?? 快捷鍵說明

復制代碼 Ctrl + C
搜索代碼 Ctrl + F
全屏模式 F11
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