當(dāng)山>0時(shí)，必然使集成運(yùn)放的輸出uo<0，從而導(dǎo)致二極管D2導(dǎo)通，D1截止，電路實(shí)現(xiàn)反相比例運(yùn)算，輸出電壓當(dāng)u<0時(shí)，必然使集成運(yùn)放的輸出uo>0，從而導(dǎo)致二極管D1導(dǎo)通D2截止，R+中電流為零，因此輸出電壓uo=0。u和uo的波形如圖（b）所小如果設(shè)二極管的導(dǎo)通電壓為0.7V，集成運(yùn)放的開環(huán)差模放大倍數(shù)為50萬倍，那么為使二極管D1導(dǎo)通，集成運(yùn)放的凈輸入電壓0.7v=014×10-=145×10同理可估算出為使D2導(dǎo)通集成運(yùn)放所需的凈輸入電壓，也是同數(shù)量級。可見，只要輸入電壓u使集成運(yùn)放的凈輸入電壓產(chǎn)生非常微小的變化，就可以改變D1和D2工作狀態(tài)，從而達(dá)到精密整流的目的在半波精密整流電路中，當(dāng)u>0時(shí)，U=Ku（K>0），當(dāng)u<0時(shí)，U=0若利用反相求和電路將-Ku與山負(fù)半周波形相加，就可實(shí)現(xiàn)全波整流。分析由A所組成的反相求和運(yùn)算電路可知，輸出電壓當(dāng)u>0時(shí)，U=2u，u∞=-（-2u+u）=u；當(dāng)u<0時(shí)，uo=0、想想？）uc-u；所以故此圖也稱為絕對值電路。當(dāng)輸入電壓為正弦波和三角波時(shí)，電路輸出波形分別如圖所示。
標(biāo)簽： 精密整流電路
上傳時(shí)間： 2022-06-26
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VIP專區(qū)-嵌入式/單片機(jī)編程源碼精選合集系列（53）資源包含以下內(nèi)容：1. c8051f020的A/D轉(zhuǎn)換的應(yīng)用事例.2. 封裝較完整的串口類庫.3. ucos下的FAT文件系統(tǒng)源碼。 config.h dir.C disk.C FAT.C Fat.h FDT.C file.C floppy.c floppy.h format.C.4. norflash的文件系統(tǒng)。 用于中低端手機(jī)開發(fā)的參考。 存儲文件或短消息或電話簿。.5. 關(guān)于2407的程序,可以實(shí)現(xiàn)FFT運(yùn)算,很好用,所有程序都在.6. Nand Flash Translation Layer 用于nandflash的操作。 bad block memory map garbage collection average er.7. Nand Flash low driver。.8. 使用JTAG口對AT91R40008芯片進(jìn)行FLASH編程的程序.9. 一個(gè)fpga開發(fā)板的原理圖.10. 復(fù)旦大學(xué)的nios講義.是學(xué)習(xí)nios的好材料..11. Avalon Bus的參考手冊.對做nios的sopc的人很有參考價(jià)值..12. 三星c3c2410原理圖 arm9系列.13. 視頻選擇卡設(shè)計(jì)原理圖 使用該原理圖設(shè)計(jì)一個(gè)多路選擇的視頻切換卡.14. ht1621的液晶驅(qū)動(dòng)程序.15. “華為模塊（GTM900）+ ARM(LPC2104) + LWIP1.1”以PPP 方式實(shí)現(xiàn)GPRS 無線數(shù)據(jù)傳輸.16. 內(nèi)部有說明,多為嵌入式系統(tǒng)程序,側(cè)重于實(shí)用的系統(tǒng),很有參考價(jià)值.17. DA 轉(zhuǎn)換 產(chǎn)生三角波 正旋波 梯形波（dac0832)換電路接成同相電壓輸出形式.18. 這是一個(gè)介紹嵌入式軟件的應(yīng)用.19. 基于DSP編寫的DS18B20的驅(qū)動(dòng)程序.20. 基于NIOS2的http的網(wǎng)絡(luò)應(yīng)用.21. 嵌入式系統(tǒng)設(shè)計(jì)師考試大綱.22. 座機(jī)短信發(fā)送平臺.23. 座機(jī)短信發(fā)送平臺.24. 座機(jī)短信發(fā)送平臺.25. 座機(jī)短信發(fā)送平臺.26. 這是一個(gè)RC500的開發(fā)實(shí)例.27. JTAG和ICE操作源代碼,在Linux系統(tǒng)下編譯使用.28. ARM指令集.29. 通用ASK信號解碼接收程序 1. 接收數(shù)據(jù)位數(shù)最多為40(5*8)位. 2. 由定時(shí)器對time進(jìn)行漸增,在TCC中斷程序中加入"INC TIME". 3. 寬脈沖最大允許時(shí)間和最小.30. 6963的液晶驅(qū)動(dòng)程序.31. usart的驅(qū)動(dòng)程序.32. 利用DELPHI結(jié)合研華數(shù)據(jù)采集卡PCI1711對模擬量和數(shù)字量進(jìn)行采集。.33. 泰瑞6713A開發(fā)箱原理圖,個(gè)人感覺有參考價(jià)值,大家可以下來看看。.34. 使用freescale的DP256B和D12做的CAN轉(zhuǎn)USB接口板的固件源代碼,現(xiàn)在的CAN分析儀每個(gè)至少要5000多,自己實(shí)現(xiàn)一個(gè),希望對大家開發(fā)CAN轉(zhuǎn)USB有所幫助..35. LF2407的各個(gè)模塊的測試程序,包含2407里面的所有模塊,均已經(jīng)調(diào)試通過,心血所致,希望對大家有所幫助..36. 在典型系統(tǒng)應(yīng)用中CC1000要與微控器相連該微控器必須能夠 通過三串行配置口PDATAPCLK和PALE控制CC1000改變不同模式.37. AD7705的C語言版,已通過測試.38. 這是關(guān)于串口中斷的程序.39. Wigger小板電路原理圖.40. USB和CPLD之間傳輸,已經(jīng)調(diào)試完成,向SRAM里寫數(shù)據(jù)后從FX2 USB GPIF 口讀出,使用EZ-USB Control Panel 讀.
標(biāo)簽： 設(shè)計(jì)手冊
上傳時(shí)間： 2013-08-03
上傳用戶：eeworm
用兩個(gè)按鍵通過單片機(jī)控制 DAC0832 的輸出，使 OUT 端可以輸出 0—5V 的幅 值，頻率為1KHZ的鋸齒波和三角波兩種波形。通上電源后；按下INT1則輸出
上傳時(shí)間： 2013-07-03
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為設(shè)計(jì)高性能、低損耗的電機(jī)，需要準(zhǔn)確地分析電機(jī)鐵耗。本文從鐵磁材料的磁化特點(diǎn)出發(fā)，以分離鐵耗模型為基礎(chǔ)，對交變磁化以及旋轉(zhuǎn)磁化條件下鐵磁材料和電機(jī)的鐵耗進(jìn)行分析和計(jì)算，分別從理論和實(shí)踐角度著重就電機(jī)鐵耗計(jì)算和測量中的一些相關(guān)問題作了深入研究。 按照分離鐵耗模型，鐵心損耗可以分成磁滯損耗、渦流損耗和異常損耗。本文首先從交流磁滯回線的產(chǎn)生機(jī)理出發(fā)，在Preisach靜態(tài)磁滯模型的基礎(chǔ)上，利用極限磁滯回線的對稱性，采用人工神經(jīng)網(wǎng)絡(luò)技術(shù)，建立了Preisach人工神經(jīng)網(wǎng)絡(luò)磁滯仿真模型，實(shí)現(xiàn)了對鐵磁材料交流磁滯回線的理論計(jì)算，為磁滯損耗的理論分析和計(jì)算奠定了基礎(chǔ)；為對交流磁滯回線進(jìn)行實(shí)測，本文給出了一種采用愛潑斯坦方圈測量鐵磁材料交流磁滯回線與磁滯損耗的新方法，該方法克服了環(huán)形樣片測量法的不足，操作簡單，且測量精度高，具有較好的實(shí)用價(jià)值。利用該方法得到的實(shí)驗(yàn)數(shù)據(jù)很好地驗(yàn)證了理論計(jì)算結(jié)果。 對渦流損耗以及異常損耗的計(jì)算模型，本文系統(tǒng)地給出了其推導(dǎo)過程，對模型中的參數(shù)進(jìn)一步加以明確，并對模型的特點(diǎn)進(jìn)行了分析。鐵磁材料異常損耗計(jì)算模型是基于統(tǒng)計(jì)學(xué)原理推導(dǎo)而來的，模型中參數(shù)的確定涉及到鐵磁材料的微觀特性，本文給出了通過實(shí)驗(yàn)確定其參數(shù)的具體方法；考慮到工程中異常損耗計(jì)算模型是其理論模型的簡化形式，文中對兩者的差別進(jìn)行了分析。 在分析電機(jī)鐵耗時(shí)，既要考慮鐵心材料本身的損耗特性，也要考慮電機(jī)供電方式以及鐵心中磁場變化等因素對鐵耗的影響。在對鐵磁材料損耗特性分析的基礎(chǔ)上，本文考慮到局部磁滯回環(huán)對電機(jī)鐵耗的影響，推導(dǎo)了計(jì)及局部磁滯作用的電機(jī)鐵耗模型，并從理論上對C.P.Steinmetz的磁滯損耗經(jīng)驗(yàn)公式進(jìn)行了驗(yàn)證，從而明確了公式中經(jīng)驗(yàn)系數(shù)的物理意義；同時(shí)通過實(shí)驗(yàn)研究，分析了磁化頻率對磁滯損耗系數(shù)的影響，提出了在磁化頻率較高時(shí)分段確定磁滯損耗系數(shù)的方法；考慮到現(xiàn)代電機(jī)控制策略以及供電方式的多樣性，本文對正弦波、方波以及三角波電壓供電時(shí)鐵心材料的交變鐵耗模型分別進(jìn)行了推導(dǎo)，給出了其解析表達(dá)式，并通過實(shí)測證明了模型的有效性；對SPWM這類應(yīng)用較為廣泛的非正弦供電方式，推導(dǎo)了電機(jī)交變損耗的一般計(jì)算模型，分析了SPWM變頻器供電時(shí)電機(jī)鐵耗與變頻器參數(shù)的關(guān)系，給出了其關(guān)系的數(shù)量表達(dá)式; 同時(shí)采用改進(jìn)的愛潑斯坦方圈試驗(yàn)平臺對非正弦供電條件下的鐵磁材料損耗和電機(jī)鐵耗進(jìn)行了實(shí)驗(yàn)研究。 考慮到電機(jī)鐵心制造過程中沖壓對鐵心材料特性的影響，本文提出了一套簡便的對鐵磁材料進(jìn)行沖壓影響研究的實(shí)驗(yàn)方法，利用該方法，有效地對材料的沖壓影響特性進(jìn)行了分析。在實(shí)驗(yàn)研究的基礎(chǔ)上，本文推導(dǎo)了考慮沖壓影響時(shí)的鐵磁材料損耗的修正系數(shù)，從而在傳統(tǒng)交變鐵耗分離模型的基礎(chǔ)上，建立了計(jì)及沖壓影響的電機(jī)鐵耗計(jì)算模型。對模型中引入的沖壓影響修正系數(shù)，給出了詳細(xì)的推導(dǎo)過程和明確的計(jì)算方法，從而使傳統(tǒng)的經(jīng)驗(yàn)修正方法得到改善。 在旋轉(zhuǎn)電機(jī)中，除交變磁化外，同時(shí)還存在大量的旋轉(zhuǎn)磁化。本文對旋轉(zhuǎn)磁化的物理機(jī)理進(jìn)行了初步探討，分析了旋轉(zhuǎn)磁化條件下的損耗特點(diǎn)，系統(tǒng)介紹了當(dāng)前鐵磁材料旋轉(zhuǎn)磁化性能以及旋轉(zhuǎn)磁化損耗實(shí)驗(yàn)測量和理論計(jì)算的方法和手段。 在以上鐵耗理論的基礎(chǔ)上，充分考慮鐵心的非線性及磁滯特性，本文建立了一般條件下的鐵心動(dòng)態(tài)電路模型，并將該模型應(yīng)用于異步電動(dòng)機(jī)鐵心等效電路中，推導(dǎo)了異步電動(dòng)機(jī)動(dòng)態(tài)鐵耗的分離等效電阻。以一臺三相異步電動(dòng)機(jī)為樣機(jī)，采用以上鐵耗的動(dòng)態(tài)分離等效電阻，有效地對電機(jī)鐵耗進(jìn)行了分離，從而為深入研究電機(jī)的動(dòng)態(tài)鐵耗特性提供了便利。 論文最后以一臺永磁無刷直流電機(jī)為例，對電機(jī)的運(yùn)行特性以及鐵心損耗進(jìn)行了分析計(jì)算。分析中應(yīng)用場路結(jié)合法，建立了永磁無刷電機(jī)換流等效電路模型，采用鏡像法建立了深槽無刷電機(jī)電樞反應(yīng)分析模型；在電機(jī)鐵耗分析中，推導(dǎo)了考慮旋轉(zhuǎn)磁化的電機(jī)鐵耗工程計(jì)算模型，對樣機(jī)鐵耗進(jìn)行了理論計(jì)算，并通過構(gòu)建實(shí)驗(yàn)平臺，對旋轉(zhuǎn)磁化條件下的樣機(jī)空載鐵耗進(jìn)行了測量，最終理論值與實(shí)測值吻合良好，證明了上述方法的有效性。
標(biāo)簽： 旋轉(zhuǎn)電機(jī) 損耗 分
上傳時(shí)間： 2013-07-02
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晶閘管控制電抗器(TCR)型靜止無功補(bǔ)償裝置(SVC)由于其對快速波動(dòng)負(fù)荷補(bǔ)償?shù)牧己眯Ч蔀榻陙頍o功補(bǔ)償?shù)臒狳c(diǎn)。本文對SVC的各種裝置進(jìn)行了介紹，研究了TCR型SVC的原理和控制方法，特別分析了12脈波TCR的諧波特性；引入了基于三角波調(diào)制的無功電流檢測方法，并在此基礎(chǔ)上設(shè)計(jì)了以AVR單片機(jī)為核心的動(dòng)態(tài)無功補(bǔ)償裝置控制器。在控制器硬件電路的基礎(chǔ)上，利用C語言進(jìn)行軟件編程實(shí)現(xiàn)了控制器對裝置的自動(dòng)控制。通過變電站的現(xiàn)場實(shí)驗(yàn)證明控制器能夠準(zhǔn)確、快速、可靠的控制TCR實(shí)現(xiàn)對波動(dòng)負(fù)荷的快速補(bǔ)償。
上傳時(shí)間： 2013-08-03
上傳用戶：baitouyu
本課題為電流型高電壓隔離電源，它是基于交流電流母線的分布式系統(tǒng)，能夠整定短路電流，適應(yīng)高電壓工作環(huán)境的隔離電源。本論文介紹了該課題的應(yīng)用場合，簡要介紹了分布式系統(tǒng)的種類及各自優(yōu)勢，以及已有的電流型副邊穩(wěn)壓電路相關(guān)的研究成果，并在此基礎(chǔ)上提出了本課題的研究目標(biāo)。 本篇論文主要針對課題方案的三個(gè)方面進(jìn)行論述，分別闡述如下： 一，母線電流產(chǎn)生系統(tǒng)與電流型副邊開關(guān)電路的匹配問題，包括各部分電路的功能介紹、電流型副邊開關(guān)電路的小信號等效電路的建模、高電壓隔離變壓器及磁元件的選擇； 二，模塊體積小型化有利于高壓部件的設(shè)計(jì)安裝和EMS防護(hù)。為了省去體積較大的輔助電源部分，本課題采用了副邊電路自供電的方式。在低壓自供電方式下，利用比較器、TLA31等器件產(chǎn)生多路同步三角波以及開關(guān)驅(qū)動(dòng)PWM脈沖。對自供電方式下的三角波振蕩器進(jìn)行比較，并對三角波振蕩器電路模塊進(jìn)行了建模以及系統(tǒng)反饋補(bǔ)償； 三，在本方案中實(shí)現(xiàn)了電流源拓?fù)涞耐秸骷夹g(shù)，利用PMOS管替代續(xù)流二極管，減小了電路的損耗、散熱器的使用以及模塊的體積。 本篇論文對本課題設(shè)計(jì)的核心部分進(jìn)行了比較詳細(xì)的介紹和分析，具體的參數(shù)計(jì)算方法也一一列出。最終，論文以研究目標(biāo)為方向，通過一系列的改進(jìn)措施，基本實(shí)現(xiàn)了課題要求。
標(biāo)簽： 電流型 高電壓 隔離開關(guān)
上傳時(shí)間： 2013-06-24
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電子功能模件是機(jī)電產(chǎn)品的基本組成部分，其水平高低直接決定整個(gè)機(jī)電產(chǎn)品的工作質(zhì)量。當(dāng)前PCB自動(dòng)測試系統(tǒng)大多為歐美產(chǎn)品，價(jià)格相當(dāng)昂貴，遠(yuǎn)遠(yuǎn)超出我國中小電子企業(yè)的承受能力。為了提高我國中小企業(yè)電子設(shè)備的競爭力，本課題研發(fā)了適合于我國中小企業(yè)、價(jià)格低廉、使用方便的PCB路內(nèi)測試系統(tǒng)。 本文首先詳細(xì)介紹了PCB各種檢測技術(shù)的原理和特點(diǎn)，然后根據(jù)本課題面向的用戶群和他們對PCB測試的需求，組建PCB內(nèi)測試系統(tǒng)。本系統(tǒng)基于虛擬儀器設(shè)計(jì)思想，以PCB上模擬電子器件、組合邏輯電路及由其構(gòu)成的功能模塊等為被測對象，包括路內(nèi)測試儀、邏輯分析單元、信號發(fā)生器、高速數(shù)據(jù)采集器、多路通道掃描器及針床。其中：路內(nèi)測試儀對不同被測對象選擇不同測試方法，采用電位隔離法實(shí)現(xiàn)了被測對象與PCB上其他元器件的隔離，并采用自適應(yīng)測試方法提高測試結(jié)果的準(zhǔn)確度。邏輯分析單元主要采用反向驅(qū)動(dòng)技術(shù)測試常見的組合邏輯電路。信號發(fā)生器能同時(shí)產(chǎn)生兩路正弦波、方波、斜波、三角波等常用波形。數(shù)據(jù)采集器能同時(shí)采集四路信號，以USB接口與主機(jī)通訊。多路通道掃描器采用小型繼電器陣列來實(shí)現(xiàn)，可擴(kuò)展性好。針床采用新型夾具，既保證接觸性能，又不至破壞觸點(diǎn)。 實(shí)踐表明，本系統(tǒng)能對常用電子功能模件進(jìn)行自動(dòng)測試，基本達(dá)到了預(yù)期目標(biāo)。
標(biāo)簽： PCB 故障診斷 測試系統(tǒng)
上傳時(shí)間： 2013-06-06
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任意波形發(fā)生器已成為現(xiàn)代測試領(lǐng)域應(yīng)用最為廣泛的通用儀器之一，代表了信號源的發(fā)展方向。直接數(shù)字頻率合成(DDS)是二十世紀(jì)七十年代初提出的一種全數(shù)字的頻率合成技術(shù)，其查表合成波形的方法可以滿足產(chǎn)生任意波形的要求。由于現(xiàn)場可編程門陣列(FPGA)具有高集成度、高速度、可實(shí)現(xiàn)大容量存儲器功能的特性，能有效地實(shí)現(xiàn)DDS技術(shù)，極大的提高函數(shù)發(fā)生器的性能，降低生產(chǎn)成本。 本文首先介紹了函數(shù)波形發(fā)生器的研究背景和DDS的理論。然后詳盡地?cái)⑹隽擞肍PGA完成DDS模塊的設(shè)計(jì)過程，接著分析了整個(gè)設(shè)計(jì)中應(yīng)處理的問題，根據(jù)設(shè)計(jì)原理就功能上進(jìn)行了劃分，將整個(gè)儀器功能劃分為控制模塊、外圍硬件、FPGA器件三個(gè)部分來實(shí)現(xiàn)。最后就這三個(gè)部分分別詳細(xì)地進(jìn)行了闡述。 在實(shí)現(xiàn)過程中，本設(shè)計(jì)選用了Altera公司的EP2C35F672C6芯片作為產(chǎn)生波形數(shù)據(jù)的主芯片，充分利用了該芯片的超大集成性和快速性。在控制芯片上選用了三星公司的上S3C2440作為控制芯片。本設(shè)計(jì)中，F(xiàn)PGA芯片的設(shè)計(jì)和與控制芯片的接口設(shè)計(jì)是一個(gè)難點(diǎn)，本文利用Altera的設(shè)計(jì)工具QuartusⅡ并結(jié)合Verilog—HDL語言，采用硬件編程的方法很好地解決了這一問題。論文最后給出了系統(tǒng)的測量結(jié)果，并對誤差進(jìn)行了一定分析，結(jié)果表明，可輸出步進(jìn)為0.01Hz，頻率范圍0.01Hz～20MHz的正弦波、三角波、鋸齒波、方波，或0.01Hz～20KHz的任意波。通過實(shí)驗(yàn)結(jié)果表明，本設(shè)計(jì)達(dá)到了預(yù)定的要求，并證明了采用軟硬件結(jié)合，利用FPGA技術(shù)實(shí)現(xiàn)任意波形發(fā)生器的方法是可行的。
標(biāo)簽： FPGA 函數(shù)信號發(fā)生器
上傳時(shí)間： 2013-08-03
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隨著科學(xué)技術(shù)的飛速發(fā)展，電子測量技術(shù)被廣泛應(yīng)用在電子、機(jī)械、醫(yī)療、測控及航天等各個(gè)領(lǐng)域，而電子測量技術(shù)要用到各種形式的高質(zhì)量信號源，因此任意波形發(fā)生器的研制就具有非常重要的現(xiàn)實(shí)意義。 本文便是基于DDS(DirectDigitalSynthesis)技術(shù)進(jìn)行任意波形發(fā)生器研制的。要求可以產(chǎn)生正弦波、方波、三角波與鋸齒波等常規(guī)波形，而且能夠產(chǎn)生任意波形，從而滿足研究的需要。具體工作如下： (一)介紹國內(nèi)外關(guān)于任意波形發(fā)生器研究的發(fā)展情況，闡述頻率合成技術(shù)的各種方式與技術(shù)對比情況，并選定直接數(shù)字頻率合成技術(shù)進(jìn)行研制。 (二)介紹系統(tǒng)的硬件設(shè)計(jì)構(gòu)成與功能實(shí)現(xiàn)，并對系統(tǒng)部件進(jìn)行逐一細(xì)述。選用單片機(jī)作為控制模塊，使用FPGA實(shí)現(xiàn)DDS功能作為技術(shù)核心，并對外圍電路的設(shè)計(jì)與接口技術(shù)進(jìn)行分析。 (三)講述DDS的工作原理、工作特點(diǎn)與技術(shù)指標(biāo)，并基于FPGA芯片EP1C3T144C8進(jìn)行設(shè)計(jì)，通過使用相位累加器與波形ROM等模塊，實(shí)現(xiàn)DDS功能。同時(shí)輔以使能模塊與行列式鍵盤，實(shí)現(xiàn)各種波形的靈活輸出。 (四)給出系統(tǒng)產(chǎn)生的測試數(shù)據(jù)，并對影響頻譜純度的雜散與噪聲產(chǎn)生的原因進(jìn)行分析。
標(biāo)簽： FPGA 任意波形發(fā)生器
上傳時(shí)間： 2013-04-24
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逆變控制器的發(fā)展經(jīng)歷從分立元件的模擬電路到以專用微處理芯片（DSP/MCU）為核心的電路系統(tǒng)，并從數(shù)模混合電路過渡到純數(shù)字控制的歷程。但是，通用微處理芯片是為一般目的而設(shè)計(jì)，存在一定局限。為此，近幾年來逆變器專用控制芯片（ASIC）實(shí)現(xiàn)技術(shù)的研究越來越受到關(guān)注，已成為逆變控制器發(fā)展的新方向之一。本文利用一個(gè)成熟的單相電壓型PWM逆變器控制模型，圍繞逆變器專用控制芯片ASIC的實(shí)現(xiàn)技術(shù)，依次對專用芯片的系統(tǒng)功能劃分，硬件算法，全系統(tǒng)的硬件設(shè)計(jì)及優(yōu)化，流水線操作和并行化，芯片運(yùn)行穩(wěn)定性等問題進(jìn)行了初步研究。首先引述了單相電壓型PWM逆變器連續(xù)時(shí)間和離散時(shí)間的數(shù)學(xué)模型，以及基于極點(diǎn)配置的單相電壓型PWM逆變器電流內(nèi)環(huán)電壓外環(huán)雙閉環(huán)控制系統(tǒng)的設(shè)計(jì)過程，同時(shí)給出了仿真結(jié)果，仿真表明此系統(tǒng)具有很好的動(dòng)、靜態(tài)性能，并且具有自動(dòng)限流功能，提高了系統(tǒng)的可靠性。緊接著分析了FPGA器件的特征和結(jié)構(gòu)。在給出本芯片應(yīng)用目標(biāo)的基礎(chǔ)上，制定了FPGA目標(biāo)器件的選擇原則和芯片的技術(shù)規(guī)格，完成了器件選型及相關(guān)的開發(fā)環(huán)境和工具的選取。然后系統(tǒng)闡述了復(fù)雜FPGA設(shè)計(jì)的設(shè)計(jì)方法學(xué)，詳細(xì)介紹了基于FPGA的ASIC設(shè)計(jì)流程，概要介紹了僅使用QuartusII的開發(fā)流程，以及Modelsim、SynplifyPro、QuartusII結(jié)合使用的開發(fā)流程。在此基礎(chǔ)上，進(jìn)行了芯片系統(tǒng)功能劃分，針對：DDS標(biāo)準(zhǔn)正弦波發(fā)生器，電壓電流雙環(huán)控制算法單元，硬件PI算法單元，SPWM產(chǎn)生器，三角波發(fā)生器，死區(qū)控制器，數(shù)據(jù)流/控制流模塊等逆變器控制硬件算法/控制單元，研究了它們的硬件算法，完成了模塊化設(shè)計(jì)。分析了全數(shù)字鎖相環(huán)的結(jié)構(gòu)和模型，以此為基礎(chǔ)，設(shè)計(jì)了一種應(yīng)用于逆變器的，用比例積分方法替代傳統(tǒng)鎖相系統(tǒng)中的環(huán)路濾波，用相位累加器實(shí)現(xiàn)數(shù)控振蕩器（DCO）功能的高精度二階全數(shù)字鎖相環(huán)（DPLL）。分析了“流水線操作”等設(shè)計(jì)優(yōu)化問題，并針對逆變器控制系統(tǒng)中，控制系統(tǒng)算法呈多層結(jié)構(gòu)，且層與層之間還有數(shù)據(jù)流聯(lián)系，其執(zhí)行順序和數(shù)據(jù)流的走向較為復(fù)雜，不利于直接采用流水線技術(shù)進(jìn)行設(shè)計(jì)的特點(diǎn)，提出一種全新的“分層多級流水線”設(shè)計(jì)技術(shù)，有效地解決了復(fù)雜控制系統(tǒng)的流水線優(yōu)化設(shè)計(jì)問題。本文最后對芯片運(yùn)行穩(wěn)定性等問題進(jìn)行了初步研究。指出了設(shè)計(jì)中的“競爭冒險(xiǎn)”和飽受困擾之苦的“亞穩(wěn)態(tài)”問題，分析了產(chǎn)生機(jī)理，并給出了常用的解決措施。
上傳時(shí)間： 2013-05-28
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