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三軸傳感器

  • 基于以太網(wǎng)接口的ARMJTAG仿真器設(shè)計(jì)

    在嵌入式系統(tǒng)的開(kāi)發(fā)過(guò)程中,仿真器是一個(gè)必不可少的開(kāi)發(fā)工具。特別是對(duì)于初級(jí)嵌入式系統(tǒng)開(kāi)發(fā)工程師,借助一個(gè)功能強(qiáng)大的仿真器進(jìn)行開(kāi)發(fā)工作,可以達(dá)到事半功倍的效果。一個(gè)嵌入式仿真、調(diào)試系統(tǒng)支持單步執(zhí)行、設(shè)置斷點(diǎn)、觀察變量?jī)?nèi)容及寄存器內(nèi)容等功能。開(kāi)發(fā)人員可以通過(guò)各類(lèi)調(diào)試功能觀察變量和寄存器的變化,從而可以很清楚的了解整個(gè)程序運(yùn)行的狀況,及時(shí)的調(diào)整和修改程序,并不需要反復(fù)的向芯片燒寫(xiě)程序,就可以完成對(duì)于程序的調(diào)試工作。 @@ 本文在分析了目前市場(chǎng)上常用仿真器的設(shè)計(jì)原理的基礎(chǔ)上,提出了以三星公司的S3C44BO ARM7處理器為主CPU,通過(guò)以太網(wǎng)接口進(jìn)行數(shù)據(jù)傳輸?shù)腁RMJTAT仿真器的設(shè)計(jì)方案。利用這種仿真器進(jìn)行程序調(diào)試,不僅可以大幅度的提高下載速度,還可以實(shí)現(xiàn)仿真器資源的共享,而且調(diào)試時(shí)程序是在目標(biāo)板上運(yùn)行,仿真更接近于目標(biāo)硬件。 @@ 文中首先對(duì)于傳統(tǒng)仿真器的設(shè)計(jì)原理、作用、存在的問(wèn)題進(jìn)行了研究,然后提出了基于S3C44BO的以太網(wǎng)接口的ARM-JTAG仿真器的設(shè)計(jì)。該仿真器的設(shè)計(jì)主要分為以下幾步:第一,提出總體設(shè)計(jì)方案,包括硬件的設(shè)計(jì)及軟件的設(shè)計(jì)。第二,詳細(xì)介紹該仿真器的硬件結(jié)構(gòu)設(shè)計(jì)和程序開(kāi)發(fā)過(guò)程,其中特別對(duì)以太網(wǎng)接口的設(shè)計(jì)進(jìn)行了研究。第三,總結(jié)了該仿真器的功能、特點(diǎn)。 @@關(guān)鍵詞:仿真器;S3C44BO;以太網(wǎng)接口;JTAG;LwIP

    標(biāo)簽: ARMJTAG 以太網(wǎng)接口 仿真器

    上傳時(shí)間: 2013-06-16

    上傳用戶(hù):253189838

  • 卷積碼在CDMA2000中的應(yīng)用及其譯碼器FPGA實(shí)現(xiàn)

    數(shù)字信息在有噪聲的信道中傳輸時(shí),受到噪聲的影響,誤碼總是不可避免的。根據(jù)香農(nóng)信息理論,只要使Es/N0足夠大,就可以達(dá)到任意小的誤碼率。采用差錯(cuò)控制編碼,即信道編碼技術(shù),可以在一定的Es/N0條件下有效地降低誤碼率。按照對(duì)信息元處理方式不同,信道編碼分為分組碼與卷積碼兩類(lèi)。卷積碼的k0和n0較小,實(shí)現(xiàn)最佳譯碼與準(zhǔn)最佳譯碼更加容易。卷積碼運(yùn)用廣泛,被ITU選入第三代移動(dòng)通信系統(tǒng),作為包括WCDMA,CDMA2000和TD-SCDMA在內(nèi)的信道編碼的標(biāo)準(zhǔn)方案。 本文研究了CDMA2000業(yè)務(wù)通道中的幀結(jié)構(gòu),對(duì)CDMA2000系統(tǒng)中的卷積碼特性及維特比譯碼的性能限進(jìn)行了分析,并基于MATLAB平臺(tái)做了相應(yīng)的譯碼性能仿真。我們?cè)O(shè)計(jì)了一種可用于CDMA2000通信系統(tǒng)的通用、高速維特比譯碼器。該譯碼器在設(shè)計(jì)上具有以下創(chuàng)新之處:(1)采用通用碼表結(jié)構(gòu),支持可變碼率;幀控制模塊和頻率控制器模塊的設(shè)計(jì)中采用計(jì)數(shù)器、定時(shí)器等器件實(shí)現(xiàn)了可變幀長(zhǎng)、可變數(shù)據(jù)速率的數(shù)據(jù)幀處理方式。(2)結(jié)合流水線結(jié)構(gòu)思想,利用四個(gè)ACS模塊并行運(yùn)行,加快數(shù)據(jù)處理速度;在ACS模塊中,將路徑度量值存貯器的存儲(chǔ)結(jié)構(gòu)進(jìn)行優(yōu)化,防止數(shù)據(jù)讀寫(xiě)的阻塞,縮短存儲(chǔ)器讀寫(xiě)時(shí)間,使譯碼器的處理速度更快。(3)為了防止路徑度量值和幸存路徑長(zhǎng)度的溢出,提出了保護(hù)處理策略。我們還將設(shè)計(jì)結(jié)果在APEXEP20K30E芯片上進(jìn)行了硬件實(shí)現(xiàn)。該譯碼器芯片具有可變的碼率和幀長(zhǎng)處理能力,可以運(yùn)行于40MHZ系統(tǒng)時(shí)鐘下,內(nèi)部最高譯碼速度可達(dá)625kbps。本文所提出的維特比譯碼器硬件結(jié)構(gòu)具有很強(qiáng)的通用性和高速性,可以方便地應(yīng)用于CDMA2000移動(dòng)通信系統(tǒng)。

    標(biāo)簽: CDMA 2000 FPGA 卷積碼

    上傳時(shí)間: 2013-06-24

    上傳用戶(hù):lingduhanya

  • LDPC碼編碼器FPGA實(shí)現(xiàn)研究

    LDPC(低密度奇偶校驗(yàn)碼)編碼是提高通信質(zhì)量和數(shù)據(jù)傳輸速率的關(guān)鍵技術(shù)。LDPC碼應(yīng)用于實(shí)際通信系統(tǒng)是本課題的研究重點(diǎn)。實(shí)際通信要求在LDPC碼長(zhǎng)盡量短、碼率盡量高及硬件可實(shí)現(xiàn)的前提下,結(jié)合連續(xù)相位MSK調(diào)制,滿(mǎn)足歸一化信噪比SNR=2dB時(shí),系統(tǒng)誤碼率低于10-4。根據(jù)課題背景,本文主要研究基于FPGA的LDPC編碼器設(shè)計(jì)與實(shí)現(xiàn)。 LDPC碼的編碼復(fù)雜度往往與其幀長(zhǎng)的平方成正比,編碼復(fù)雜度大,成為編碼硬件實(shí)現(xiàn)的一個(gè)障礙;論文針對(duì)實(shí)際系統(tǒng)的預(yù)期指標(biāo),通過(guò)對(duì)多種矩陣構(gòu)造算法的預(yù)選方案及影響LDPC碼性能參數(shù)仿真分析,基于1/2碼率,1024和2048兩種幀長(zhǎng),設(shè)計(jì)了三種編碼器的備選方案,分別為直接下三角編碼器,串行準(zhǔn)循環(huán)編碼器和二階準(zhǔn)循環(huán)編碼器。 對(duì)于每種編碼器,分別設(shè)計(jì)了其整體結(jié)構(gòu),并對(duì)每種編碼器的功能模塊進(jìn)行深入研究,設(shè)計(jì)完成后利用第3方軟件MODELSIM對(duì)編碼器進(jìn)行了時(shí)序仿真;根據(jù)時(shí)序仿真結(jié)果和綜合報(bào)告對(duì)三種編碼方案進(jìn)行比較,最終選擇串行準(zhǔn)循環(huán)編碼器作為硬件實(shí)現(xiàn)的編碼方案。 最后,在FPGA中硬件實(shí)現(xiàn)了串行準(zhǔn)循環(huán)編碼器并對(duì)其進(jìn)行測(cè)試,利用MATLAB仿真程序和串口通信工具最終驗(yàn)證了這種編碼器的正確性和硬件可實(shí)現(xiàn)性。

    標(biāo)簽: LDPC FPGA 編碼器 實(shí)現(xiàn)研究

    上傳時(shí)間: 2013-08-02

    上傳用戶(hù):林魚(yú)2016

  • 基于FPGA的高頻數(shù)字DCDC變換器研究

    在傳統(tǒng)的電力電子電路中,DC/DC變換器通常采用模擬電路實(shí)現(xiàn)電壓或電流的控制。數(shù)字控制與模擬控制相比,有著顯著的優(yōu)點(diǎn),數(shù)字控制可以實(shí)現(xiàn)復(fù)雜的控制策略,同時(shí)大大提高系統(tǒng)的可靠性和靈活性,并易于實(shí)現(xiàn)系統(tǒng)的智能化。但目前數(shù)字控制基本上限于電力傳動(dòng)領(lǐng)域,DC/DC變換器由于其開(kāi)關(guān)頻率較高,一般其外圍功能由DSP或微處理器完成,而控制的核心,如PWM發(fā)生等大多采用專(zhuān)用控制芯片實(shí)現(xiàn)。FPGA由于其快速性、靈活性及保密性等優(yōu)點(diǎn),近年來(lái)在數(shù)字控制領(lǐng)域受到越來(lái)越多的關(guān)注。基于FPGA的DC/DC變換器是電力電子領(lǐng)域重要的研究方向之一。本文研究了同步Buck變換器的建模、設(shè)計(jì)及仿真,采用Xinlix的VIRTEX-Ⅱ PRO FPGA開(kāi)發(fā)板實(shí)現(xiàn)了Buck變換器的全數(shù)字控制。 論文首先從Buck變換器的理論分析入手,根據(jù)它的物理特性,研究了該變換器的狀態(tài)空間平均模型和小信號(hào)分析。為了獲得高性能的開(kāi)關(guān)電源,提出并分析了混雜模型設(shè)計(jì)方案,然后進(jìn)行了控制器設(shè)計(jì)。并采用MATLAB/SIMULINK建立了同步Buck電路的仿真模型,并進(jìn)行仿真研究。浮點(diǎn)仿真的運(yùn)算精度與溢出問(wèn)題,影響了仿真的精度。為了克服這些不足,作者采用了定點(diǎn)仿真方法,得到了滿(mǎn)意的仿真結(jié)果。論文還著重論述了開(kāi)關(guān)電源的數(shù)字控制器部分,數(shù)字控制器一般由三個(gè)主要功能模塊組成:模數(shù)轉(zhuǎn)換器、數(shù)字脈寬調(diào)制器(Digital PulseWidth Modulation:DPWM)和數(shù)字補(bǔ)償器。文中重點(diǎn)研究了DPWM和數(shù)字補(bǔ)償器,闡述了目前高頻數(shù)字控制變換器中存在的主要問(wèn)題,特別是高頻狀態(tài)下DPWM分辨率較低,影響控制精度,甚至引起極限環(huán)(Limit Cycling)現(xiàn)象,對(duì)DPWM分辨率的提高與系統(tǒng)硬件工作頻率之間的矛盾、DPWM分辨率與A/D分辨率之間的關(guān)系等問(wèn)題作了全面深入的分析。論文提出了一種新的提高DPWM分辨率的方法,該方法在不提高系統(tǒng)硬件頻率的前提下,采用軟件使DPWM的分辨率大大提高。作者還設(shè)計(jì)了兩種數(shù)字補(bǔ)償器,并進(jìn)行了分析比較,選擇了合適的補(bǔ)償算法,達(dá)到了改善系統(tǒng)性能的目的。 設(shè)計(jì)完成后,作者使用ISE 9.1i軟件進(jìn)行了FPGA實(shí)現(xiàn)的前、后仿真,驗(yàn)證了所提出理論及控制算法的正確性。作者完成了Buck電路的硬件制作及基于FPGA的軟件設(shè)計(jì),采用32MHz的硬件晶振實(shí)現(xiàn)了11-bit的DPWM分辨率,開(kāi)關(guān)頻率達(dá)到1MHz,得到了滿(mǎn)意的系統(tǒng)性能,論文最后給出了仿真和實(shí)驗(yàn)結(jié)果。

    標(biāo)簽: FPGA DCDC 高頻 數(shù)字

    上傳時(shí)間: 2013-07-23

    上傳用戶(hù):kristycreasy

  • 干涉型光纖水聽(tīng)器信號(hào)解調(diào)方法研究

    光纖水聽(tīng)器自問(wèn)世以來(lái),在巨大的軍事價(jià)值和民用價(jià)值推動(dòng)下得到了迅速發(fā)展,已逐漸從實(shí)驗(yàn)室研究階段走向工程應(yīng)用。同時(shí)隨著光纖水聽(tīng)器的不斷發(fā)展,對(duì)水聲信號(hào)的檢測(cè)技術(shù)以及數(shù)字處理能力也提出了新的要求。論文在此背景下開(kāi)展了一系列研究工作,并提出了利用FPGA(Field ProgrammableGate Array,現(xiàn)場(chǎng)可編程門(mén)陣列)實(shí)現(xiàn)光纖3×3耦合器解調(diào)算法的新思路。 目前干涉型光纖水聽(tīng)器的解調(diào)一般采用PGC(Phase Generated Carrier,相位生成載波技術(shù))技術(shù)和基于3×3光纖耦合器干涉的解調(diào)技術(shù)。PGC技術(shù)在解調(diào)過(guò)程中引入了載波信號(hào),它對(duì)采樣率,激光器等的要求都較高,因此我們把目光投向3×3耦合器解調(diào)技術(shù),文中對(duì)其解調(diào)原理進(jìn)行了闡述,對(duì)采樣率的確定進(jìn)行了討論,并對(duì)3×3耦合器三路輸出不對(duì)稱(chēng)的情況進(jìn)行了分析,最后在本文的結(jié)論部分提出了基于3×3耦合器解調(diào)的改良方案。 目前,光纖信號(hào)數(shù)字化解調(diào)的硬件實(shí)現(xiàn)采用DSP(Digital Signal Process,可編程數(shù)字信號(hào)處理器)信號(hào)處理機(jī),與之相比,F(xiàn)PGA解調(diào)具有速度快、資源占用少、易于擴(kuò)展等優(yōu)勢(shì)。本文對(duì)FPGA與DSP、ASIC(application-specificintegrated circuit,專(zhuān)用集成電路)實(shí)現(xiàn)方案進(jìn)行了對(duì)比,分析了適合利用FPGA實(shí)現(xiàn)的算法所應(yīng)具備的特征;介紹了3×3耦合器解調(diào)算法中各個(gè)模塊的設(shè)計(jì)情況;分析了系統(tǒng)的工作情況,硬件的構(gòu)造及芯片的選擇,最后驗(yàn)證了利用FPGA可以實(shí)現(xiàn)3×3耦合器解調(diào)算法。

    標(biāo)簽: 干涉型 光纖水聽(tīng)器 信號(hào)解調(diào) 方法研究

    上傳時(shí)間: 2013-07-03

    上傳用戶(hù):love1314

  • 新型并行Turbo編譯碼器的FPGA實(shí)現(xiàn)

    可靠通信要求消息從信源到信宿盡量無(wú)誤傳輸,這就要求通信系統(tǒng)具有很好的糾錯(cuò)能力,如使用差錯(cuò)控制編碼。自仙農(nóng)定理提出以來(lái),先后有許多糾錯(cuò)編碼被相繼提出,例如漢明碼,BCH碼和RS碼等,而C。Berrou等人于1993年提出的Turbo碼以其優(yōu)異的糾錯(cuò)性能成為通信界的一個(gè)里程碑。 然而,Turbo碼迭代譯碼復(fù)雜度大,導(dǎo)致其譯碼延時(shí)大,故而在工程中的應(yīng)用受到一定限制,而并行Turbo譯碼可以很好地解決上述問(wèn)題。本論文的主要工作是通過(guò)硬件實(shí)現(xiàn)一種基于幀分裂和歸零處理的新型并行Turbo編譯碼算法。論文提出了一種基于多端口存儲(chǔ)器的并行子交織器解決方法,很好地解決了并行訪問(wèn)存儲(chǔ)器沖突的問(wèn)題。 本論文在現(xiàn)場(chǎng)可編程門(mén)陣列(FPGA)平臺(tái)上實(shí)現(xiàn)了一種基于幀分裂和籬笆圖歸零處理的并行Turbo編譯碼器。所實(shí)現(xiàn)的并行Turbo編譯碼器在時(shí)鐘頻率為33MHz,幀長(zhǎng)為1024比特,并行子譯碼器數(shù)和最大迭代次數(shù)均為4時(shí),可支持8.2Mbps的編譯碼數(shù)掘吞吐量,而譯碼時(shí)延小于124us。本文還使用EP2C35FPGA芯片設(shè)計(jì)了系統(tǒng)開(kāi)發(fā)板。該開(kāi)發(fā)板可提供高速以太網(wǎng)MAC/PHY和PCI接口,很好地滿(mǎn)足了通信系統(tǒng)需求。系統(tǒng)測(cè)試結(jié)果表明,本文所實(shí)現(xiàn)的并行Turbo編譯碼器及其開(kāi)發(fā)板運(yùn)行正確、有效且可靠。 本論文主要分為五章,第一章為緒論,介紹Turbo碼背景和硬件實(shí)現(xiàn)相關(guān)技術(shù)。第二章為基于幀分裂和歸零的并行Turbo編碼的設(shè)計(jì)與實(shí)現(xiàn),分別介紹了編碼器和譯碼器的RTL設(shè)計(jì),還提出了一種基于多端口存儲(chǔ)器的并行子交織器和解交織器設(shè)計(jì)。第三章討論了使用NIOS處理器的SOC架構(gòu),使用SOC架構(gòu)處理系統(tǒng)和基于NIOSII處理器和uC/0S一2操作系統(tǒng)的架構(gòu)。第四章介紹了FPGA系統(tǒng)開(kāi)發(fā)板設(shè)計(jì)與調(diào)試的一些工作。最后一章為本文總結(jié)及其展望。

    標(biāo)簽: Turbo FPGA 并行 編譯碼器

    上傳時(shí)間: 2013-04-24

    上傳用戶(hù):ziyu_job1234

  • 實(shí)時(shí)三維信息獲取系統(tǒng)

    三維彩色信息獲取系統(tǒng)目的是獲取對(duì)象的三維空間坐標(biāo)和顏色信息。它是計(jì)算機(jī)視覺(jué)研究的重要內(nèi)容,也是當(dāng)前信息科學(xué)研究中的一個(gè)重要熱點(diǎn)。 本文首先介紹了三維信息獲取技術(shù)的意義和實(shí)時(shí)可重構(gòu)三維激光彩色信息獲取系統(tǒng)總體方案。該方案合理劃分了系統(tǒng)的圖像處理任務(wù),充分地利用了擁有的硬、軟件資源。闡述了基于FPGA處理器的硬件系統(tǒng)結(jié)構(gòu)及其工作原理和系統(tǒng)工作時(shí)序。 本文還研究了圖像處理系統(tǒng)中的數(shù)字邏輯設(shè)計(jì),總結(jié)出了較完整、規(guī)范化的設(shè)計(jì)流程和方法,介紹了從圖像處理算法到可編程邏輯器件的規(guī)范化映射方法,總結(jié)了在視頻系統(tǒng)中的高級(jí)設(shè)計(jì)技巧,包括并行流水線技術(shù)和循環(huán)結(jié)構(gòu)的硬件實(shí)現(xiàn)方式等。 為了說(shuō)明提出的設(shè)計(jì)方法,本文分析了基于自適應(yīng)閾值的結(jié)構(gòu)光條紋中心的方向模板快速檢測(cè)算法的硬件實(shí)現(xiàn)。該算法是把自適應(yīng)閾值法與可變方向模板法相結(jié)合,具有穩(wěn)定性好、精度高、計(jì)算簡(jiǎn)單、數(shù)據(jù)存儲(chǔ)量小、實(shí)現(xiàn)速度快的特點(diǎn),此外,該方法有利于硬件快速實(shí)現(xiàn)。實(shí)踐證明這種方法是實(shí)用的、有效的。 本文的重點(diǎn)在于研制了具有完全自主知識(shí)產(chǎn)權(quán)的實(shí)時(shí)可重構(gòu)三維激光彩色信息獲取系統(tǒng)中視頻圖像處理專(zhuān)用集成電路。該集成電路是實(shí)現(xiàn)系統(tǒng)快速算法的核心,使用現(xiàn)場(chǎng)可編程器FPGA器件EPlK50實(shí)現(xiàn)提取激光線、提取人頭輪廓線和提取中心顏色線算法;該集成電路還要實(shí)現(xiàn)系統(tǒng)所需的控制邏輯。控制部分包括將視頻采集輸出端口信號(hào)轉(zhuǎn)化為RGB真彩色信號(hào)的數(shù)據(jù)鎖存模塊、各FIFO緩存器的輸入輸出控制模塊和系統(tǒng)需要的其它信號(hào)控制模塊。提出提取輪廓線快速算法,即由FPGA處理器與主機(jī)交互式共同快速完成提取人頭正側(cè)影輪廓線算法。該專(zhuān)用集成電路研制是整個(gè)實(shí)時(shí)可重構(gòu)三維激光彩色信息獲取系統(tǒng)實(shí)現(xiàn)的關(guān)鍵。

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    上傳時(shí)間: 2013-07-23

    上傳用戶(hù):lguotao

  • 三體X

    網(wǎng)友根據(jù)劉慈欣三體系列小說(shuō)寫(xiě)作的“補(bǔ)全版”或者說(shuō)“續(xù)集”,網(wǎng)友評(píng)價(jià)說(shuō)有亂真之感。

    標(biāo)簽:

    上傳時(shí)間: 2013-04-24

    上傳用戶(hù):wfeel

  • 《傳感器與執(zhí)行器大全2003-2004年卷》[PDF]

    ·【內(nèi)容簡(jiǎn)介】本書(shū)是中國(guó)電子學(xué)會(huì)敏感技術(shù)分會(huì)、北京電子學(xué)會(huì)和北京電子商會(huì)傳感器分會(huì)年卷編委會(huì)編寫(xiě)的出版物,每年一卷。本卷分三部分,第1部分介紹傳感器與敏感元器件國(guó)家標(biāo)準(zhǔn);第2部分介紹傳感器、變送器和執(zhí)行器產(chǎn)品;第3部分介紹研究、生產(chǎn)和銷(xiāo)售這些產(chǎn)品的技術(shù)支持。 本書(shū)是選用傳感器與執(zhí)行器的必備手冊(cè),可供傳感器與執(zhí)行器生產(chǎn)、研制和應(yīng)用的廠商及科技工作者閱讀,也可供高等院校有關(guān)專(zhuān)業(yè)的師生參考。 【目錄信息】

    標(biāo)簽: 2003 2004 傳感器

    上傳時(shí)間: 2013-06-02

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  • 變頻器原理與應(yīng)用教程

    ·作    者: 三菱電機(jī)株式會(huì)社 I S B N: 7118019917 頁(yè)    數(shù): 176 開(kāi)    本: 大16開(kāi) 封面形式: 簡(jiǎn)裝本 出 版 社: 國(guó)防工業(yè)出版社   本社特價(jià)書(shū)  出版日期: 2001-7-1 定    價(jià): 40元 變頻器原理與應(yīng)用教程 內(nèi)容簡(jiǎn)介本書(shū)

    標(biāo)簽: 變頻器原理 應(yīng)用教程

    上傳時(shí)間: 2013-08-01

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