隨著微電子技術(shù)的發(fā)展，可編程邏輯器件取得了迅速的發(fā)展，其功能日益強(qiáng)大，F(xiàn)PGA內(nèi)部可用邏輯資源飛速增長，近來推出的FPGA都針對數(shù)字信號處理的特點(diǎn)做了特定設(shè)計(jì)，集成了存儲器、鎖相環(huán)（PLL）、硬件乘法器、DSP模塊等，通過使用各個公司提供的FPGA開發(fā)軟件使用硬件描述語言，可以實(shí)現(xiàn)特定的信號處理算法，如FFT、FIR等算法，為電子設(shè)計(jì)工程師提供了新的選擇。實(shí)時圖像處理系統(tǒng)采用FPGA+DSP的結(jié)構(gòu)來完成整個復(fù)雜的圖像處理算法。將圖像處理算法進(jìn)行分類，F(xiàn)PGA和DSP份協(xié)作發(fā)揮各自的長處，對于算法實(shí)現(xiàn)簡單、運(yùn)算量大、實(shí)時性高的這類處理過程由大容量高性能的FPGA實(shí)現(xiàn)，DSP則用來處理經(jīng)過預(yù)處理后的圖像數(shù)據(jù)，來運(yùn)行算法結(jié)構(gòu)復(fù)雜，乘加運(yùn)算多的算法。整個系統(tǒng)主要包括FPGA處理單元、DSP處理單元以及PCI接口通訊三個部分。主要取得的了以下的研究成果：（1）研究了FPGA的工作原理及應(yīng)用，完成了Stratix芯片的選型。設(shè)計(jì)了數(shù)字圖像處理板的電路原理圖和PCB設(shè)計(jì)圖。并對電路板進(jìn)行調(diào)試，工作正常。（2）完成了FPGA程序下載電纜的PCB電路設(shè)計(jì)，并調(diào)試成功，應(yīng)用到FPGA的調(diào)試下載配置中，取得了良好的實(shí)驗(yàn)與經(jīng)濟(jì)效果。（3）充分利用FPGA的設(shè)計(jì)開發(fā)軟件與工具，完成了中值濾波、形態(tài)學(xué)濾波和自適應(yīng)閾值的FPGA實(shí)現(xiàn)，并給出了詳細(xì)的實(shí)現(xiàn)過程。將算法下載到FPGA芯片，經(jīng)過試驗(yàn)調(diào)試，達(dá)到要求。（4）研究了PCI接口通訊的實(shí)現(xiàn)方式，選用PCI9054芯片實(shí)現(xiàn)通訊，完成PCI接口電路設(shè)計(jì)，經(jīng)過調(diào)試，實(shí)現(xiàn)了中斷、DMA等方式，滿足了數(shù)據(jù)傳輸?shù)囊蟆＃?）學(xué)習(xí)了C6701DSP芯片的工作特性以及內(nèi)部功能結(jié)構(gòu)，完成了DSP外圍存儲器的擴(kuò)展、時鐘信號發(fā)生以及電源模塊等外圍電路的設(shè)計(jì)。
標(biāo)簽： FPGA DSP 紅外 圖像預(yù)處理
上傳時間： 2013-07-22
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該論文介紹二次雷達(dá)的基本概念、發(fā)展歷史、工作流程和運(yùn)作機(jī)理以及單脈沖二次雷達(dá)的系統(tǒng)原理,并且對傳統(tǒng)的單脈沖二次雷達(dá)應(yīng)答信號處理器的硬件結(jié)構(gòu)進(jìn)行改進(jìn),提出一種全新的應(yīng)答處理器硬件結(jié)構(gòu),即FPGA+DSP的混合結(jié)構(gòu).這種硬件結(jié)構(gòu)的特點(diǎn)是結(jié)構(gòu)靈活,有較強(qiáng)的通用性.該論文圍繞FPGA+DSP這種數(shù)字信號處理的硬件結(jié)構(gòu),闡述了它在單脈沖二次雷達(dá)應(yīng)答數(shù)字信號處理器中的應(yīng)用,使用VHDL語言設(shè)計(jì)FPGA程序,并且給出主要模塊的仿真結(jié)果.FPGA主要完成距離計(jì)數(shù)、方位計(jì)數(shù)、脈沖分解、產(chǎn)生應(yīng)答數(shù)據(jù)送給DSP、與PC104交換報(bào)表等功能.長時間的成功試驗(yàn)表明,基于FPGA和DSP技術(shù)的二次雷達(dá)應(yīng)答信號處理器在3毫秒內(nèi)可以同時處理四個重疊應(yīng)答,計(jì)算所接收的每一個脈沖的到達(dá)方向,得到真實(shí)脈沖并且給出脈沖置信度.系統(tǒng)達(dá)到了預(yù)期的目的.該課題的另外一個重要意義是對傳統(tǒng)的二次監(jiān)視雷達(dá)應(yīng)答信號處理器進(jìn)行了改進(jìn),使單脈沖二次雷達(dá)系統(tǒng)的應(yīng)答處理能力在可靠性、穩(wěn)定性和系統(tǒng)精度三個方面有質(zhì)的飛躍.
標(biāo)簽： FPGA DSP 二次雷達(dá) 處理器
上傳時間： 2013-04-24
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目前,以互聯(lián)網(wǎng)業(yè)務(wù)為代表的網(wǎng)絡(luò)應(yīng)用,正快速地向包括數(shù)據(jù)、語音、圖像的綜合寬帶多媒體方向發(fā)展,構(gòu)建寬帶化、大容量、全業(yè)務(wù)、智能化的現(xiàn)代通信網(wǎng)絡(luò)已成為大勢所趨.寬帶無線接入(BWA)憑借其組網(wǎng)快速靈活、運(yùn)營維護(hù)方便及成本較低等競爭優(yōu)勢,迅速成為市場熱點(diǎn),各種微波、無線通信領(lǐng)域的先進(jìn)手段和方法不斷引入,各種寬帶無線接入技術(shù)迅速涌現(xiàn).由于BWA要用于非視距傳輸,所以必須考慮無線信道的多經(jīng)效應(yīng).而OFDM技術(shù)憑借著魯棒的對抗頻率選擇性衰落能力和極高頻譜效率引起了學(xué)術(shù)界和工業(yè)界的高度重視.其基本思想是把調(diào)制在單載波上的高速串行數(shù)據(jù)流,分成多路低速的數(shù)據(jù)流,調(diào)制到多個正交載波上并行傳輸,這樣在傳輸時,雖然整個信道是頻率選擇性衰落,但是各個子信道卻是平坦衰落,有效對抗了多經(jīng)效應(yīng),同時由于各個子載波是正交的,極大提高了頻譜效率.可以預(yù)料的是,隨著通信系統(tǒng)將向基于IPv6核心網(wǎng)的全I(xiàn)P包的傳輸方向發(fā)展,越來越多的通信系統(tǒng)將具有"突發(fā)模式"的特征.本文關(guān)注的正是突發(fā)OFDM系統(tǒng)接收機(jī)設(shè)計(jì)和實(shí)現(xiàn).由于IEEE 802.11a無線局域網(wǎng)是OFDM技術(shù)第一次真正的應(yīng)用于突發(fā)系統(tǒng),實(shí)現(xiàn)了面向IP的無線寬帶傳輸,所以基于IEEE 802.11a的突發(fā)OFDM系統(tǒng)有著重要的借鑒和研究價值,本文也正是圍繞著這個中心而展開.本文的各章節(jié)安排如下:在第一章中主要介紹OFDM的技術(shù)原理和在寬帶無線接入中的應(yīng)用,同時引出本文所關(guān)注的突發(fā)OFDM接收機(jī)設(shè)計(jì).在第二章中先介紹了相干接收和信道估計(jì)的概念,重點(diǎn)分析了本文所采用的WLAN信道模型和信道估計(jì)算法,然后在得到同步誤差表達(dá)式的基礎(chǔ)上,先用星座圖直觀的表現(xiàn)OFDM系統(tǒng)中各種同步誤差的影響,再從信噪比損失的角度對符種同步誤差進(jìn)行分析.第三章是本文的重點(diǎn)之一,在本章中對基于IEEE 802.11a的各種同步算法包括幀檢測和符號定時、載波同步和采樣時鐘同步進(jìn)行仿真和比較,并針對適合FPGA實(shí)現(xiàn)的同步算法進(jìn)行了重點(diǎn)的分析.第四章也是本文的重點(diǎn)之一,提出了整個OFDM系統(tǒng)平臺的硬件結(jié)構(gòu)和基于IEEE 802.11a的接收機(jī)FPGA設(shè)計(jì)方案,然后從整體上介紹了接收機(jī)的實(shí)現(xiàn)結(jié)構(gòu),并給出了接收機(jī)各個模塊的具體設(shè)計(jì),最后對整個系統(tǒng)調(diào)試過程和測試結(jié)果進(jìn)行了分析.
上傳時間： 2013-04-24
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本論文主要對無線擴(kuò)頻集成電路設(shè)計(jì)中的信道編解碼算法進(jìn)行研究并對其FPGA實(shí)現(xiàn)思路和方法進(jìn)行相關(guān)研究。 近年來無線局域網(wǎng)IEEE802.11b標(biāo)準(zhǔn)建議物理層采用無線擴(kuò)頻技術(shù)，所以開發(fā)一套擴(kuò)頻通信芯片具有重大的現(xiàn)實(shí)意義。無線擴(kuò)頻通信系統(tǒng)與常規(guī)通信相比，具有很強(qiáng)的抗干擾能力，并具有信息蔭蔽、多址保密通信等特點(diǎn)。無線信道的特性較復(fù)雜，因此在無線擴(kuò)頻集成電路設(shè)計(jì)中，加入信道編碼是提高芯片穩(wěn)定性的重要方法。 在了解擴(kuò)頻通信基本原理的基礎(chǔ)上，本文提出了“串聯(lián)級聯(lián)碼+兩次交織”的信道編碼方案。串聯(lián)的級聯(lián)碼由外碼——(15，9，4)里德-所羅門(Reed-Solomon)碼，和內(nèi)碼-(2，1，3)卷積碼構(gòu)成，交織則采用交織深度為4的塊交織。重點(diǎn)對RS碼的時域迭代譯碼算法和卷積碼的維特比譯碼算法進(jìn)行了詳細(xì)的討論，并完成信道編譯碼方案的性能仿真及用FPGA實(shí)現(xiàn)的方法。 計(jì)算機(jī)仿真的結(jié)果表明，采用此信道編碼方案可以較好的改善現(xiàn)有仿真系統(tǒng)的誤符號率。 本論文的內(nèi)容安排如下：第一章介紹了無線擴(kuò)頻通信技術(shù)的發(fā)展?fàn)顟B(tài)以及國內(nèi)外開發(fā)擴(kuò)頻通信芯片的現(xiàn)狀，并給出了本論文的研究內(nèi)容和安排。第二章主要介紹了擴(kuò)頻通信的基本原理，主要包括擴(kuò)頻通信的定義、理論基礎(chǔ)和分類，直接序列擴(kuò)頻通信方式的數(shù)學(xué)模型。第三章介紹了基本的信道編碼原理，信道編碼的分類和各自的特點(diǎn)。第四章給出了本課題選擇的信道編碼方案——“串聯(lián)級聯(lián)碼+兩次交織”，詳細(xì)討論了方案中里德-所羅門(Reed-Solomon)碼和卷積碼的基本原理、編碼算法和譯碼算法。最后給出編碼方案的實(shí)際參數(shù)。第五章對第四章提出的編碼方案進(jìn)行了性能仿真。第六章結(jié)合項(xiàng)目實(shí)際，討論了FPGA開發(fā)基帶擴(kuò)頻通信系統(tǒng)的設(shè)計(jì)思路和方法。首先對FPGA開發(fā)流程以及實(shí)際開發(fā)的工具進(jìn)行了簡要的介紹，然后給出了擴(kuò)頻通信系統(tǒng)的總體設(shè)計(jì)。對發(fā)射和接收子系統(tǒng)中信道編碼、解碼等相關(guān)功能模塊的實(shí)現(xiàn)原理和方法進(jìn)行分析。第七章對論文的工作進(jìn)行總結(jié)。
標(biāo)簽： FPGA 無線擴(kuò)頻 信道編解 技術(shù)研究
上傳時間： 2013-07-18
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本文主要研究Turbo碼的編碼和譯碼算法及其FPGA硬件實(shí)現(xiàn).在概述信道編碼理論及其發(fā)展歷程之后,簡要地論述了Turbo碼的原理.然后分別對Turbo碼的MAP譯碼算法,LOG-MAP算法進(jìn)行推導(dǎo),在給出LOG-MAP的推導(dǎo)之后,提出了對于LOG-MAP譯碼算法的兩點(diǎn)改進(jìn),采用三階牛頓插值函數(shù)對校驗(yàn)函數(shù)進(jìn)行擬合,采用雙滑動窗口技術(shù)取代傳統(tǒng)的單滑動窗口技術(shù).Turb碼還有一種譯碼復(fù)雜度相對較低的算法——SOVA算法,本文也給出了SOVA算法的詳細(xì)推導(dǎo)過程.在對LOG-MAP和SOVA算法的詳細(xì)推導(dǎo)之后,本文給出Turbo碼的軟件仿真,采用Matlab語言編寫Turbo碼仿真系統(tǒng)程序,仿真系統(tǒng)比較了單滑動窗口技術(shù)和雙滑動窗口技術(shù)在不同的信噪比下的譯碼性能.在軟件仿真的基礎(chǔ)上,本文給出了Turbo碼編碼器和采用LOG-MAP譯碼算法譯碼器的FPGA硬件實(shí)現(xiàn)方法.
上傳時間： 2013-06-19
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隨著通信網(wǎng)的發(fā)展和用戶需求的提高,光纖通信中的PDH體系逐漸被SDH體系所取代.SDH光纖通信系統(tǒng)以其通信容量大、傳輸性能好、接口標(biāo)準(zhǔn)、組網(wǎng)靈活方便、管理功能強(qiáng)大等優(yōu)點(diǎn)獲得越來越廣泛的應(yīng)用.但是在某些對傳輸容量需求不大的場合,SDH的巨大潛力和優(yōu)越性無法發(fā)揮出來,反而還會造成帶寬浪費(fèi).相反,PDH因其容量適中,配置靈活,成本低廉和功能齊全,可針對客戶不同需要設(shè)計(jì)不同的方案,在某些特定的接入場合具有一定的優(yōu)勢.本課題根據(jù)現(xiàn)實(shí)的需要,提出并設(shè)計(jì)了一種基于PDH技術(shù)的多業(yè)務(wù)單片F(xiàn)PGA傳輸系統(tǒng).系統(tǒng)可以同時提供12路E1的透明傳輸和一個線速為100M以太網(wǎng)通道,主要由一塊FPGA芯片實(shí)現(xiàn)大部分功能,該解決方案在集成度、功耗、成本以及靈活性等方面都具有明顯的優(yōu)勢.本文首先介紹數(shù)字通信以及數(shù)字復(fù)接原理和以太網(wǎng)的相關(guān)知識,然后詳細(xì)闡述了本系統(tǒng)的方案設(shè)計(jì),對所使用的芯片和控制芯片F(xiàn)PGA做了必要的介紹,最后具體介紹了系統(tǒng)硬件和FPGA編碼設(shè)計(jì),以及后期的軟硬件調(diào)試.歸納起來,本文主要具體工作如下:1.實(shí)現(xiàn)4路E1信號到1路二次群信號的復(fù)分接,主要包括全數(shù)字鎖相環(huán)、HDB3-NRZ編解碼、正碼速調(diào)整、幀頭檢測和復(fù)分接等.2.將以太網(wǎng)MII接口來的25M的MII信號通過碼速變換到25.344M,進(jìn)行映射.3.將三路二次群信號和變換過的以太網(wǎng)MII信號進(jìn)行5b6b編解碼,以利于在光纖上傳輸.4.高速時提取時鐘采用XILINX的CDR方案.并對接收到的信號經(jīng)過5b6b解碼后,分接出各路信號.
標(biāo)簽： FPGA PDH 多業(yè)務(wù) 方案
上傳時間： 2013-07-23
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早期的噴墨打印機(jī)由于其設(shè)計(jì)開發(fā)成本相對較高，僅僅用于一些專業(yè)印刷系統(tǒng)或者廣告設(shè)計(jì)行業(yè)。近年來，噴墨打印技術(shù)的成本大幅度下降，打印效果顯著改善。從最初的效果粗糙、輸出緩慢、耗時較長，發(fā)展到現(xiàn)在的照片級效果、輸出快速、操作簡便，特別是最新的噴墨打印機(jī)整合了數(shù)碼功能，這種類型的打印機(jī)具有很強(qiáng)的趣味性，它能根據(jù)打印用戶的不同要求，打印出各種非常有趣的家庭數(shù)碼影像效果出來。 本文首先研究了目前市場上幾個主流廠商的噴墨打印技術(shù)的特點(diǎn)，最新進(jìn)展以及相關(guān)技術(shù)。這些信息可以作為自身產(chǎn)品設(shè)計(jì)的一個重要參考，從而可以根據(jù)市場需求和產(chǎn)品自身定位，設(shè)計(jì)好噴墨打印機(jī)產(chǎn)品的規(guī)格要求，提高其在市場上的競爭力。 噴墨打印機(jī)的性價比是產(chǎn)品能否被用戶接受的關(guān)鍵因素，本文對噴墨打印機(jī)軟硬件平臺的構(gòu)建進(jìn)行了研究，并基于對性能和價格的綜合考慮，提出了本文的噴墨打印機(jī)軟硬件平臺。 噴墨打印機(jī)的相關(guān)技術(shù)很多，在知識產(chǎn)權(quán)方面，幾個主要的打印機(jī)廠商在許多國家和地區(qū)均有成千上萬篇專利對他們的產(chǎn)品進(jìn)行保護(hù)。 本文主要研究其中的Boot loader的實(shí)現(xiàn)，Printhead溫度的控制以及Printhead的打印控制這三個關(guān)鍵技術(shù)，并針對這些關(guān)鍵技術(shù)的基本原理及其實(shí)現(xiàn)方法進(jìn)行了深入的研究。 本文對噴墨打印機(jī)的相關(guān)核心技術(shù)做了比較深入的研究，這些研究工作對于有志于噴墨打印機(jī)開發(fā)的相關(guān)技術(shù)人員有較好的參考意義，同時，基于ARM的噴墨打印機(jī)系統(tǒng)，又是一個典型的嵌入式系統(tǒng)，這對其它嵌入式系統(tǒng)的設(shè)計(jì)也有較好的借鑒意義。
標(biāo)簽： ARM 噴墨打印機(jī) 關(guān)鍵技術(shù)
上傳時間： 2013-07-13
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介紹了三菱FX2N 系列PLC 在串行通訊技術(shù)中使用無協(xié)議數(shù)據(jù)傳輸?shù)闹噶罡袷剑约皢纹瑱C(jī)與其通訊的軟硬件實(shí)現(xiàn)方法。關(guān)鍵詞：PLC RS485 接口 無協(xié)議數(shù)據(jù)傳輸 打碼機(jī)控制器
標(biāo)簽： PLC 單片機(jī) 三菱 協(xié)議
上傳時間： 2013-05-20
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雕刻機(jī)的數(shù)控系統(tǒng)是三維雕刻機(jī)的控制核心，其控制系統(tǒng)的性能直接關(guān)系著三維雕刻機(jī)的加工質(zhì)量和加工效率，對雕刻機(jī)的性價比有著重要的影響。本論文在對三維雕刻機(jī)系統(tǒng)的結(jié)構(gòu)和功能進(jìn)行分析的基礎(chǔ)上，提出了一個以．ARM微處理器和CPLD器件構(gòu)建硬件平臺、基于μC/OS-Ⅱ?yàn)榍度胧娇刂葡到y(tǒng)的解決方案，充分利用ARM微處理器的高速運(yùn)算能力與CPLD的高速并行運(yùn)算能力，大大減少了系統(tǒng)的外圍接口器件，有效的降低系統(tǒng)成本。 此方案中選用Philips公司的基于ARM7內(nèi)核的LPC2214處理器作為主控芯片。對于系統(tǒng)的輸入/輸出的邏輯控制通過CPLD來實(shí)現(xiàn)，該芯片選用Atlera公司的EPM7128SLC84，作為處理器的外圍器件。同時對整個系統(tǒng)的硬件開發(fā)作了詳細(xì)說明：電源、SRAM、FLASH等芯片選型及設(shè)計(jì)；液晶顯示模塊及鍵盤的應(yīng)用設(shè)計(jì)；電機(jī)的輸入輸出電路設(shè)計(jì)等。 軟件部分包括Boot Loader、RTOS、應(yīng)用程序的設(shè)計(jì)等。其中，Rot Loader支持系統(tǒng)Boot、程序下載到RAM中執(zhí)行和燒寫到Flash存儲器等功能；RTOS包括操作系統(tǒng)的移植、任務(wù)管理、任務(wù)間的通信等，應(yīng)用程序的設(shè)計(jì)包括設(shè)備驅(qū)動程序、液晶顯示、鍵盤操作、電機(jī)控制等。同時用VB6.0開發(fā)了PC機(jī)下載控制界面，并對液晶模塊和電機(jī)進(jìn)行調(diào)試。
標(biāo)簽： ARM 雕刻機(jī) 控制系統(tǒng)設(shè)計(jì)
上傳時間： 2013-06-06
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當(dāng)今繡花機(jī)市場蓬勃發(fā)展，繡花機(jī)控制系統(tǒng)作為繡花機(jī)最核心的部分，是提高性能和降低成本的關(guān)鍵。本文結(jié)合浙江虎王科技有限公司與浙江大學(xué)的合作項(xiàng)目“繡花機(jī)控制系統(tǒng)”，設(shè)計(jì)出一套基于ARM的技術(shù)先進(jìn)、功能精簡、高性價比的繡花機(jī)控制系統(tǒng)。論文按照嵌入式系統(tǒng)的開發(fā)過程，先根據(jù)市場需求劃分了控制系統(tǒng)的功能模塊并構(gòu)建了總體架構(gòu),選擇了系統(tǒng)的軟硬件平臺，然后采用先進(jìn)的設(shè)計(jì)方法對繡花機(jī)控制系統(tǒng)的硬件和軟件進(jìn)行了設(shè)計(jì)。 第一章介紹了繡花機(jī)及其控制系統(tǒng)的發(fā)展過程和現(xiàn)狀，論述了嵌入式系統(tǒng)的定義、特點(diǎn)和發(fā)展，闡述了ARM的發(fā)展歷史、研究和應(yīng)用現(xiàn)狀，提出了論文的主要研究內(nèi)容，最后給出了論文的總體結(jié)構(gòu)。 第二章闡述了嵌入式系統(tǒng)的開發(fā)過程，選擇了軟硬件協(xié)同設(shè)計(jì)法為本系統(tǒng)的設(shè)計(jì)方法，論述了EDA技術(shù)的工作范圍和設(shè)計(jì)步驟，詳細(xì)討論了軟件的結(jié)構(gòu)化設(shè)計(jì)方法和面向?qū)ο笤O(shè)計(jì)方法的原理，最后給出了繡花機(jī)控制系統(tǒng)的設(shè)計(jì)原則。 第三章根據(jù)市場需求劃分了繡花機(jī)控制系統(tǒng)的功能模塊，構(gòu)建了系統(tǒng)總體架構(gòu)，并分析了每個模塊的具體功能；根據(jù)選型原則選出了適用于繡花機(jī)控制系統(tǒng)的上位機(jī)和下位機(jī)CPU芯片、操作系統(tǒng)及開發(fā)環(huán)境。 第四章根據(jù)總體架構(gòu)，在選好的CPU芯片的基礎(chǔ)．卜確定了繡花機(jī)控制系統(tǒng)的硬件框架，詳細(xì)設(shè)計(jì)了電源電路、復(fù)位電路、存儲器接口電路、鍵盤與顯示電路、USB接口電路、串行通信接口電路和下層機(jī)電接口電路。 第五章按照上位機(jī)和下位機(jī)的層次構(gòu)建了繡花機(jī)控制系統(tǒng)的軟件框架，設(shè)計(jì)了鍵盤輸入模塊、圖形顯示模塊、USB驅(qū)動模塊、花樣存儲與管理模塊、串口通信模塊、機(jī)電控制模塊的程序。 第六章回顧與總結(jié)全文的主要研究內(nèi)容，歸納了本文的主要研究成果，并對今后的研究工作作了展望。
標(biāo)簽： ARM 繡花機(jī) 嵌入式控制 系統(tǒng)設(shè)計(jì)
上傳時間： 2013-04-24
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