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  • OFDM系統同步及解調的FPGA實現.rar

    自20世紀80年代以來,正交頻分復用技術不但在廣播式數字音頻和視頻領域得到廣泛的應用,而且已經成為無線局域網標準(例如IEEE802.11a和HiperLAN/2等)的一部分。OFDM由于其頻譜利用率高,成本低等原因越來越受到人們的關注。隨著人們對通信數據化、寬帶化、個人化和移動化需求的增強,OFDM技術在綜合無線接入領域將會獲得越來越廣泛的應用。人們開始集中越來越多的精力開發OFDM技術在移動通信領域的應用,本文也是基于無線通信平臺上的OFDM技術的運用。 本文的所有內容都是建立在空地數據無線通信系統下行鏈路FPGA實現基礎上的。本文作者的主要工作集中在鏈路接收端的FPGA實現和調試上。主要包括幀同步(時間同步)算法的研究與設計、OFDM頻率同步算法的研究與設計以及同步模塊、OFDM解調模塊、QAM解調模塊的FPGA實現。最終實現高速數字圖像傳輸系統下行鏈路在無線環境中連通。 對于無線移動通信系統而言,多普勒頻移、收發設備的本地載頻偏差均可能破壞OFDM系統子載波之間的正交性,從而導致ICI,影響系統性能。另外,由于OFDM系統大多采用IFFT/FFT實現調制解調,因此在接收方確定FFT的起點對數據的正確解調也至關重要。同步技術即是針對系統中存在的定時偏差、頻率偏差進行定時、頻偏的估計與補償,來減少各種同步偏差對系統性能的影響。在OFDM實現的關鍵技術中,同步技術是十分重要的一部分。本文花費了三個章節闡述了同步技術的原理、算法和實現方法。 目前OFDM系統的載波同步方案,可以歸納為三大類:輔助數據類,盲估計類和基于循環前綴的半盲估計類。本文首先分析了各種載波同步方案的優缺點,并舉例說明了各個載波同步方式的實現方法。然后具體闡述了本文在FPGA平臺上實現的OFDM接收端同步的同步方式,包括其具體算法和FPGA實現結構。本文所采用的幀同步和頻率同步方案都是采用輔助數據類的,在闡述其具體算法的同時對算法在不同參數和不同形式下的性能做出了仿真對比分析。 OFDM的解調采用FFT算法,在FPGA上的實現是十分方便的。本文主要闡述其實現結構,重點放在提取有效數據部分有效數據位置的推導過程。最后介紹了本文實現QAM軟解調的解調方法。 本文闡述算法采用先提出原理,然后給出具體公式,再根據公式中的系數和變量分析算法性能的方式。在闡述實現方式時首先給出實現框圖,然后對框圖中比較重要或者復雜的部分進行詳細闡述。在介紹完每個模塊實現方式之后給出了仿真或者上板結果,最后再給出整體測試結果。

    標簽: OFDM FPGA

    上傳時間: 2013-06-26

    上傳用戶:希醬大魔王

  • 基于FPGA的DDC在頻譜儀中的設計.rar

    軟件無線電思想的出現帶來了接收機實現方式的革新。隨著近年來軟件無線電理論和應用趨于成熟與完善,軟件無線電技術已經被越來越廣泛地應用于無線通信系統和電子測量測試儀器中。數字下變頻技術作為軟件無線電的核心技術之一,在頻譜分析儀中也得到了越來越普遍的應用。 本人參與的手持式頻譜分析儀項目采用的是中頻數字化實現方式,可滿足輕巧,可重配置和低功耗的需求。數字化中頻的關鍵部件數字下變頻器DDC采用的是Intersil公司的ISL5216,這個器件和高性能FPGA共同組成手持頻譜儀的數字信號處理前端。這個數字前端就手持頻譜分析儀來說存在一定的局限性,ISL5216的信號處理帶寬單通道為1 MHz,4個通道級聯為3MHz,未能滿足譜儀分析帶寬日益增加的需求;系統集成度不高,ISL5216的功能要是集成到FPGA,可進一步提高系統集成度,降低物料成本和系統功耗。基于以上兩個方面的考慮,現正以手持頻譜分析儀項目為依托,基于Xilinx Spartan3A-DSP系列FPGA實現高速高處理帶寬的DDC。 本論文首先描述了數字下變頻基本理論和結構,對完成各級數字信號處理所涉及的數字正交變換、CORDIC算法、CIC、HB、多相濾波等關鍵算法做了適當介紹;然后介紹了當前主流FPGA的數字信號處理特性和其內部的DSP資源。接著詳細描述了數控振蕩器NCO、復數數字混頻器MIXER、5級CIC濾波器、5級HB濾波器和255階可編程FIR的設計和實現,并對各個模塊的不同實現方式作了對比和仿真測試數據作了分析。最后介紹了所設計DDC在手持頻譜分析儀中的主要應用。

    標簽: FPGA DDC 頻譜儀

    上傳時間: 2013-04-24

    上傳用戶:a155166

  • LTE系統中基帶DAGC的應用研究及FPGA實現.rar

    當今,移動通信正處于向第四代通信系統發展的階段,OFDM技術作為第四代數字移動通信(4G)系統的關鍵技術之一,被包括LTE在內的眾多準4G協議所采用。IDFT/DFT作為OFDM系統中的關鍵功能模塊,其精度對基帶解調性能產生著重大的影響,尤其對LTE上行所采用的SC_FDMA更是如此。為了使定點化IDFT/DFT達到較好的性能,本文采用數字自動增益控制(DAGC)技術,以解決過大輸入信號動態范圍所造成的IDFT/DFT輸出信噪比(SNR)惡化問題。 首先,本文簡單介紹了較為成熟的AAGC(模擬AGC)技術,并重點關注近年來為了改善其性能而興起的數字化AGC技術,它們主要用于壓縮ADC輸入動態范圍以防止其飽和。針對基帶處理中具有累加特性的定點化IDFT/DFT技術,進一步分析了AAGC技術和基帶DAGC在實施對象,實現方法等上的異同點,指出了基帶DAGC的必要性。 其次,根據LTE協議,搭建了從調制到解調的基帶PUSCH處理鏈路,并針對基于DFT的信道估計方法的缺點,使用簡單的兩點替換實現了優化,通過高斯信道下的MATLAB仿真,證明其可以達到理想效果。仿真結果還表明,在不考慮同步問題的高斯信道下,本文所搭建的基帶處理鏈路,采用64QAM進行調制,也能達到在SNR高于17dB時,硬判譯碼結果為極低誤碼率(BER)的效果。 再次,在所搭建鏈路的基礎上,通過理論分析和MATLAB仿真,證明了包括時域和頻域DAGC在內的基帶DAGC具有穩定接收鏈路解調性能的作用。同時,通過對幾種DAGC算法的比較后,得到的一套適用于實現的基帶DAGC算法,可以使IDFT/DFT的輸出SNR處于最佳范圍,從而滿足LTE系統基帶解調的要求。針對時域和頻域DAGC的差異,分別選定移位和加法,以及查表的方式進行基帶DAGC算法的實現。 最后,本文對選定的基帶DAGC算法進行了FPGA設計,仿真、綜合和上板結果說明,時域和頻域DAGC實現方法占用資源較少,容易進行集成,能夠達到的最高工作頻率較高,完全滿足基帶處理的速率要求,可以流水處理每一個IQ數據,使之滿足基帶解調性能。

    標簽: DAGC FPGA LTE

    上傳時間: 2013-05-17

    上傳用戶:laozhanshi111

  • 基于FPGA的小型CPU中通信協議的研究及IPCore的開發.rar

    FPGA作為新一代集成電路的出現,引起了數字電路設計的巨大變革。隨著FPGA工藝的不斷更新與改善,越來越多的用戶與設計公司開始使用FPGA進行系統開發,因此,PFAG的市場需求也越來越高,從而使得FPGA的集成電路板的工藝發展也越來越先進,在如此良性循環下,不久的將來,FPGA可以主領集成電路設計領域。正是由于FPGA有著如此巨大的發展前景與市場吸引力,因此,本文采用FPGA作為電路設計的首選。 @@ 隨著FPGA的開發技術日趨簡單化、軟件化,從面向硬件語言的VHDL、VerilogHDL設計語言,到現在面向對象的System Verilog、SystemC設計語言,硬件設計語言開始向高級語言發展。作為一個軟件設計人員,會很容易接受面向對象的語言。現在軟件的設計中,算法處理的瓶頸就是速度的問題,如果采用專用的硬件電路,可以解決這個問題,本文在第一章第二節詳細介紹了軟硬結合的開發優勢。另外,在第一章中還介紹了知識產權核心(IP Core)的發展與前景,特別是IP Core中軟核的設計與開發,許多FGPA的開發公司開始爭奪軟核的開發市場。 @@ 數字電路設計中最長遇到的就是通信的問題,而每一種通信方式都有自己的協議規范。在CPU的設計中,由于需要高速的處理速度,因此其內部都是用并行總線進行通信,但是由于集成電路資源的問題,不可能所有的外部設備都要用并行總線進行通信,因此其外部通信就需要進行串行傳輸。又因為需要連接的外部設備的不同,因此就需要使用不同的串行通信接口。本文主要介紹了小型CPU中常用的三種通信協議,那就是SPI、I2C、UART。除了分別論述了各自的通信原理外,本文還特別介紹了一個小型CPU的內部構造,以及這三個通信協議在CPU中所處的位置。 @@ 在硬件的設計開發中,由于集成電路本身的特殊性,其開發流程也相對的復雜。本文由于篇幅的問題,只對總的開發流程作了簡要的介紹,并且將其中最復雜但是又很重要的靜態時序分析進行了詳細的論述。在通信協議的開發中,需要注意接口的設計、時序的分析、驗證環境的搭建等,因此,本文以SPI數據通信協議的設計作為一個開發范例,從協議功能的研究到最后的驗證測試,將FPGA 的開發流程與關鍵技術等以實例的方式進行了詳細的論述。在SPI通信協議的開發中,不僅對協議進行了詳細的功能分析,而且對架構中的每個模塊的設計都進行了詳細的論述。@@關鍵詞:FPGA;SPI;I2C;UART;靜態時序分析;驗證環境

    標簽: IPCore FPGA CPU

    上傳時間: 2013-04-24

    上傳用戶:vvbvvb123

  • 移動無線信道特性及基于FPGA的信道仿真器實現.rar

    移動無線信道特性對移動通信系統性能具有重要影響,移動信道建模和仿真對移動通信系統的研發具有重要意義。因此,對移動信道建模與仿真進行研究,具有重要的理論意義和實際應用價值。 本文從無線電波的傳播特點出發,分析了無線電波的傳播模型和描述信道特性的主要參數,重點分析了移動小尺度衰落模型;結合無線電波傳輸環境的特點,研究了平坦衰落信道和頻率選擇性信道的特點,設計了基于FPGA的移動無線信道仿真器,同時給予了軟硬件驗證。 本文從衰落的數學模型角度研究了信道傳輸特性,以及各項參數對信道特性的影響。主要做了以下幾個方面的工作: 1.簡要介紹了無線電通信的發展史及信道建模與仿真的意義;論述了信道對無線信號主要的三類影響:自由空間的路徑損失、陰影衰落、多徑衰落;分析了無線通信傳播環境,移動無線通信信道仿真的基本模型,同時介紹了用正弦波疊加法和成型濾波器法建立信道確定型仿真模型的具體實現方法。 2.對移動無線信道特性進行了Matlab仿真,對仿真結果進行了對比分析,對影響信道特性的主要參數設置進行了分析仿真。 3.設計了一種基于FPGA的移動無線信道仿真器,并對實現該仿真器的關鍵技術和實現方法進行了分析。該信道仿真器能夠實時模擬窄帶信號條件下無線信道的主要特點,如多徑時延、多普勒頻移、瑞利衰落等,其主要的技術指標達到了設計要求。該模擬器結構簡單,參數可調,易于擴展,通用性強,可以部分或全部集成到處于研制階段的接收機中,以便于性能測試,也可應用于教學實踐。

    標簽: FPGA 移動 無線信道

    上傳時間: 2013-04-24

    上傳用戶:suxuan110425

  • 地面數字電視廣播系統中SRRC濾波器及FFT處理器的設計與FPGA實現.rar

    隨著人們對數字電視和數字視頻信息的需求越來越大,數字電視廣播在中國迅速的發展起來。近幾年,數字電視傳輸系統技術逐漸成熟,數字電視地面廣播(DTTB)傳輸標準也于2006年8月30號正式出臺。此標準技術是由我國多家單位聯合研究的,具有自主知識產權的數字地面電視傳輸標準。DTTB系統標準的研究與仿真,具有巨大的實用價值和廣闊的市場前景。 @@ 本文首先研究了地面數字電視廣播標準中平方根升余弦(SRRC)濾波器(滾降系數為0.05)的結構設計,介紹了一種適合在FPGA中實現的高階高速FIR濾波器的并行流水線結構。在本設計中,以CSD數優化濾波器系數,并運用簡化加法器圖(Reduced Adder Graph,RAG)算法進行改進,最后采用并行處理的轉置型流水線結構實現。 @@ 接著研究數字電視地面傳輸標準采用的傳輸技術-OFDM的基本概念和技術特點,并研究了清華大學提出的DMB-T方案中TDS-OFDM信號幀的組成結構以及相關原理。 @@ 最后,本文針對OFDM調制所需要的3780點FFT處理器進行研究。為了保證OFDM信號的采樣率和時域導頻的采樣率相同,以達到較好的同步性能,采用了3780個正交子載波的設計方案。在實現過程中,分析比較了多種算法的計算復雜性,設計出在硬件實現復雜度上進行優化的3780點FFT處理器的數據流流水線算法。之后,通過定點仿真比較各模塊輸出的動態范圍和概率分布,設計出定點字長的優化方案,并分析計算了這一處理器的輸出信噪比與內部各模塊字長的關系,進一步降低了硬件實現復雜性。 @@關鍵字:數字電視地面廣播傳輸(DTTB);平方根升余弦濾波器(SRRC);正交頻分復用調制(OFDM);快速傅立葉變換(FFT); 3780

    標簽: SRRC FPGA FFT

    上傳時間: 2013-04-24

    上傳用戶:mdrd3080

  • 數字電視傳輸系統中LDPC碼編碼器的研究與FPGA實現.rar

    自香農先生于1948年開創信息論以來,經過將近60年的發展,信道編碼技術已經成為通信領域的一個重要分支,各種編碼技術層出不窮。目前廣泛研究的低密度奇偶校驗(LDCP)碼是由R.G.Gallager先生提出的一種具有逼近香農限性能的優秀糾錯碼,并已在數字電視、無線通信、磁盤存儲等領域得到大量應用。 目前數字電視已經成為最熱門的話題之一,用手機看北京奧運,已經成為每一個中國人的夢想。最近兩年我國頒布了兩部與數字電視有關的通信標準,分別是數字電視地面傳輸標準(DMB-TH)和移動多媒體(CMMB)即俗稱的手機電視標準。數字電視正與每個人走得越來越近,我國預期在2015年全面實現數字電視并停止模擬電視的播出。作為數字電視標準的核心技術之一的前向糾錯碼技術已經成為眾多科研單位的研究熱點,相應的編解碼芯片更成為重中之重。在DMB-TH標準中用到了LDPC碼和BCH碼的級聯編碼方式,在CMMB標準中用到了LDPC碼和RS碼的級聯編碼方式,在DVB-S2標準中用到了LDPC碼和BCH碼的級聯編碼方式。 本論文以目前最重要的三個與數字電視相關的標準:數字電視地面傳輸標準(DMB-TH)、手機電視標準(CMMB)以及數字衛星電視廣播標準(DVB-S2)為切入點,深入研究它們的編碼方式,設計了這三個標準中的LDPC碼編碼器,并在FPGA上實現了前兩個標準的編碼芯片,實現了DMB-TH標準中0.4、0.6以及0.8三種碼率的復用。在研究CMMB標準中編碼器設計時,提出一種改進的LU分解算法,該分解方式適合任意的H矩陣,具有一定的廣泛性。測試結果表明,芯片邏輯功能完全正確,速度和資源消耗均達到了標準的要求,具有一定的商用價值。

    標簽: LDPC FPGA 數字電視

    上傳時間: 2013-07-07

    上傳用戶:327000306

  • WCDMA數字直放站中數字預失真研究及其FPGA實現.rar

    現代社會對各種無線通信業務的需求迅猛增長,這就要求無線通信在具有較高傳輸質量的同時,還必須具有較大的傳輸容量。這種需求要求在無線通信中必須采用效率較高的線性調制方式,以提高有限頻帶帶寬的數據速率和頻譜利用率,而效率較高的調制方式通常會對發端發射機的線性要求較高,這就使功率放大器線性化技術成為下一代無線通信系統的關鍵技術之一。 在本文中,研究了前人所提出的各種功放線性化技術,如功率回退法、正負反饋法、預失真和非線性器件法等等,針對功率放大器對信號的失真放大問題進行研究,對比和研究了目前廣泛流行的自適應數字預失真算法。在一般的自適應數字預失真算法中,主要有兩類:無記憶非線性預失真和有記憶非線性預失真。無記憶非線性預失真主要是通過比較功率放大器的反饋信號和已知輸入信號的幅度和相位的誤差來估計預失真器的各種修正參數。而有記憶非線性預失真主要是綜合考慮功率放大器非線性和記憶性對信號的污染,需要同時分析信號的當前狀態和歷史狀態。在對比完兩種數字預失真算法之后,文章著重分析了有記憶預失真算法,選擇了其中的多項式預失真算法進行了具體分析推演,并通過軟件無線電的方法將數字信號處理與FPGA結合起來,在內嵌了System Generator軟件的Matlab/Simulink上對該算法進行仿真分析,證明了這個算法的性能和有效性。 本文另外一個最重要的創新點在于,在FPGA設計上,使用了系統級設計的思路,與Xilinx公司提供的軟件能夠很好的配合,在完成仿真后能夠直接將代碼轉換成FPGA的網表文件或者硬件描述語言,大大簡化了開發過程,縮短了系統的開發周期。

    標簽: WCDMA FPGA 數字

    上傳時間: 2013-06-20

    上傳用戶:handless

  • 基于FPGA的圖像處理算法研究及硬件設計.rar

    隨著圖像分辨率的越來越高,軟件實現的圖像處理無法滿足實時性的需求;同時FPGA等可編程器件的快速發展使得硬件實現圖像處理變得可行。如今基于FPGA的圖像處理研究成為了國內外的一個熱門領域。 本文在FPGA平臺上,用Verilog HDL實現了一個研究圖像處理算法的可重復配置的硬件模塊架構,架構包括PC機預處理和通信軟件,控制模塊,計算單元,存儲器模塊和通信適配模塊五個部分。其中的計算模塊負責具體算法的實現,根據不同的圖像處理算法可以獨立實現。架構為計算模塊實現了一個可添加、移出接口,不同的算法設計只要符合該接口就可以方便的加入到模塊架構中來進行調試和運行。 在硬件架構的基礎上本文實現了排序濾波,中值濾波,卷積運算及高斯濾波,形態學算子運算等經典的圖像處理算法。討論了FPGA的圖像處理算法的設計方法及優化策略,通過性能分析,FPGA實現圖像處理在時間上比軟件處理有了很大的提高;通過結果的比較,發現FPGA的處理結果達到了軟件處理幾乎同等的效果水平。最后本文在實現較大圖片處理和圖像處理窗口的大小可配置性方面做了一定程度的討論和改進,提高了算法的可用性,同時為進一步的研究提供了更加便利的平臺。 整個設計都是在ISE8.2和ModelSim第三方仿真軟件環境下開發的,在xilinx的Spartan-3E XC3S500E硬件平臺上實現。在軟件仿真過程中利用了ISE8.2自帶仿真工具和ModelSim結合使用。 本課題為制造FPGA的專用圖像處理芯片做了有益的探索性研究,為實現FPGA為核心處理芯片的實時圖像處理系統有著積極的作用。

    標簽: FPGA 圖像處理 算法研究

    上傳時間: 2013-07-29

    上傳用戶:愛順不順

  • MP3音頻編解碼運算中IMDCT算法研究及其FPGA實現.rar

    近年來,隨著多媒體技術的迅猛發展,電子、計算機、通訊和娛樂之間的相互融合、滲透越來越多,而數字音頻技術則是應用最為廣泛的技術之一。MP3(MPEG-1 Audio LayerⅢ)編解碼算法作為數字音頻的解決方案,在便攜式多媒體產品中得到了廣泛流行。 在已有的便攜式MP3系統實現方案中,低速處理器與專用硬件結合的SOC設計方案結合了硬件實現方式和軟件實現方式的優點,具有成本低、升級容易、功能豐富等特點。IMDCT(反向改進離散余弦變換)是編解碼算法中一個運算量大調用頻率高的運算步驟,因此適于硬件實現,以降低處理器的開銷和功耗,來提高整個系統的性能。 本文首先闡述了MP3音頻編解碼標準和流程,以及IMDCT常用的各種實現算法。在此基礎上選擇了適于硬件實現的遞歸循環實現方法,并在已有算法的基礎上進行了改進,減小了所需硬件資源需求并保持了運算速度。接著提出了模塊總體設計方案,結合算法進行了實現結構的優化,并在EDA環境下具體實現,用硬件描述語言設計、綜合、仿真,且下載到Xilinx公司的VirtexⅡ系列xc2v1000FPGA器件中,在減小硬件資源的同時快速地實現了IMDCT,經驗證功能正確。

    標簽: IMDCT FPGA MP3

    上傳時間: 2013-05-31

    上傳用戶:Minly

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