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中星微

  • 基于FPGA語音識別系統(tǒng)設(shè)計與實現(xiàn).rar

    近年來,語音識別研究大部分集中在算法設(shè)計和改進等方面,而隨著半導(dǎo)體技術(shù)的高速發(fā)展,集成電路規(guī)模的不斷增大與各種研發(fā)技術(shù)水平的不斷提高,新的硬件平臺的推出,語音識別實現(xiàn)平臺有了更多的選擇。語音識別技術(shù)在與DSP、FPGA、ASIC等器件為平臺的嵌入式系統(tǒng)結(jié)合后,逐漸向?qū)嵱没?、小型化方向發(fā)展。 本課題通過對現(xiàn)有各種語音特征參數(shù)與孤立詞語音識別模型進行研究的基礎(chǔ)上,重點探索基于動態(tài)時間規(guī)整算法的DTW模型在孤立詞語音識別領(lǐng)域的應(yīng)用,并結(jié)合基于FPGA的SOPC系統(tǒng),在嵌入式平臺上實現(xiàn)具有較好精度與速度的孤立詞語音識別系統(tǒng)。 本系統(tǒng)整體設(shè)計基于DE2開發(fā)平臺,采用基于Nios II的SOPC技術(shù)。采用這種解決方案的優(yōu)點是實現(xiàn)了片上系統(tǒng),減少了系統(tǒng)的物理體積和總體功耗;同時系統(tǒng)控制核心都在FPGA內(nèi)部實現(xiàn),可以極為方便地更新和升級系統(tǒng),大大地提高了系統(tǒng)的通用性和可維護性。 此外,由于本系統(tǒng)需要大量的高速數(shù)據(jù)運算,在設(shè)計中作者充分利用了Cyclone II芯片的豐富的硬件乘法器,實現(xiàn)了語音信號的端點檢測模塊,F(xiàn)FT快速傅立葉變換模塊,DCT離散余弦變換模塊等硬件設(shè)計模塊。為了提高系統(tǒng)的整體性能,作者充分利用了FPGA的高速并行的優(yōu)勢,以及配套開發(fā)環(huán)境中的Avalon總線自定義硬件外設(shè),使系統(tǒng)處理數(shù)字信號的能力大大提高,其性能優(yōu)于傳統(tǒng)的微控制器和普通DSP芯片。 本論文主要包含了以下幾個方面: (1)結(jié)合ALTERA CYCLONE II芯片的特點,確定了基于FPGA語音識別系統(tǒng)的總體設(shè)計,在此基礎(chǔ)上進行了系統(tǒng)的軟硬件的選擇和設(shè)計。 (2)自主設(shè)計了純硬件描述語言的驅(qū)動電路設(shè)計,完成了高速語音采集的工作,并且對存儲數(shù)據(jù)芯片SRAM中的原始語音數(shù)據(jù)進行提取導(dǎo)入MATLAB平臺測試數(shù)據(jù)的正確性。整個程序測試的方式對系統(tǒng)的模塊測試起到重要的作用。 (3)完成高速定點256點的FFT模塊的設(shè)計,此模塊是系統(tǒng)成敗的關(guān)鍵,實現(xiàn)高速實時的運算。 (4)結(jié)合SOPC的特性,設(shè)計了人機友好接口,如LCD顯示屏的提示反饋信息等等,以及利用ALTERA提供的一些驅(qū)動接口設(shè)計完成用戶定制的系統(tǒng)。 (5)進行了整體系統(tǒng)測試,系統(tǒng)可以較穩(wěn)定地實現(xiàn)實時處理的目的,具有一定的市場潛在價值。

    標簽: FPGA 語音識別 系統(tǒng)設(shè)計

    上傳時間: 2013-05-23

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  • 地面數(shù)字電視廣播系統(tǒng)中SRRC濾波器及FFT處理器的設(shè)計與FPGA實現(xiàn).rar

    隨著人們對數(shù)字電視和數(shù)字視頻信息的需求越來越大,數(shù)字電視廣播在中國迅速的發(fā)展起來。近幾年,數(shù)字電視傳輸系統(tǒng)技術(shù)逐漸成熟,數(shù)字電視地面廣播(DTTB)傳輸標準也于2006年8月30號正式出臺。此標準技術(shù)是由我國多家單位聯(lián)合研究的,具有自主知識產(chǎn)權(quán)的數(shù)字地面電視傳輸標準。DTTB系統(tǒng)標準的研究與仿真,具有巨大的實用價值和廣闊的市場前景。 @@ 本文首先研究了地面數(shù)字電視廣播標準中平方根升余弦(SRRC)濾波器(滾降系數(shù)為0.05)的結(jié)構(gòu)設(shè)計,介紹了一種適合在FPGA中實現(xiàn)的高階高速FIR濾波器的并行流水線結(jié)構(gòu)。在本設(shè)計中,以CSD數(shù)優(yōu)化濾波器系數(shù),并運用簡化加法器圖(Reduced Adder Graph,RAG)算法進行改進,最后采用并行處理的轉(zhuǎn)置型流水線結(jié)構(gòu)實現(xiàn)。 @@ 接著研究數(shù)字電視地面?zhèn)鬏敇藴什捎玫膫鬏敿夹g(shù)-OFDM的基本概念和技術(shù)特點,并研究了清華大學(xué)提出的DMB-T方案中TDS-OFDM信號幀的組成結(jié)構(gòu)以及相關(guān)原理。 @@ 最后,本文針對OFDM調(diào)制所需要的3780點FFT處理器進行研究。為了保證OFDM信號的采樣率和時域?qū)ьl的采樣率相同,以達到較好的同步性能,采用了3780個正交子載波的設(shè)計方案。在實現(xiàn)過程中,分析比較了多種算法的計算復(fù)雜性,設(shè)計出在硬件實現(xiàn)復(fù)雜度上進行優(yōu)化的3780點FFT處理器的數(shù)據(jù)流流水線算法。之后,通過定點仿真比較各模塊輸出的動態(tài)范圍和概率分布,設(shè)計出定點字長的優(yōu)化方案,并分析計算了這一處理器的輸出信噪比與內(nèi)部各模塊字長的關(guān)系,進一步降低了硬件實現(xiàn)復(fù)雜性。 @@關(guān)鍵字:數(shù)字電視地面廣播傳輸(DTTB);平方根升余弦濾波器(SRRC);正交頻分復(fù)用調(diào)制(OFDM);快速傅立葉變換(FFT); 3780

    標簽: SRRC FPGA FFT

    上傳時間: 2013-04-24

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  • Actel SmartFusion智能混合信號FPGA背景介紹

    Actel SmartFusion智能混合信號FPGA在單個器件中整合了已經(jīng)獲驗證且高度靈活的ProASIC?3 FPGA架構(gòu)、先進的混合信號功能以及一個ARM? Cortex?-M3硬核處理器。SmartFusion能夠為嵌入式系統(tǒng)設(shè)計人員提供了多達50萬門用戶邏輯、13.8 Kb的通用FPGA RAM、眾多系統(tǒng)外設(shè)和可編程模擬電路,以及一個包含了100 MHz Cortex-M3處理器(64 Kb SRAM 和 512 Kb閃存)的微控制器子系統(tǒng)(MSS)。

    標簽: SmartFusion Actel FPGA 智能混合

    上傳時間: 2013-04-24

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  • 數(shù)字電視傳輸系統(tǒng)中LDPC碼編碼器的研究與FPGA實現(xiàn).rar

    自香農(nóng)先生于1948年開創(chuàng)信息論以來,經(jīng)過將近60年的發(fā)展,信道編碼技術(shù)已經(jīng)成為通信領(lǐng)域的一個重要分支,各種編碼技術(shù)層出不窮。目前廣泛研究的低密度奇偶校驗(LDCP)碼是由R.G.Gallager先生提出的一種具有逼近香農(nóng)限性能的優(yōu)秀糾錯碼,并已在數(shù)字電視、無線通信、磁盤存儲等領(lǐng)域得到大量應(yīng)用。 目前數(shù)字電視已經(jīng)成為最熱門的話題之一,用手機看北京奧運,已經(jīng)成為每一個中國人的夢想。最近兩年我國頒布了兩部與數(shù)字電視有關(guān)的通信標準,分別是數(shù)字電視地面?zhèn)鬏敇藴?DMB-TH)和移動多媒體(CMMB)即俗稱的手機電視標準。數(shù)字電視正與每個人走得越來越近,我國預(yù)期在2015年全面實現(xiàn)數(shù)字電視并停止模擬電視的播出。作為數(shù)字電視標準的核心技術(shù)之一的前向糾錯碼技術(shù)已經(jīng)成為眾多科研單位的研究熱點,相應(yīng)的編解碼芯片更成為重中之重。在DMB-TH標準中用到了LDPC碼和BCH碼的級聯(lián)編碼方式,在CMMB標準中用到了LDPC碼和RS碼的級聯(lián)編碼方式,在DVB-S2標準中用到了LDPC碼和BCH碼的級聯(lián)編碼方式。 本論文以目前最重要的三個與數(shù)字電視相關(guān)的標準:數(shù)字電視地面?zhèn)鬏敇藴?DMB-TH)、手機電視標準(CMMB)以及數(shù)字衛(wèi)星電視廣播標準(DVB-S2)為切入點,深入研究它們的編碼方式,設(shè)計了這三個標準中的LDPC碼編碼器,并在FPGA上實現(xiàn)了前兩個標準的編碼芯片,實現(xiàn)了DMB-TH標準中0.4、0.6以及0.8三種碼率的復(fù)用。在研究CMMB標準中編碼器設(shè)計時,提出一種改進的LU分解算法,該分解方式適合任意的H矩陣,具有一定的廣泛性。測試結(jié)果表明,芯片邏輯功能完全正確,速度和資源消耗均達到了標準的要求,具有一定的商用價值。

    標簽: LDPC FPGA 數(shù)字電視

    上傳時間: 2013-07-07

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  • WCDMA數(shù)字直放站中數(shù)字預(yù)失真研究及其FPGA實現(xiàn).rar

    現(xiàn)代社會對各種無線通信業(yè)務(wù)的需求迅猛增長,這就要求無線通信在具有較高傳輸質(zhì)量的同時,還必須具有較大的傳輸容量。這種需求要求在無線通信中必須采用效率較高的線性調(diào)制方式,以提高有限頻帶帶寬的數(shù)據(jù)速率和頻譜利用率,而效率較高的調(diào)制方式通常會對發(fā)端發(fā)射機的線性要求較高,這就使功率放大器線性化技術(shù)成為下一代無線通信系統(tǒng)的關(guān)鍵技術(shù)之一。 在本文中,研究了前人所提出的各種功放線性化技術(shù),如功率回退法、正負反饋法、預(yù)失真和非線性器件法等等,針對功率放大器對信號的失真放大問題進行研究,對比和研究了目前廣泛流行的自適應(yīng)數(shù)字預(yù)失真算法。在一般的自適應(yīng)數(shù)字預(yù)失真算法中,主要有兩類:無記憶非線性預(yù)失真和有記憶非線性預(yù)失真。無記憶非線性預(yù)失真主要是通過比較功率放大器的反饋信號和已知輸入信號的幅度和相位的誤差來估計預(yù)失真器的各種修正參數(shù)。而有記憶非線性預(yù)失真主要是綜合考慮功率放大器非線性和記憶性對信號的污染,需要同時分析信號的當前狀態(tài)和歷史狀態(tài)。在對比完兩種數(shù)字預(yù)失真算法之后,文章著重分析了有記憶預(yù)失真算法,選擇了其中的多項式預(yù)失真算法進行了具體分析推演,并通過軟件無線電的方法將數(shù)字信號處理與FPGA結(jié)合起來,在內(nèi)嵌了System Generator軟件的Matlab/Simulink上對該算法進行仿真分析,證明了這個算法的性能和有效性。 本文另外一個最重要的創(chuàng)新點在于,在FPGA設(shè)計上,使用了系統(tǒng)級設(shè)計的思路,與Xilinx公司提供的軟件能夠很好的配合,在完成仿真后能夠直接將代碼轉(zhuǎn)換成FPGA的網(wǎng)表文件或者硬件描述語言,大大簡化了開發(fā)過程,縮短了系統(tǒng)的開發(fā)周期。

    標簽: WCDMA FPGA 數(shù)字

    上傳時間: 2013-06-20

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  • TDSCDMA頻點拉遠系統(tǒng)的FPGA設(shè)計與實現(xiàn).rar

    隨著TD—SCDMA技術(shù)的不斷發(fā)展,TD—SCDMA系統(tǒng)產(chǎn)品也逐步成熟并隨之完善。產(chǎn)品家族日益豐富,室內(nèi)型宏基站、室外型宏基站、分布式基站(BBU+RRU)、微基站等系列化基站產(chǎn)品逐步問世,可以滿足不同場景的建網(wǎng)需求。而分布式基站(BBU+RRU)越來越多地受到業(yè)界的關(guān)注和重視。 本文主要從TD—SCDMA頻點拉遠系統(tǒng)(RRU)和軟件無線電技術(shù)的發(fā)展入手,重點研究TD—SCDMA頻點拉遠系統(tǒng)的FPGA設(shè)計與實現(xiàn)。TD—SCDMA通信系統(tǒng)通過靈活分配不同的上下行時隙,實現(xiàn)業(yè)務(wù)的不對稱性,但是多路數(shù)字中頻所構(gòu)成的系統(tǒng)成本高和控制的復(fù)雜性,以及TDD雙工模式下,系統(tǒng)的峰均比隨時隙數(shù)增加而增加,對整個頻點拉遠系統(tǒng)的前端放大器線性輸入提出了很高的要求。TD—SCDMA系統(tǒng)使用軟件無線電平臺,一方面軟件算法可以有效保證時隙分配的準確性,保證對前端控制器的開關(guān)控制,以及對上下行功率讀取計算和子幀的靈活提取,另一方面靈活的DUC/CFR算法可以有效的提高頻帶利用率和抗干擾能力,有效的控制TDD系統(tǒng)的峰均比,有效降低系統(tǒng)對前端放大器線性輸出能力的要求。 本文主要研究軟件無線電中DUC和CFR的關(guān)鍵技術(shù)以及FPGA實現(xiàn),DUC主要由3倍FIR內(nèi)插成型濾波器、2倍插值補償濾波器以及5級CIC濾波器級聯(lián)組成;而CFR主要采用類似基帶削峰的加窗濾波的中頻削峰算法,可以降低相鄰信道的溢出,更有效的降低CF值。將DUC/CFR以單片F(xiàn)PGA實現(xiàn),能很好提高RRU性能,減少其硬件結(jié)構(gòu),降低成本,降低功耗,增加外部環(huán)境的穩(wěn)定性。

    標簽: TDSCDMA FPGA 頻點

    上傳時間: 2013-07-20

    上傳用戶:rishian

  • 基于FPGA的PWM發(fā)生器的研究與設(shè)計.rar

    PWM(脈沖寬度調(diào)制)是一種利用數(shù)字信號來控制模擬電路的控制技術(shù),廣泛應(yīng)用于電源、電機、伺服系統(tǒng)、通信系統(tǒng)、電子控制器、功率控制等電力電子設(shè)備。PWM技術(shù)在逆變電路中的應(yīng)用最為廣泛,也是變頻技術(shù)的核心,同時在機床,液壓位置控制系統(tǒng)等機械裝置中也發(fā)揮著重要的作用。PWM技術(shù)已經(jīng)成為控制領(lǐng)域的一個熱點,因此研究PWM發(fā)生器對于基礎(chǔ)理論的發(fā)展和技術(shù)的改進都有十分重要的意義。 論文研究的主要內(nèi)容是用任意波形作為調(diào)制信號通過特定的方法來產(chǎn)生所需要的PWM波形,任意波形的合成和PWM波形的生成是兩個主要任務(wù)。任意波形的合成是課題設(shè)計的一個難點,也是影響系統(tǒng)性能的關(guān)鍵因素之一。論文中波形合成采用直接數(shù)字頻率合成(DDS)技術(shù)來實現(xiàn)。DDS技術(shù)以相位為地址,通過查找離散幅度數(shù)據(jù)進行波形合成,具有輸出波形相位變化連續(xù)、分辨率高、頻率轉(zhuǎn)換速率快的優(yōu)點,而且通過設(shè)置控制字可靈活方便地改變輸出頻率,是目前波形合成的主流方法。 實現(xiàn)PWM發(fā)生器的設(shè)計方法有多種。在綜合比較了單片機、DSP、ARM等常用開發(fā)工具特點的基礎(chǔ)上,本文提出了一種以可編程邏輯器件(PLD)為主體,單片機輔助配合的設(shè)計方法。隨著計算機技術(shù)和微電了技術(shù)的迅速發(fā)展,可編程邏輯器件的集成度和容量越來越大,基于PLD的設(shè)計方法正逐步成為一種主流于段,是近些年來電子系統(tǒng)設(shè)計的一個熱點。整個系統(tǒng)分為模擬波形產(chǎn)生、單片機控制電路、FPGA內(nèi)部功能模塊三大部分。FPGA部分的設(shè)計是以Altera公司的Quartus Ⅱ軟件為開發(fā)平臺,采用VHDL語言為主要輸入手段來完成內(nèi)部各功能模塊的設(shè)計輸入、編譯、仿真等調(diào)試工作,目標載體選用性價比比較高的Altera公司的CycloneⅡ系列的器件;單片機控制電路主要負責(zé)控制字的設(shè)置和顯示,波形數(shù)據(jù)的接受與發(fā)送;用MATLAB軟件完成仟意波形的繪制和模擬任務(wù)。 論文共分五章,詳細介紹了課題的背景、PWM發(fā)生器的發(fā)展和應(yīng)用以及選題的目的和意義等,論述了系統(tǒng)設(shè)計方案的可行性,對外圍電路和FPAG內(nèi)部功能模塊的設(shè)計方法進行了具體說明,并對仿真結(jié)果、系統(tǒng)的性能、存在的問題和改進方法等進行了分析和闡述。整個設(shè)計滿足PWM發(fā)生器的任務(wù)和功能要求,設(shè)計方法可行。

    標簽: FPGA PWM 發(fā)生器

    上傳時間: 2013-04-24

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  • 嵌入式TCPIP協(xié)議的FPGA實現(xiàn).rar

    隨著Internet的不斷發(fā)展,人們希望日常生活中所用到的嵌入式設(shè)備都能夠很方便地實現(xiàn)Intemet接入,這對嵌入式系統(tǒng)設(shè)計提出了新的挑戰(zhàn),要求低成本、多功能、高性能。這些是目前嵌入式系統(tǒng)設(shè)計的熱點。 可編程邏輯器件FPGA在過去的幾十年中取得了飛速發(fā)展,從最初的幾千門到現(xiàn)在的幾百萬門,可靠性與集成度不斷提高,而功耗和成本卻在不斷降低,具有很高的性價比。再加上開發(fā)周期短、對開發(fā)人員的要求相對較低的優(yōu)點,因此被大量應(yīng)用于嵌入式系統(tǒng)設(shè)計中。 本文是基于FPGA高性價比、可靈活配置的特點,也是當前流行的“微控制器+FPGA”的嵌入式系統(tǒng)設(shè)計方式,所以我們提出了基于FPGA的實現(xiàn)方案。本文通過在FPGA中硬件實現(xiàn)嵌入式TCP/IP協(xié)議(包括UDP、IP、ARP、TCP等網(wǎng)絡(luò)協(xié)議)以及以太網(wǎng)MAC協(xié)議,并提供標準MII接口,通過外接PHY實現(xiàn)網(wǎng)絡(luò)連接。最終成功地通過了驗證。 基于FPGA的實現(xiàn)可以有效地降低成本,同時可以在其中集成其他功能模塊,提高整個系統(tǒng)的集成度,減小PCB版圖面積和布線復(fù)雜度,有利于提高系統(tǒng)可靠性。因此,本研究課題對嵌入式系統(tǒng)設(shè)計有很大的實用價值。

    標簽: TCPIP FPGA 嵌入式

    上傳時間: 2013-04-24

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  • 基于FPGA的GPS信號捕獲與跟蹤系統(tǒng)設(shè)計研究.rar

    互聯(lián)網(wǎng)、移動通信、星基導(dǎo)航是21世紀信息社會的三大支柱產(chǎn)業(yè),而GPS系統(tǒng)的技術(shù)水平和發(fā)展歷程代表著全世界衛(wèi)星導(dǎo)航系統(tǒng)的發(fā)展狀況。目前,我國已經(jīng)成為GPS的使用大國,衛(wèi)星導(dǎo)航產(chǎn)業(yè)鏈也已基本形成。然而,我們對GPS核心技術(shù)的研究還不夠深入,我國GPS產(chǎn)品的核心部分多數(shù)還是靠進口。 GPS接收機工作時,為了將本地信號和接收到的信號同步,要完成復(fù)雜的信號處理過程。其中,如何捕獲衛(wèi)星信號并保持對信號的跟蹤是最重要的核心技術(shù)。很多研究者提出了多種解決方法,但這些方法多數(shù)都只停留在理論階段,無法應(yīng)用于GPS接收機系統(tǒng)進行實時處理。 本課題在分析了多種現(xiàn)有算法的基礎(chǔ)上,研究設(shè)計了基于FPGA的GPS信號捕獲與跟蹤系統(tǒng)。在研究過程中,首先利用Nemerix公司的GPS芯片組設(shè)計制作了GPS接收機模塊,它能正常穩(wěn)定地工作,并可用作GPS基帶信號處理的研究平臺;該平臺可實時地輸出GPS數(shù)字中頻信號;本課題在中頻信號的基礎(chǔ)上深入研究了GPS信號的捕獲與跟蹤技術(shù)。先詳細分析比較了幾種GPS信號捕獲方法,給出了步進相關(guān)的捕獲方案;接著分析了跟蹤環(huán)路的特點,給出了鎖頻環(huán)和鎖相環(huán)交替工作跟蹤載波以及載波輔助偽碼的跟蹤方案,并最終實現(xiàn)了這些方案。 本課題設(shè)計的GPS信號捕獲與跟蹤處理系統(tǒng)是通過硬件和軟件協(xié)同工作的方式實現(xiàn)的。硬件電路主要實現(xiàn)數(shù)據(jù)速率高、邏輯簡單的相關(guān)器功能;而基于MicroBlaze軟處理器的軟件主要實現(xiàn)數(shù)據(jù)速率低、邏輯復(fù)雜的功能。本文給出了硬件電路的詳細設(shè)計、仿真結(jié)果以及軟件設(shè)計的詳細流程。 本課題最終在FPGA上實現(xiàn)了GPS信號的捕獲與跟蹤功能,而且系統(tǒng)的性能良好。由此可以得出結(jié)論:本設(shè)計能夠滿足系統(tǒng)功能和性能的要求,可以直接用于實時GPS接收機系統(tǒng)的設(shè)計中,為自主設(shè)計GPS接收機奠定了基礎(chǔ)。 本課題的研究得到了大連市信息產(chǎn)業(yè)局集成電路設(shè)計專項的資助,項目名稱是“定位與通信集成功能的SOC設(shè)計”,研究成果將在2008年上半年投入試用。

    標簽: FPGA GPS 信號捕獲

    上傳時間: 2013-04-24

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  • 軟件無線電中數(shù)字下變頻技術(shù)研究及FPGA實現(xiàn).rar

    軟件無線電(SDR,Software Defined Radio)由于具備傳統(tǒng)無線電技術(shù)無可比擬的優(yōu)越性,已成為業(yè)界公認的現(xiàn)代無線電通信技術(shù)的發(fā)展方向。理想的軟件無線電系統(tǒng)強調(diào)體系結(jié)構(gòu)的開放性和可編程性,減少靈活性著的硬件電路,把數(shù)字化處理(ADC和DAC)盡可能靠近天線,通過軟件的更新改變硬件的配置、結(jié)構(gòu)和功能。目前,直接對射頻(RF)進行采樣的技術(shù)尚未實現(xiàn)普及的產(chǎn)品化,而用數(shù)字變頻器在中頻進行數(shù)字化是普遍采用的方法,其主要思想是,數(shù)字混頻器用離散化的單頻本振信號與輸入采樣信號在乘法器中相乘,再經(jīng)插值或抽取濾波,其結(jié)果是,輸入信號頻譜搬移到所需頻帶,數(shù)據(jù)速率也相應(yīng)改變,以供后續(xù)模塊做進一步處理。數(shù)字變頻器在發(fā)射設(shè)備和接收設(shè)備中分別稱為數(shù)字上變頻器(DUC,Digital Upper Converter)和數(shù)字下變頻器(DDC,Digital Down Converter),它們是軟件無線電通信設(shè)備的關(guān)鍵部什。大規(guī)??删幊踢壿嬈骷膽?yīng)用為現(xiàn)代通信系統(tǒng)的設(shè)計帶來極大的靈活性。基于FPGA的數(shù)字變頻器設(shè)計是深受廣大設(shè)計人員歡迎的設(shè)計手段。本文的重點研究是數(shù)字下變頻器(DDC),然而將它與數(shù)字上變頻器(DUC)完全割裂后進行研究顯然是不妥的,因此,本文對數(shù)字上變頻器也作適當介紹。 第一章簡要闡述了軟件無線電及數(shù)字下變頻的基本概念,介紹了研究背景及所完成的主要研究工作。 第二章介紹了數(shù)控振蕩器(NCO),介紹了兩種實現(xiàn)方法,即基于查找表和基于CORDIC算法的實現(xiàn)。對CORDIc算法作了重點介紹,給出了傳統(tǒng)算法和改進算法,并對基于傳統(tǒng)CORDIC算法的NCO的FPGA實現(xiàn)進行了EDA仿真。 第三章介紹了變速率采樣技術(shù),重點介紹了軟件無線電中廣泛采用的級聯(lián)積分梳狀濾波器 (cascaded integratot comb, CIC)和ISOP(Interpolated Second Order Polynomial)補償法,對前者進行了基于Matlab的理論仿真和FPGA實現(xiàn)的EDA仿真,后者只進行了基于Matlab的理論仿真。 第四章介紹了分布式算法和軟件無線電中廣泛采用的半帶(half-band,HB)濾波器,對基于分布式算法的半帶濾波器的FPGA實現(xiàn)進行了EDA仿真,最后簡要介紹了FIR的多相結(jié)構(gòu)。 第五章對數(shù)字下變頻器系統(tǒng)進行了噪聲綜合分析,給出了一個噪聲模型。 第六章介紹了數(shù)字下變頻器在短波電臺中頻數(shù)字化應(yīng)用中的一個實例,給出了測試結(jié)果,重點介紹了下變頻器的:FPGA實現(xiàn),其對應(yīng)的VHDL程序收錄在本文最后的附錄中,希望對從事該領(lǐng)域設(shè)計的技術(shù)人員具有一定參考價值。

    標簽: FPGA 軟件無線電 數(shù)字下變頻

    上傳時間: 2013-06-30

    上傳用戶:huannan88

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