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中的實現(xiàn)

  • 模糊PID控制算法在賽車中的應用

    本文介紹了在非死卡爾智能賽車競賽中的一份技術報告:模糊PID控制算法在賽車中的應用

    標簽: PID 模糊 控制算法 中的應用

    上傳時間: 2013-07-13

    上傳用戶:feilinhan

  • 嵌入式系統中的模擬設計(英文版)

    嵌入式系統中的模擬設計(英文版) 嵌入式系統中的模擬設計(英文版)

    標簽: 嵌入式系統 模擬設計 英文

    上傳時間: 2013-07-06

    上傳用戶:zhyiroy

  • ARM處理器和FPGA在數據傳輸中的應用與研究

    隨著對高處理能力、網絡通信、實時多任務,超低功耗這些需求的增長,傳統8位處理器已經不能滿足新產品的要求了,高端嵌入式處理器已經得到了普遍的重視和應用.ARM是目前嵌入式領域應用最廣泛的RISC微處理器結構,該文研究了基于ARM處理器的嵌入式系統的開發,介紹了利用一款ARM微處理器和FPGA設計的四路E1中繼板卡的硬件結構和工作原理,并在這個硬件平臺上進行軟件開發的過程.該四路E1收發器能夠提供四條E1鏈路,把帶寬從2Mbps提高到8Mbps,能夠同時負載120個用戶的通信,解決了數字環路系統中卡槽數目限制的問題.目前,建立在G. 703基礎上的El接口在分組網、幀中繼網、GSM移動基站及軍事通信中得到廣泛的應用,傳送語音信號、數據、圖像等業務.文中首先分析了當前數字環路系統的發展現狀和趨勢,隨著網絡通信的用戶數目及信息量的猛增,拓寬數據傳輸的通道是一項研究熱點,這是開發四路E1收發器的一個目的.接著敘述了數字環路系統的結構和工作原理,即四路E1收發器的應用環境,著重介紹了四路E1板卡在整個系統中所扮演的角色和嵌入式處理器ARM的體系結構和特點,鑒于數據傳輸中對時鐘的要求比較嚴格,該文還介紹了FPGA技術,應用它主要是為系統提供各個精確的時鐘.然后,在分析了四路E1收發器的工作原理和比較了各類處理器特點的基礎上,提出了四路E1收發器的硬件設計,分別介紹了時鐘模塊、系統接口電路、存儲系統模塊、四通道E1合成器模塊、CPU模塊以及時隙交換模塊.接著,在研究分析了G.703和G.704等通信協議后,再根據系統要求提出了四路E1收發器的軟件設計.先介紹了實時操作系統RTXC,詳細闡述了ARM處理器啟動代碼程序的設計,然后給出了在此操作系統下軟件設計的整體結構,分四個任務分別闡述此軟件功能,其中詳細介紹了信令處理模塊、接口中斷處理模塊、系統運行監測模塊和RC消息LC消息處理模塊.最后介紹了軟件和硬件的調試方法以及設計過程中的調試開發過程,整個系統設計完成后,經過反復調試、測驗已達到了預期的效果,現正投入使用中.

    標簽: FPGA ARM 處理器 中的應用

    上傳時間: 2013-04-24

    上傳用戶:夢雨軒膂

  • FPGA在飛機音頻管理組件測試系統中的應用研究

    音頻管理組件(Audio Management Unit,AMU)是先進客艙娛樂與服務系統(Advanced Cabin Entertainment Service System,ACESS)的組成部分,應用于飛機上音頻資源的管理與控制。飛機運營對航空機載電子系統準確性、復雜性和安全性的高要求,使得其維修維護工作極大地依賴于自動測試設備(Automatic Testing Equipment,ATE)。本課題來源于實際工程項目, FPGA技術具備多種優點,將其與民航測試設備結合研制一個用于檢測AMU故障的自動測試系統,該系統將對AMU自動完成部件維修手冊(Comvonent Maintenance Manual,CMM)所規定的全部功能、性能方面的綜合測試。 本文首先概述音頻管理組件、自動測試系統及其在民航領域的應用,并闡述了課題的背景、研究目標和相關技術要求;文章對可編程邏輯器件CPLD/FPGA的結構原理、硬件描述語言VHDL的特點以及MAXL+plusⅡ軟件的設計流程進行了說明,重點闡述了基于FPGA的DDS信號發生器以及數據采集卡的設計實現、并著重闡述了ARINC429總線的傳輸規范,和基于FPGA的ARINC429總線接口的設計與實現。在ARINC429接口設計中采用自頂向下,多層次系統設計的方法,用VHDL語言進行描述。在發送器中利用了FPGA內部的分布式RAM創建異步FIFO,節約了FPGA的內部資源和提高了數據傳輸速度;在接收器中采用了提高抗干擾性的優化設計。測試結果表明基于FPGA的設計實現ARINC429總線數據通信的要求,使用方便,可靠性好,能夠克服HS-3282芯片中的數據格式固定,使用不夠靈活方便,價格昂貴的缺點。

    標簽: FPGA 飛機 音頻 測試系統

    上傳時間: 2013-08-06

    上傳用戶:gzming

  • FPGA在數字信號處理中的應用與研究

    數字信號處理是信息科學中近幾十年來發展最為迅速的學科之一.目前,數字信號處理廣泛應用于通信、雷達、聲納、語音與圖像處理等領域.而數字信號處理算法的硬件實現一般來講有三種方式:用于通用目的的可編程DSP芯片;用于特定目的的固定功能DSP芯片組和ASIC;可以由用戶編程的FPGA芯片.隨著微電子技術的發展,采用現場可編程門陣列FPGA進行數字信號處理得到了飛速發展,FPGA正在越來越多地代替ASIC和PDSP用作前端數字信號處理的運算.該文主要探討了基于FPGA數字信號處理的實現.首先詳細闡述了數字信號處理的理論基礎,重點討論了離散傅立葉變換算法原理,由于快速傅立葉變換算法在實際中得到了廣泛的應用,該文給出了基-2FFT算法原理、討論了按時間抽取FFT算法的特點.該論文對硬件描述語言的描述方法和風格做了一定的探討,介紹了硬件描述語言的開發環境MAXPLUSII.在此基礎上,該論文詳細闡述了數字集成系統的高層次設計方法,討論了數字系統設計層次的劃分和數字系統的自頂向下的設計方法,探討了數字集成系統的系統級設計和寄存器傳輸級設計,描述了數字集成系統的高層次綜合方法.最后該文描述了數字信號處理系統結構的實現方法,指出常見的高速、實時信號處理系統的四種結構;由于FFT算法在數字信號處理中占有重要的地位,所以該文提出了用FPGA實現FFT的一種設計思想,給出了總體實現框圖;重點設計實現了FFT算法中的蝶形處理單元,采用了一種高效乘法器算法設計實現了蝶形處理單元中的旋轉因子乘法器,從而提高了蝶形處理器的運算速度,降低了運算復雜度.

    標簽: FPGA 數字信號處理 中的應用

    上傳時間: 2013-07-19

    上傳用戶:woshiayin

  • 高速FPGA在激光回波檢測中的應用

    激光測距是激光技術在軍事上最早和最成熟的應用,自1961.年美國休斯飛機公司研制成功世界上第一臺激光測距機之后,激光測距技術發展迅速。如今,它已經被廣泛運用于軍用領域和民用領域。為了進一步提高我國激光測距水平,研制更高性能激光測距機依然是我國國防科技研究中的重要課題之一。其中,測距精度是激光測距機的一個重要參數。而激光測距機能否準確的檢測激光回波信號將直接影響測距精度。 脈沖激光測距系統主要包括激光發射子系統、激光回波探測子系統、回波檢測與主控子系統、終端顯示子系統等組成。其中設計高精度激光回波檢測與主控子系統是實現高精度激光測距的核心問題。傳統激光回波檢測與主控子系統通常采用分立元件和小規模集成電路設計,電路復雜且精度較低。隨著數字電路設計技術的發展,已出現大規模可編程邏輯器件FPGA(現場可編程門陣列)和CPLD(復雜可編程邏輯器件)。采用FPGA代替傳統的分立元件和小規模集成電路來設計激光回波檢測與主控子系統,不僅提高了回波檢測精度,同時簡化了整個測距系統的設計。 本文研究了將激光回波信號直接送入FPGA進行檢測的方案。同時,采用這種方案設計了一種激光回波檢測系統,并把它成功運用在一引信項目中。這種方案電路設計簡單,易于實現。在實際應用中,由于激光回波探測子系統只是完成由光信號到電信號的轉換及簡單放大,理論分析和試驗結果均表明,采用該方案進行回波檢測的精度較低,這種回波檢測方法也只能應用在測距精度要求低的項目中。 為了滿足另一高精度測距項目的需要,在FPGA直接進行激光回波檢測方案的基礎上,設計了一種高精度激光回波檢測系統。文中介紹了其實現原理,理論上分析了該系統所能達到的回波檢測精度及整機測距系統的測距精度。與第一種方案相比,該方案引入了超高速數據采集電路。由于采樣速率高達lGsps,該方案實現的難點在于如何保證數據采集電路的穩定工作。文中從總體方案的設計,到器件的選型,硬件電路板的實現等方面做了詳細的闡述,最終完成了系統硬件電路設計。接著介紹了系統程序設計。后面給出了試驗測試結果,該系統工作穩定,性能良好。系統設計中引入的超高速數據采集電路有著廣泛的應用,為其他相關設計提供了參考。最后,對全文做了工作總結,并給出了接下來的后續工作與展望。 本文在高速FPGA對激光回波信號檢測方向取得了一定的成果,為進一步研究提供了參考價值。

    標簽: FPGA 激光 回波 中的應用

    上傳時間: 2013-06-13

    上傳用戶:cy1109

  • 卷積碼在CDMA2000中的應用及其譯碼器FPGA實現

    數字信息在有噪聲的信道中傳輸時,受到噪聲的影響,誤碼總是不可避免的。根據香農信息理論,只要使Es/N0足夠大,就可以達到任意小的誤碼率。采用差錯控制編碼,即信道編碼技術,可以在一定的Es/N0條件下有效地降低誤碼率。按照對信息元處理方式不同,信道編碼分為分組碼與卷積碼兩類。卷積碼的k0和n0較小,實現最佳譯碼與準最佳譯碼更加容易。卷積碼運用廣泛,被ITU選入第三代移動通信系統,作為包括WCDMA,CDMA2000和TD-SCDMA在內的信道編碼的標準方案。 本文研究了CDMA2000業務通道中的幀結構,對CDMA2000系統中的卷積碼特性及維特比譯碼的性能限進行了分析,并基于MATLAB平臺做了相應的譯碼性能仿真。我們設計了一種可用于CDMA2000通信系統的通用、高速維特比譯碼器。該譯碼器在設計上具有以下創新之處:(1)采用通用碼表結構,支持可變碼率;幀控制模塊和頻率控制器模塊的設計中采用計數器、定時器等器件實現了可變幀長、可變數據速率的數據幀處理方式。(2)結合流水線結構思想,利用四個ACS模塊并行運行,加快數據處理速度;在ACS模塊中,將路徑度量值存貯器的存儲結構進行優化,防止數據讀寫的阻塞,縮短存儲器讀寫時間,使譯碼器的處理速度更快。(3)為了防止路徑度量值和幸存路徑長度的溢出,提出了保護處理策略。我們還將設計結果在APEXEP20K30E芯片上進行了硬件實現。該譯碼器芯片具有可變的碼率和幀長處理能力,可以運行于40MHZ系統時鐘下,內部最高譯碼速度可達625kbps。本文所提出的維特比譯碼器硬件結構具有很強的通用性和高速性,可以方便地應用于CDMA2000移動通信系統。

    標簽: CDMA 2000 FPGA 卷積碼

    上傳時間: 2013-06-24

    上傳用戶:lingduhanya

  • JTAG邊界掃描在FPGA中的應用及電路設計

    邊界掃描技術是一種應用于數字集成電路器件的標準化可測試性設計方法,它提供了對電路板上元件的功能、互連及相互間影響進行測試的一種新方案,極大地方便了系統電路的測試。本文基于IEEE 1149.1標準剖析了JTAG邊界掃描測試的精髓,分析了其組成,功能與時序控制等關鍵技術。 應用在FPGA芯片中的邊界掃描電路側重于電路板級測試,兼顧芯片功能測試,同時提供JTAG下載方式。針對在FPGA芯片中的應用特點,設計了一種邊界掃描電路,應用于自行設計的FPGA結構之中。除了基本的測試功能外,加入了對FPGA芯片進行配置、回讀以及用戶自定義測試等功能。 通過仿真驗證,所設計的邊界掃描電路可實現FPGA芯片的測試、配置和回讀等功能,并符合IEEE 11491.1邊界掃描標準的規定,達到設計要求。

    標簽: JTAG FPGA 邊界掃描 中的應用

    上傳時間: 2013-04-24

    上傳用戶:372825274

  • CCS中的graph詳細使用說明

    CCS中的graph詳細使用說明

    標簽: graph CCS 使用說明

    上傳時間: 2013-07-30

    上傳用戶:1043041441

  • FPGA在硬盤加密卡中的應用與研究

    隨著我國信息化發展進程加快,信息化覆蓋面擴大,信息安全問題也就隨之增多,其影響和后果也更加廣泛和嚴重。同時,信息安全及其對經濟發展、國家安全和社會穩定的重大影響,正日益突出地顯現出來,受到越來越多的關注。在和平年代,通過對信息載體進行大規模的物理破壞,從而達到危害信息安全的目的,在一定程度上是行不通的。然而,在信息安全的角力上,破壞者從來都沒有放棄過,他們把目標對準了信息載體中的數據,由于數據的易失性,計算機數據成為信息安全中的最大隱患,同時也是破壞信息安全的一個突破口。 本文提出研制硬盤加密卡的主要目的是為了防止對計算機數據的竊取,保護硬盤中的數據。破壞者在得到硬盤后,也不能夠得到硬盤中的數據,從而達到保護信息安全的目的。加密卡提供兩個符合ATA-6標準的接口,串接在主板IDE接口和硬盤之間。存儲在硬盤上的數據,是經過加密以后的加密數據;從硬盤上讀出的數據,必須經過該卡的解密才可被正常使用,否則只是一堆亂碼。加密卡采用FPGA技術實現IDE接口和加密算法,以減小加解密帶來的速度上的影響。 論文的工作重點主要有以下幾個方面的內容:FPGA及VHDL語言的研究,ATA協議標準研究及IDE接口的FPGA實現。論文對ATA協議做了細致的研究,分析了硬盤接口的工作機制以及主機與硬盤之間的通信協議,并在此基礎上,重點研究了用FPGA的編程功能來實現一個計算機硬件底層接口協議的方法,詳細介紹了芯片的內部框圖及FPGA的軟件流程圖,提出了在實現過程中應注意的要點,最終用FPGA構建了一個雙向IDE硬盤通道,實現了兩套符合ATA-6規范的IDE接口。

    標簽: FPGA 硬盤 加密卡 中的應用

    上傳時間: 2013-08-02

    上傳用戶:Ants

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