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中的設(shè)(shè)計(jì)

FPGA在新型激光光幕靶中的應(yīng)用

結(jié)合坐標(biāo)采集和處理在新型激光光幕靶中的應(yīng)用，針對(duì)傳統(tǒng)激光光幕靶處理器I/O緊缺、處理速度慢、存在錯(cuò)報(bào)、漏報(bào)，無(wú)法測(cè)試子彈連發(fā)坐標(biāo)等問題，提出了一種以FPGA為核心的坐標(biāo)采集和處理系統(tǒng)的設(shè)計(jì)方法。設(shè)計(jì)中采用了自頂向下的設(shè)計(jì)方法，將該系統(tǒng)依據(jù)邏輯功能劃分為3個(gè)模塊，并在ISE 14.1和Modelsim中進(jìn)行設(shè)計(jì)、編譯、仿真，最后的仿真結(jié)果表明該系統(tǒng)能夠很好地采集到子彈的坐標(biāo)。

標(biāo)簽： FPGA 激光光幕靶中的應(yīng)用

上傳時(shí)間： 2013-10-20

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電子元件在proteus中的符號(hào)

主要是電子元器件在仿真中的符號(hào)

標(biāo)簽： proteus 電子元件符號(hào)

上傳時(shí)間： 2013-10-22

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Nios II軟件開發(fā)人員手冊(cè)中的緩存和緊耦合存儲(chǔ)器部分

Nios II 軟件開發(fā)人員手冊(cè)中的緩存和緊耦合存儲(chǔ)器部分 Nios® II embedded processor cores can contain instruction and data caches. This chapter discusses cache-related issues that you need to consider to guarantee that your program executes correctly on the Nios II processor. Fortunately, most software based on the Nios II hardware abstraction layer (HAL) works correctly without any special accommodations for caches. However, some software must manage the cache directly. For code that needs direct control over the cache, the Nios II architecture provides facilities to perform the following actions:

標(biāo)簽： Nios 軟件開發(fā) 存儲(chǔ)器

上傳時(shí)間： 2013-10-25

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狀態(tài)機(jī)在AD采樣控制中的應(yīng)用

狀態(tài)機(jī)在A_D采樣控制中的應(yīng)用

標(biāo)簽： 狀態(tài) 控制中的應(yīng)用采樣

上傳時(shí)間： 2013-11-19

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FPGA設(shè)計(jì)中的基本問題

第6章 FPGA設(shè)計(jì)中的基本問題

標(biāo)簽： FPGA

上傳時(shí)間： 2014-12-04

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MATLAB在FPGA中的應(yīng)用電子書

MATLAB及其在FPGA中的應(yīng)用（第2版）本書緊密結(jié)合作者在MATIAB和FPGA應(yīng)用領(lǐng)域中的實(shí)際經(jīng)驗(yàn)，講述了MATIAB的基本使用方法及其在FPGA設(shè)計(jì)中的應(yīng)用。書中略去對(duì)MATIAB和FPGA的一般性介紹，以大量設(shè)計(jì)實(shí)例為切入點(diǎn)，將MATIAB強(qiáng)大的數(shù)值計(jì)算和算法仿真功能與當(dāng)今電子設(shè)計(jì)領(lǐng)域快速發(fā)展的FPGA設(shè)計(jì)技術(shù)相結(jié)合，重點(diǎn)講述了FPGA設(shè)計(jì)中的MATLAB聯(lián)合仿真問題，最后以三個(gè)大型設(shè)計(jì)實(shí)例結(jié)束全書的討論。目錄

標(biāo)簽： MATLAB FPGA 中的應(yīng)用電子書

上傳時(shí)間： 2013-11-15

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MATLAB及其在FPGA中的應(yīng)用（第2版）

MATLAB及其在FPGA中的應(yīng)用（第2版）

標(biāo)簽： MATLAB FPGA 中的應(yīng)用

上傳時(shí)間： 2013-11-02

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高速PCB設(shè)計(jì)中的反射研究

在高速數(shù)字電路飛速發(fā)展的今天，信號(hào)的頻率不斷提高, 信號(hào)完整性設(shè)計(jì)在P C B設(shè)計(jì)中顯得日益重要。其中由于傳輸線效應(yīng)所引起的信號(hào)反射問題是信號(hào)完整性的一個(gè)重要方面。本文研究分析了高速PCB 設(shè)計(jì)中的反射問題的產(chǎn)生原因，并利用HyperLynx 軟件進(jìn)行了仿真，最后提出了相應(yīng)的解決方法。

標(biāo)簽： PCB 反射

上傳時(shí)間： 2013-12-18

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powerPCB中的pcb轉(zhuǎn)到protel中的pcb的方法

如果用戶現(xiàn)有的是 Protel99SE 。ProtelDXP，Protel2004 版本： 1 在powerpcb 軟件的中打開 PCB 文件，選擇導(dǎo)出 ASCII 文件（export ascii file），ascii file 的版本應(yīng)該選擇 3.5 及以下的版本。 2 a 在 Protel99SE 。ProtelDXP ，選擇 File->Import->在出現(xiàn)的對(duì)話框中,選擇文件類型中的PADS Ascil Files (*.ASC)輸入對(duì)應(yīng)文件即可 1.powerpcb-->export ascii file--->import ascii file with protel99 se sp5(u must install padsimportor that is an add-on for 99sesp5 which can downloan from protel company ). 2.powerpcb-->export ascii file-->import ascii file in orcad layout-->import max file(orcad pcb file)with protel 99 or 99se.

標(biāo)簽： pcb powerPCB protel

上傳時(shí)間： 2013-10-16

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PCB板設(shè)計(jì)中的接地方法與技巧

“地”通常被定義為一個(gè)等位點(diǎn)，用來(lái)作為兩個(gè)或更多系統(tǒng)的參考電平。信號(hào)地的較好定義是一個(gè)低阻抗的路徑，信號(hào)電流經(jīng)此路徑返回其源。我們主要關(guān)心的是電流，而不是電壓。在電路中具有有限阻抗的兩點(diǎn)之間存在電壓差，電流就產(chǎn)生了。在接地結(jié)構(gòu)中的電流路徑?jīng)Q定了電路之間的電磁耦合。因?yàn)殚]環(huán)回路的存在，電流在閉環(huán)中流動(dòng)，所以產(chǎn)生了磁場(chǎng)。閉環(huán)區(qū)域的大小決定著磁場(chǎng)的輻射頻率，電流的大小決定著噪聲的幅度。在實(shí)施接地方法時(shí)存在兩類基本方法：?jiǎn)吸c(diǎn)接地技術(shù)和多點(diǎn)接地技術(shù)。在每套方案中，又可能采用混合式的方法。針對(duì)某一個(gè)特殊的應(yīng)用，如何選擇最好的信號(hào)接地方法取決于設(shè)計(jì)方案。只要設(shè)計(jì)者依據(jù)電流流量和返回路徑的概念，就可以以同時(shí)采用幾種不同的方法綜合加以考慮

標(biāo)簽： PCB 法與技巧

上傳時(shí)間： 2013-11-14

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