自動檢測80C51串行通訊中的波特率:本文介紹一種在80C51 串行通訊應用中自動檢測波特率的方法。按照經(jīng)驗，程序起動后所接收到的第1 個字符用于測量波特率。這種方法可以不用設定難于記憶的開關，還可以免去在有關應用中使用多種不同波特率的煩惱。人們可以設想：一種可靠地實現(xiàn)自動波特檢測的方法是可能的，它無須嚴格限制可被確認的字符。問題是：在各種的條件下，如何可以在大量允許出現(xiàn)的字符中找出波特率定時間隔。顯然，最快捷的方法是檢測一個單獨位時間（single bit time），以確定接收波特率應該是多少?？墒?，在RS-232 模式下，許多ASCII 字符并不能測量出一個單獨位時間。對于大多數(shù)字符來說，只要波特率存在合理波動（這里的波特率是指標準波特率），從起始位到最后一位“可見”位的數(shù)據(jù)傳輸周期就會在一定范圍內發(fā)生變化。此外，許多系統(tǒng)采用8 位數(shù)據(jù)、無奇偶校驗的格式傳輸ASCII 字符。在這種格式里，普通ASCII 字節(jié)不會有MSB 設定，并且，UART總是先發(fā)送數(shù)據(jù)低位（LSB），后發(fā)送數(shù)據(jù)高位（MSB），我們總會看見數(shù)據(jù)的停止位。在下面的波特率檢測程序中，先等待串行通訊輸入管腳的起始信號（下降沿），然后起動定時器T0。在其后的串行數(shù)據(jù)的每一個上升沿，將定時器T0 的數(shù)值捕獲并保存。當定時器T0溢出時，其最后一次捕獲的數(shù)值即為從串行數(shù)據(jù)起始位到最后一個上升沿（我們假設是停止位）過程所持續(xù)的時間。
上傳時間： 2014-08-22
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RS232C串行通信在控制領域里應用得很廣泛但在實際應用中又會因所控制的對象所解決的問題不同而各具特點本文所涉及的是傳輸距離不超過15米所傳輸數(shù)據(jù)量較小的PC機和單片機的通信如PC機對IC卡的讀寫PC機對單片機燒寫器的數(shù)據(jù)轉輸以及其它一些具有類似特點的智能化儀器和儀表中的數(shù)據(jù)通信
上傳時間： 2014-12-28
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CAT24Cxxx是集E2PROM存儲器, 精確復位控制器和看門狗定時器三種流行功能于一體的芯片。CAT24C161/162（16K），CAT24C081/082（8K），CAT24C041/042（4K）和CAT24C021/022（2K） 主要作為I2C 串行CMOS E2PROM器件，采用先進的CMOS工藝大大降低了器件的功耗。CAT24Cxxx另一特點是16 字節(jié)的頁寫緩沖區(qū)，提供8腳DIP和SOIC封裝。CAT24Cxxx的復位功能和看門狗定時器功能保證系統(tǒng)出現(xiàn)故障的時候能給CPU一個復位信號。CAT24Cxxx的第2腳輸出低電平復位信號，第7腳輸出高電平復位信號。CAT24Cxx1 看狗溢出信號從SDA腳輸出CAT24Cxx2不具備看門狗功能
上傳時間： 2013-12-12
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帶I2C串行CMOS EEPROM、精密復位控制器和看門狗定時器的監(jiān)控電路 特性 看門狗監(jiān)控SDA信號 (CAT1161) 兼容400KHz 的I2C總線 操作電壓范圍為2.7V～6.0V 低功耗CMOS 技術 16 字節(jié)的頁寫緩沖區(qū) 內置誤寫保護電路－Vcc鎖定－寫保護管腳WP 復位高電平或低電平有效－精確的電源電壓監(jiān)控－支持5V，3.3V 和3V 的系統(tǒng)－5個復位門檻電壓可供選擇 1,000,000個編程/擦除周期 手動復位 數(shù)據(jù)可保存100 年 8 腳DIP 封裝或8 腳SOIC 封裝 商業(yè)和工業(yè)級溫度范圍描述CAT1161/2 為基于微控器的系統(tǒng)提供了一個完整的存儲器和電源監(jiān)控解決方案。它們利用低功耗CMOS技術將16k帶硬件存儲器寫保護功能的串行EEPROM 存儲器、用于掉電保護的電源監(jiān)控電路和一個看門狗定時器集成到一塊芯片上。存儲器采用I2C 總線接口。當系統(tǒng)由于軟件或硬件干擾而被終止或“掛起”時，1.6 秒的看門狗電路將復位系統(tǒng)，使系統(tǒng)恢復正常。CAT1161的看門狗電路監(jiān)控著SDA，這就可以省去額外的PC板跟蹤電路。低價位的CAT1162不含看門狗定時器。電源監(jiān)控和復位電路可在系統(tǒng)上電/下電時保護存儲器和系統(tǒng)控制器，防止掉電條件的產生。CAT1161/2的5個門檻電壓可支持5V、3.3V和3V的系統(tǒng)。一旦電源電壓超出范圍，復位信號有效，禁止微控制器、ASIC或外圍器件繼續(xù)工作。復位信號在電源電壓超過復位門檻電壓后的200ms內仍保持有效。由于帶有高電平和低電平復位信號，因此CAT1161/2可以很方便地連接到微控制器和其它IC。另外，復位管腳還可用作手動按鍵復位的去抖輸入。 CAT1161/2 的存儲器構造成16字節(jié)的頁。除此之外，寫保護管腳WP和VCC 檢測電路提供的硬件數(shù)據(jù)保護功能可防止在Vcc降到低于復位門檻電壓或上電時Vcc上升到復位門檻電壓之前對存儲器的寫操作。器件包含8腳DIP和表貼8腳SOIC兩種封裝形式。
上傳時間： 2014-03-19
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摘 要:介紹了FPGA最新一代器件Virtex25上的高速串行收發(fā)器RocketIO?；贛L505開發(fā)平臺構建了一個高速串行數(shù)據(jù)傳輸系統(tǒng),重點說明了該系統(tǒng)采用RocketIO實現(xiàn)1. 25Gbp s高速串行傳輸?shù)脑O計方案。實現(xiàn)并驗證了采用FPGA完成千兆串行傳輸?shù)墓δ苣繕?為后續(xù)采用FPGA實現(xiàn)各種高速協(xié)議奠定了良好的基礎。關鍵詞: FPGA;高速串行傳輸; RocketIO; GTP 在數(shù)字系統(tǒng)互連設計中,高速串行I/O技術取代傳統(tǒng)的并行I/O技術成為當前發(fā)展的趨勢。與傳統(tǒng)并行I/O技術相比,串行方案提供了更大的帶寬、更遠的距離、更低的成本和更高的擴展能力,克服了并行I/O設計存在的缺陷。在實際設計應用中,采用現(xiàn)場可編程門陣列( FPGA)實現(xiàn)高速串行接口是一種性價比較高的技術途徑。
上傳時間： 2013-11-22
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針對實時型相機對系統(tǒng)小型化、通用化及數(shù)據(jù)高速率可靠傳輸?shù)男枨?，文中在研究高速串行?解串器（SerDes）器件TLK2711工作原理的基礎上，提出了高速串行全雙工通信協(xié)議總體設計方案。文章以TLK2711為物理層、FPGA為鏈路層設計了高速串行全雙工通信協(xié)議，對協(xié)議的實現(xiàn)進行了詳細的描述。協(xié)議的在定制中力求做到了最簡化，為上層用戶提供簡單的數(shù)據(jù)接口。試驗中通過兩塊電路板的聯(lián)調，完成了數(shù)據(jù)率為2.5Gbps的點對點高速傳輸，采用發(fā)送偽隨機碼測試，系統(tǒng)工作2小時，所測誤碼率小于10-12。
上傳時間： 2014-12-28
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摘 要:介紹了FPGA最新一代器件Virtex25上的高速串行收發(fā)器RocketIO?；贛L505開發(fā)平臺構建了一個高速串行數(shù)據(jù)傳輸系統(tǒng),重點說明了該系統(tǒng)采用RocketIO實現(xiàn)1. 25Gbp s高速串行傳輸?shù)脑O計方案。實現(xiàn)并驗證了采用FPGA完成千兆串行傳輸?shù)墓δ苣繕?為后續(xù)采用FPGA實現(xiàn)各種高速協(xié)議奠定了良好的基礎。關鍵詞: FPGA;高速串行傳輸; RocketIO; GTP 在數(shù)字系統(tǒng)互連設計中,高速串行I/O技術取代傳統(tǒng)的并行I/O技術成為當前發(fā)展的趨勢。與傳統(tǒng)并行I/O技術相比,串行方案提供了更大的帶寬、更遠的距離、更低的成本和更高的擴展能力,克服了并行I/O設計存在的缺陷。在實際設計應用中,采用現(xiàn)場可編程門陣列( FPGA)實現(xiàn)高速串行接口是一種性價比較高的技術途徑。
上傳時間： 2013-10-22
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串行口是計算機一種常用的接口，具有連接線少，通訊簡單，得到廣泛的使用。常用的串口是RS-232-C接口(又稱EIA RS-232-C)它是在1970年由美國電子工業(yè)協(xié)會(EIA)聯(lián)合貝爾系統(tǒng)、調制解調器廠家及計算機終端生產廠家共同制定的用于串行通訊的標準。它的全名是"數(shù)據(jù)終端設備(DTE)和數(shù)據(jù)通訊設備(DCE)之間串行二進制數(shù)據(jù)交換接口技術標準"該標準規(guī)定采用一個25個腳的DB25連接器，對連接器的每個引腳的信號內容加以規(guī)定，還對各種信號的電平加以規(guī)定。傳輸距離在碼元畸變小于4%的情況下，傳輸電纜長度應為50英尺。 Linux操作系統(tǒng)從一開始就對串行口提供了很好的支持，本文就Linux下的串行口通訊編程進行簡單的介紹.
上傳時間： 2013-12-16
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//串行驅動led顯示， //一個74hc595位移寄存器驅動三極管驅動led位， //兩個74hc595驅動led段，方式位5位x8段x2=10個數(shù)碼管 //5分頻，每次掃描時間位1.25ms //定義特殊符號
上傳時間： 2015-03-30
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眾志-863系統(tǒng)芯片 USBDC（univer serial bus devce control通用串行總線設備控制芯片，以下簡稱USBDC）是和帶有USB主機控制器的設備進行通信的支持部件，實現(xiàn)和帶有USB主機控制器的設備進行數(shù)據(jù)交換。 USBDC和APB連接進行寄存器的初始化配置，和DMAC連接進行大量的數(shù)據(jù)交換。
標簽： control univer serial USBDC
上傳時間： 2015-03-31
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