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基于VHDL語言的一個(gè)新型串行數(shù)字通信模塊。
標(biāo)簽： VHDL 串行 數(shù)字通信 模塊
上傳時(shí)間： 2013-08-09
上傳用戶：bvdragon
本文介紹了一種新的使用串行通信進(jìn)行DSP遠(yuǎn)程在線編程方法。對設(shè)計(jì)中的主要技術(shù)：DSP與PC機(jī)的串口通信、Flash編程以及DSP自引導(dǎo)等進(jìn)行了詳細(xì)介紹。結(jié)合TI公司的TMS320VC33處理器，闡述了具體的實(shí)現(xiàn)方法
標(biāo)簽： DSP 串行通信 遠(yuǎn)程 編程方法
上傳時(shí)間： 2013-08-19
上傳用戶：zhangfx728
adi串行AD AD9229的控制使用ISE平臺(tái) Verilog語言\r\n
標(biāo)簽： 9229 adi ISE AD
上傳用戶：1417818867
異步通信串行口設(shè)計(jì)實(shí)例，很實(shí)用。比較經(jīng)典。
標(biāo)簽： FPGA-UART 異步通信 串行口 設(shè)計(jì)實(shí)例
上傳時(shí)間： 2013-08-20
上傳用戶：gundamwzc
大容量FPGA數(shù)據(jù)的EEPROM串行加載
標(biāo)簽： EEPROM FPGA 大容量 串行
上傳時(shí)間： 2013-08-23
上傳用戶：GeekyGeek
FPGA控制串行AD（AD0804）,狀態(tài)機(jī)實(shí)現(xiàn)，可以根據(jù)該程序?qū)崿F(xiàn)數(shù)字電壓計(jì)，數(shù)字溫度計(jì)的設(shè)計(jì)
標(biāo)簽： FPGA 0804 AD 控制
上傳時(shí)間： 2013-08-24
上傳用戶：jiiszha
利用ARM的GPIO和SPI總線進(jìn)行FPGA的被動(dòng)串行配置,加載速度可以達(dá)到200KBytes/Sec.
標(biāo)簽： GPIO FPGA ARM SPI
上傳時(shí)間： 2013-08-28
上傳用戶：Maple
基于FPGA的串行通信UART控制器，采用VHDL語言編寫，包含多個(gè)子模塊。\r\n在ISE或FPGA的其它開發(fā)環(huán)境下新建一個(gè)工程，然后將文檔中的各個(gè)模塊程序添加進(jìn)去，即可運(yùn)行仿真。源程序已經(jīng)過本人的仿真驗(yàn)證。
標(biāo)簽： FPGA UART 串行通信 控制器
上傳時(shí)間： 2013-09-03
上傳用戶：xieguodong1234
用VHDL語言在CPLD上實(shí)現(xiàn)串行通信
標(biāo)簽： VHDL CPLD 語言 串行通信
上傳時(shí)間： 2013-09-06
上傳用戶：q3290766
1、 利用FLEX10的片內(nèi)RAM資源，根據(jù)DDS原理，設(shè)計(jì)產(chǎn)生正弦信號的各功能模塊和頂層原理圖； 2、 利用實(shí)驗(yàn)板上的TLC7259轉(zhuǎn)換器，將1中得到的正弦信號，通過D/A轉(zhuǎn)換，通過ME5534濾波后在示波器上觀察； 3、 輸出波形要求： 在輸入時(shí)鐘頻率為16KHz時(shí)，輸出正弦波分辨率達(dá)到1Hz； 在輸入時(shí)鐘頻率為4MHz時(shí)，輸出正弦波分辨率達(dá)到256Hz； 4、 通過RS232C通信，實(shí)現(xiàn)FPGA和PC機(jī)之間串行通信，從而實(shí)現(xiàn)用PC機(jī)改變頻率控制字，實(shí)現(xiàn)對輸出正弦波頻率的控制。
標(biāo)簽： FPGA PC機(jī) 串行通信 輸出
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