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乒乓游戲

  • 大話西游II外掛的易語(yǔ)言源代碼(自動(dòng)喊話 自動(dòng)練級(jí))

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    標(biāo)簽: 自動(dòng) 語(yǔ)言 源代碼

    上傳時(shí)間: 2014-11-23

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    標(biāo)簽: 棋游大師(黑白棋)

    上傳時(shí)間: 2015-03-22

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    一款基于cocos2dx的仿割繩子手游源碼

    標(biāo)簽: 游戲開發(fā)

    上傳時(shí)間: 2015-07-19

    上傳用戶:楊旭。。

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    標(biāo)簽: 迅游

    上傳時(shí)間: 2015-11-05

    上傳用戶:CYJ--

  • 大氣采樣輝光放電質(zhì)譜儀的設(shè)計(jì)與應(yīng)用_江游

    大氣采樣輝光放電質(zhì)譜儀的設(shè)計(jì)與應(yīng)用_江游

    標(biāo)簽: 大氣 儀的設(shè)計(jì) 采樣 放電 質(zhì)譜

    上傳時(shí)間: 2019-07-14

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  • 大氣壓接口_單四極桿質(zhì)譜儀的研制_江游

    大氣壓接口_單四極桿質(zhì)譜儀的研制_江游

    標(biāo)簽: 大氣 儀的研制 接口 質(zhì)譜

    上傳時(shí)間: 2019-07-14

    上傳用戶:chen_ying993

  • 復(fù)古傳奇手游

    復(fù)古傳奇1.8手游源碼,服務(wù)器文件。個(gè)人勞動(dòng)成果,請(qǐng)勿泄露。

    標(biāo)簽: 傳奇

    上傳時(shí)間: 2020-11-02

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  • 基于FPGA和DSP的實(shí)時(shí)圖像處理系統(tǒng)設(shè)計(jì).rar

    數(shù)字信息時(shí)代帶來(lái)了“信息大爆炸”,使數(shù)據(jù)量大增,而數(shù)字圖像數(shù)據(jù)更是如此,如果不對(duì)圖像數(shù)據(jù)進(jìn)行有效的壓縮,那么圖像信息的存儲(chǔ)與傳輸將無(wú)法進(jìn)行。顯然,尋求一種高效的圖像壓縮系統(tǒng)具有很大的現(xiàn)實(shí)意義。 本文基于大規(guī)?,F(xiàn)場(chǎng)可編程邏輯陣列(FPGA)和高速數(shù)字信號(hào)處理器(DSP)協(xié)同作業(yè),來(lái)完成實(shí)時(shí)圖像處理的系統(tǒng)設(shè)計(jì)。出于對(duì)系統(tǒng)設(shè)計(jì)上的性能和功耗方面的考慮,系統(tǒng)中FPGA 選用的是ALTERA公司的Cyclone系列芯片EP1C12Q240C8,DSP選用的是TI公司的55x系列芯片TMS320VC5502。該系統(tǒng)集圖像采集、壓縮、顯示和存儲(chǔ)功能于一體,其中DSP為主處理器負(fù)責(zé)圖像處理,F(xiàn)PGA為協(xié)處理器負(fù)責(zé)系統(tǒng)的所有數(shù)字邏輯控制。FPGA和DSP的工作之間形成流水,并且借助于一片雙口RAM(CY7C025AV-15AI)完成兩者的通訊。結(jié)合FPGA和DSP自身的特點(diǎn),本文提出一種新穎的信息通信方式,借助于一片雙口RAM,其內(nèi)部按其存儲(chǔ)空間等分兩塊,利用乒乓技術(shù)完成對(duì)高速實(shí)時(shí)的圖像數(shù)據(jù)緩沖。 該系統(tǒng)從視頻采集、傳輸、壓縮到圖像存儲(chǔ)等整個(gè)過(guò)程的工作,分別由FPGA和DSP承擔(dān)。充分考慮到它們自身的優(yōu)缺點(diǎn),在滿足系統(tǒng)實(shí)時(shí)性要求的同時(shí),結(jié)構(gòu)靈活,便于以后的擴(kuò)展與升級(jí)。結(jié)果表明,在TMS320VC5502實(shí)現(xiàn)了對(duì)采集圖像的JPEG壓縮,效果良好且滿足了實(shí)時(shí)性的要求,因此系統(tǒng)的功能得到了總體上的驗(yàn)證。 關(guān)鍵詞:圖像處理;FPGA;DSP;JPEG

    標(biāo)簽: FPGA DSP 實(shí)時(shí)圖像

    上傳時(shí)間: 2013-06-11

    上傳用戶:hjshhyy

  • 基于FPGA的3D頭盔顯示設(shè)備研究.rar

    圖像顯示器是人類接受外部信息的重要手段之一。而立體顯示則能再現(xiàn)場(chǎng)景的三維信息,提供場(chǎng)景更為全面、詳實(shí)的信息,在醫(yī)學(xué)、軍事、娛樂(lè)具有廣泛的應(yīng)用前景。而現(xiàn)有的3D立體顯示設(shè)備價(jià)格都比較貴,基于此,本人研究了基于SDRAM存儲(chǔ)器和FPGA處理器的3D頭盔顯示設(shè)備并且設(shè)計(jì)出硬件和軟件系統(tǒng)。該系統(tǒng)圖像效果好,并且價(jià)格成本便宜,從而具有更大的實(shí)用性。本文完成的主要工作有三點(diǎn): 1.設(shè)計(jì)了基于FPGA處理器和SDRAM存儲(chǔ)器的3D頭盔顯示器。該方案有別于現(xiàn)有的基于MCU、DSP和其它處理芯片的方案。本方案能通過(guò)線性插值算法把1024×768的分辨率變成800×600的分辨率,并能實(shí)現(xiàn)120HZ圖像刷新率,采用SDRAM作為高速存儲(chǔ)器,并且采用乒乓操作,有別于其它的開關(guān)左右眼視頻實(shí)現(xiàn)立體圖像。在本方案中每時(shí)每刻都是左右眼視頻同時(shí)輸出,使得使用者感覺(jué)不到視頻圖像有任何閃爍,減輕眼睛疲勞。本方案還實(shí)現(xiàn)了圖像對(duì)比對(duì)度調(diào)節(jié),液晶前照光調(diào)節(jié)(調(diào)節(jié)輸出脈沖的占空比),立體圖像源自動(dòng)識(shí)別,還有人性化的操作界面(OSD)功能。 2.完成了該系統(tǒng)的硬件平臺(tái)設(shè)計(jì)和軟件設(shè)計(jì)。從便攜性角度考慮,盡量減小PCB板面積,給出了它們?cè)敿?xì)的硬件設(shè)計(jì)電路圖。完成了FPGA系統(tǒng)的設(shè)計(jì),包括系統(tǒng)整體分析,各個(gè)模塊的實(shí)現(xiàn)原理和具體實(shí)現(xiàn)的方法。完成了單片機(jī)對(duì)AD9883的配置設(shè)計(jì)。 3.完成了本方案的各項(xiàng)測(cè)試和調(diào)試工作,主要包括:數(shù)據(jù)采集部分測(cè)試、數(shù)據(jù)存儲(chǔ)部分測(cè)試、FPGA器件工作狀態(tài)測(cè)試、以電腦顯示器作為顯示器的聯(lián)機(jī)調(diào)試和以HX7015A作為顯示器的聯(lián)機(jī)調(diào)試,并且最終調(diào)試通過(guò),各項(xiàng)功能都滿足預(yù)期設(shè)計(jì)的要求。實(shí)驗(yàn)和分析結(jié)果論證了系統(tǒng)設(shè)計(jì)的合理性和使用價(jià)值。 本文的研究與實(shí)現(xiàn)工作通過(guò)實(shí)驗(yàn)和分析得到了驗(yàn)證。結(jié)果表明,本文提出的由FPGA和SDRAM組成的3D頭盔顯示系統(tǒng)完全可以實(shí)現(xiàn)高質(zhì)量的立體視覺(jué)效果,從而可以將該廉價(jià)的3D頭盔顯示系統(tǒng)用于我國(guó)現(xiàn)代化建設(shè)中所需要的領(lǐng)域。

    標(biāo)簽: FPGA 顯示設(shè)備

    上傳時(shí)間: 2013-07-16

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  • 基于FPGA的動(dòng)態(tài)光譜數(shù)據(jù)采集系統(tǒng).rar

    近紅外光譜法是血液成分無(wú)創(chuàng)檢測(cè)方法中的熱點(diǎn),也是取得成果最多的方法之一。但是,個(gè)體差異和測(cè)量條件是影響近紅外光譜血液成分無(wú)創(chuàng)檢測(cè)的一個(gè)較突出的問(wèn)題。而動(dòng)態(tài)光譜法就是針對(duì)這個(gè)問(wèn)題而提出的一種全新的近紅外無(wú)創(chuàng)血液成分濃度檢測(cè)方法。它從原理上消除了個(gè)體差異和測(cè)量條件等對(duì)光譜檢測(cè)的影響,為基于近紅外光譜法的血液成分無(wú)創(chuàng)檢測(cè)方法進(jìn)入臨床應(yīng)用去除了一個(gè)較為關(guān)鍵的障礙。因此,本文根據(jù)動(dòng)態(tài)光譜檢測(cè)原理設(shè)計(jì)了基于FPGA的動(dòng)態(tài)光譜數(shù)據(jù)采集系統(tǒng)。 在分析了動(dòng)態(tài)光譜數(shù)據(jù)采集系統(tǒng)的性能要求后,采用DALSA的高性能線陣CCD IL-C6-2048C作為光電轉(zhuǎn)換器件;根據(jù)CCD輸出數(shù)據(jù)的高速度和信號(hào)微弱及含有噪聲等特點(diǎn),選用了高速、高精度、并帶有相關(guān)雙采樣芯片的圖像處理芯片AD9826作為模數(shù)轉(zhuǎn)換器件;以FPGA及其內(nèi)嵌的NIOSⅡ處理器作為核心控制器,并用LabVIEW對(duì)采集得到的數(shù)據(jù)進(jìn)行顯示。 在FPGA中,利用Verilog HDL語(yǔ)言編寫了CCD和AD9826的控制時(shí)序;利用兩塊雙口RAM組成乒乓操作單元,實(shí)現(xiàn)高速數(shù)據(jù)的緩存,避免利用NiosⅡ處理器直接讀取時(shí)的頻繁中斷。將NIOSⅡ處理器系統(tǒng)嵌入到FPGA中,實(shí)現(xiàn)整個(gè)系統(tǒng)的管理。NiOSⅡ處理器利用中斷方式讀取緩存單元中的數(shù)據(jù)、經(jīng)對(duì)數(shù)變換后傳遞給計(jì)算機(jī)。其中緩存數(shù)據(jù)的讀取及對(duì)數(shù)變換均采用自定義組件的方式將硬件單元添加到NIOSⅡ系統(tǒng)中,編程時(shí)直接調(diào)用。NIOSⅡ系統(tǒng)通過(guò)串口將處理后的數(shù)據(jù)傳遞給LabVIEW, LabVIEW對(duì)數(shù)據(jù)簡(jiǎn)單處理后顯示,以實(shí)時(shí)觀察采樣數(shù)據(jù)是否正確。 最后對(duì)系統(tǒng)進(jìn)行了實(shí)驗(yàn)測(cè)試,實(shí)驗(yàn)結(jié)果表明,系統(tǒng)能夠很好的采集并顯示數(shù)據(jù),能夠初步完成光信號(hào)的檢測(cè)。

    標(biāo)簽: FPGA 動(dòng)態(tài) 光譜數(shù)據(jù)

    上傳時(shí)間: 2013-04-24

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