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乘加器

  • 基于FPGA設計的FIR濾波器的實現與對比

    描述了基于FPGA的FIR濾波器設計。根據FIR的原理及嚴格線性相位濾波器具有偶對稱的性質給出了FIR濾波器的4種結構,即直接乘加結構、乘法器復用結構、乘累加結構、DA算法。在本文中給出上述幾種算法的結構框圖,并通過FPGA編程實現上述幾種算法,并給出所用的資源來比較各種算法的優劣。

    標簽: FPGA FIR 濾波器 對比

    上傳時間: 2013-12-09

    上傳用戶:lvzhr

  • 基于FPGA設計的FIR濾波器的實現與對比

    描述了基于FPGA的FIR濾波器設計。根據FIR的原理及嚴格線性相位濾波器具有偶對稱的性質給出了FIR濾波器的4種結構,即直接乘加結構、乘法器復用結構、乘累加結構、DA算法。在本文中給出上述幾種算法的結構框圖,并通過FPGA編程實現上述幾種算法,并給出所用的資源來比較各種算法的優劣。

    標簽: FPGA FIR 濾波器 對比

    上傳時間: 2013-10-30

    上傳用戶:1101055045

  • Verilog大量例程

    【例 3.1】4 位全加器

    標簽: Verilog

    上傳時間: 2013-12-11

    上傳用戶:zsjzc

  • MODELSIM 環境下的Verilog 源代碼

    MODELSIM 環境下的Verilog 源代碼,實現全加器功能

    標簽: MODELSIM Verilog 環境 源代碼

    上傳時間: 2015-06-10

    上傳用戶:sardinescn

  • 實驗課的作業

    實驗課的作業,包括半加器、全加器、加/減法器,使用邏輯圖和VHDl描述,包括分析和報告。

    標簽: 實驗

    上傳時間: 2013-12-25

    上傳用戶:從此走出陰霾

  • 目錄: 0、 約定 1、 無符號數一位乘法 2、 符號數一位乘法 3、 布思算法(Booth algorithm) 4、 高基(High Radix)布思算法 5、 迭代算法 6、

    目錄: 0、 約定 1、 無符號數一位乘法 2、 符號數一位乘法 3、 布思算法(Booth algorithm) 4、 高基(High Radix)布思算法 5、 迭代算法 6、 乘法運算的實現——迭代 7、 乘法運算的實現——陣列 8、 乘加運算 9、 設計示例1 —— 8位、迭代 1、 實現方案1 —— 一位、無符號 2、 實現方案2 —— 一位、布思 3、 實現方案3 —— 二位 10、設計示例2 —— 16位、陣列 11、設計示例3 —— 32位、 迭代、陣列 1、 實現方案1 —— 乘、加一步走 2、 實現方案2 —— 乘、加兩步走

    標簽: algorithm Booth Radix High

    上傳時間: 2015-08-23

    上傳用戶:qiaoyue

  • 本程序以Modelsim為開發平臺

    本程序以Modelsim為開發平臺,采用VHDL為開發語言,實現了簡單的全加器.適合初學Modelsim的同行

    標簽: Modelsim 程序 開發平臺

    上傳時間: 2013-12-28

    上傳用戶:haohaoxuexi

  • 10個VHDL程序實例

    10個VHDL程序實例,包括加法器,全加器、函數發生器,選擇器等。

    標簽: VHDL 程序實例

    上傳時間: 2014-01-04

    上傳用戶:417313137

  • 2級流水線

    2級流水線,使用4元件實現的22位全加器的VHDL語言實現,適用于altera的FPGA

    標簽: 流水線

    上傳時間: 2016-01-27

    上傳用戶:ayfeixiao

  • 3級流水線

    3級流水線,含4元件的22位全加器的VHDL語言實現,適用于altera系列的FPGA

    標簽: 流水線

    上傳時間: 2016-01-27

    上傳用戶:cc1915

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