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互聯(lián)

CDMA超導濾波器

　　1、高溫薄膜濾波器技術(圍墻技術) 　　大規(guī)模集成電路，等效50階帶通濾波器，在接近-200℃左右工作，導體電阻接近0歐姆，帶通濾波器的品質因素Qu為100，000，是普通腔體濾波器品質因素Qu的20倍。有效抑制帶外干擾和進入帶內的高階互調。　　2、高性能的射頻電路技術　　低溫低噪聲放大器具有高增益(12dB)低噪聲系數(<0.5dB)的高性能，增益平坦度小于0.04dB,有效地壓低底噪聲，放大有用信號。比現網用的TMA和LNA的噪聲系數好3.5dB左右。世界尖端的制冷機技術，奶瓶大的氦制冷機，無需加冷凍液，可連續(xù)可靠地工作幾十年。其冷端溫度達77°K或-196.15°C。

標簽： CDMA 超導濾波器

上傳時間： 2013-11-07

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EVDO基本原理和關鍵技術

　　§培訓目標：　　本課程主要對EVDO的基本原理和關鍵技術進行介紹。通過本課程的學習，可以了解EVDO Rev.0和Rev.A的空中接口和關鍵技術，以及1X/DO互操作的相關規(guī)則等。　　§培訓內容：　　EVDO技術發(fā)展、網絡結構簡介; 　　EVDO Rev.0和RevA的空中接口結構; 　　EVDO Rev.0和RevA的關鍵技術; 　　1X / DO互操作原則;

標簽： EVDO 關鍵技術

上傳時間： 2014-03-25

上傳用戶：d815185728
Cadence PSD 15.0版本功能介紹

隨著PCB設計復雜程度的不斷提高，設計工程師對 EDA工具在交互性和處理復雜層次化設計功能的要求也越來越高。Cadence Design Systems, Inc. 作為世界第一的EDA工具供應商，在這些方面一直為用戶提供業(yè)界領先的解決方案。在 Concept-HDL15.0中，這些功能又得到了大度地提升。首先，Concept-HDL15.0，提供了交互式全局屬性修改刪除，以及全局器件替換的圖形化工作界面。在這些全新的工作環(huán)境中，用戶可以在圖紙，設計，工程不同的級別上對器件，以及器件/線網的屬性進行全局性的編輯。

標簽： Cadence 15.0 PSD 版本

上傳時間： 2013-11-19

上傳用戶：38553903210
PCB阻抗匹配計算工具（附教程）

附件是一款PCB阻抗匹配計算工具，點擊CITS25.exe直接打開使用，無需安裝。附件還帶有PCB連板的一些計算方法，連板的排法和PCB聯(lián)板的設計驗驗。 PCB設計的經驗建議: 1.一般連板長寬比率為1：1~2.5：1,同時注意For FuJi Machine:a.最大進板尺寸為:450*350mm, 2.針對有金手指的部分,板邊處需作掏空處理,建議不作為連板的部位. 3.連板方向以同一方向為優(yōu)先,考量對稱防呆,特殊情況另作處理. 4.連板掏空長度超過板長度的1/2時,需加補強邊. 5.陰陽板的設計需作特殊考量. 6.工藝邊需根據實際需要作設計調整,軌道邊一般不少於6mm,實際中需考量板邊零件的排布,軌道設備正?？▔壕嚯x為不少於3mm,及符合實際要求下的連板經濟性. 7.FIDUCIAL MARK或稱光學定位點,一般設計在對角處,為2個或4個,同時MARK點面需平整,無氧化,脫落現象;定位孔設計在板邊,為對稱設計,一般為4個,直徑為3mm,公差為±0.01inch. 8.V-cut深度需根據連板大小及基板板厚考量,角度建議為不少於45°. 9.連板設計的同時,需基於基板的分板方式考量<人工(治具)還是使用分板設備>. 10.使用針孔(郵票孔)聯(lián)接：需請考慮斷裂后的毛刺,及是否影響COB工序的Bonding機上的夾具穩(wěn)定工作,還應考慮是否有無影響插件過軌道,及是否影響裝配組裝.

標簽： PCB 阻抗匹配計算工具教程

上傳時間： 2014-12-31

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PCB阻抗匹配計算工具（附教程）

附件是一款PCB阻抗匹配計算工具，點擊CITS25.exe直接打開使用，無需安裝。附件還帶有PCB連板的一些計算方法，連板的排法和PCB聯(lián)板的設計驗驗。 PCB設計的經驗建議: 1.一般連板長寬比率為1：1~2.5：1,同時注意For FuJi Machine:a.最大進板尺寸為:450*350mm, 2.針對有金手指的部分,板邊處需作掏空處理,建議不作為連板的部位. 3.連板方向以同一方向為優(yōu)先,考量對稱防呆,特殊情況另作處理. 4.連板掏空長度超過板長度的1/2時,需加補強邊. 5.陰陽板的設計需作特殊考量. 6.工藝邊需根據實際需要作設計調整,軌道邊一般不少於6mm,實際中需考量板邊零件的排布,軌道設備正?？▔壕嚯x為不少於3mm,及符合實際要求下的連板經濟性. 7.FIDUCIAL MARK或稱光學定位點,一般設計在對角處,為2個或4個,同時MARK點面需平整,無氧化,脫落現象;定位孔設計在板邊,為對稱設計,一般為4個,直徑為3mm,公差為±0.01inch. 8.V-cut深度需根據連板大小及基板板厚考量,角度建議為不少於45°. 9.連板設計的同時,需基於基板的分板方式考量<人工(治具)還是使用分板設備>. 10.使用針孔(郵票孔)聯(lián)接：需請考慮斷裂后的毛刺,及是否影響COB工序的Bonding機上的夾具穩(wěn)定工作,還應考慮是否有無影響插件過軌道,及是否影響裝配組裝.

標簽： PCB 阻抗匹配計算工具教程

上傳時間： 2013-10-15

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可編輯程邏輯及IC開發(fā)領域的EDA工具介紹

EDA （Electronic Design Automation）即“電子設計自動化”，是指以計算機為工作平臺，以EDA軟件為開發(fā)環(huán)境，以硬件描述語言為設計語言，以可編程器件PLD為實驗載體(包括CPLD、FPGA、EPLD等)，以集成電路芯片為目標器件的電子產品自動化設計過程?！肮び破涫拢叵壤淦鳌?，因此，EDA工具在電子系統(tǒng)設計中所占的份量越來越高。下面就介紹一些目前較為流行的EDA工具軟件。 PLD 及IC設計開發(fā)領域的EDA工具，一般至少要包含仿真器（Simulator）、綜合器（Synthesizer）和配置器（Place and Routing, P&R）等幾個特殊的軟件包中的一個或多個，因此這一領域的EDA工具就不包括Protel、PSpice、Ewb等原理圖和PCB板設計及電路仿真軟件。目前流行的EDA工具軟件有兩種分類方法：一種是按公司類別進行分類，另一種是按功能進行劃分。若按公司類別分，大體可分兩類：一類是EDA 專業(yè)軟件公司，業(yè)內最著名的三家公司是Cadence、Synopsys和Mentor Graphics；另一類是PLD器件廠商為了銷售其產品而開發(fā)的EDA工具，較著名的公司有Altera、Xilinx、lattice等。前者獨立于半導體器件廠商，具有良好的標準化和兼容性，適合于學術研究單位使用，但系統(tǒng)復雜、難于掌握且價格昂貴；后者能針對自己器件的工藝特點作出優(yōu)化設計，提高資源利用率，降低功耗，改善性能，比較適合產品開發(fā)單位使用。若按功能分，大體可以分為以下三類。 (1) 集成的PLD/FPGA開發(fā)環(huán)境由半導體公司提供，基本上可以完成從設計輸入（原理圖或HDL）→仿真→綜合→布線→下載到器件等囊括所有PLD開發(fā)流程的所有工作。如Altera公司的MaxplusⅡ、QuartusⅡ，Xilinx公司的ISE，Lattice公司的 ispDesignExpert等。其優(yōu)勢是功能全集成化，可以加快動態(tài)調試，縮短開發(fā)周期；缺點是在綜合和仿真環(huán)節(jié)與專業(yè)的軟件相比，都不是非常優(yōu)秀的。 (2) 綜合類這類軟件的功能是對設計輸入進行邏輯分析、綜合和優(yōu)化，將硬件描述語句（通常是系統(tǒng)級的行為描述語句）翻譯成最基本的與或非門的連接關系（網表），導出給PLD/FPGA廠家的軟件進行布局和布線。為了優(yōu)化結果，在進行較復雜的設計時，基本上都使用這些專業(yè)的邏輯綜合軟件，而不采用廠家提供的集成PLD/FPGA開發(fā)工具。如Synplicity公司的Synplify、Synopsys公司的FPGAexpress、FPGA Compiler Ⅱ等。 (3) 仿真類這類軟件的功能是對設計進行模擬仿真，包括布局布線（P&R）前的“功能仿真”（也叫“前仿真”）和P&R后的包含了門延時、線延時等的“時序仿真”（也叫“后仿真”）。復雜一些的設計，一般需要使用這些專業(yè)的仿真軟件。因為同樣的設計輸入，專業(yè)軟件的仿真速度比集成環(huán)境的速度快得多。此類軟件最著名的要算Model Technology公司的Modelsim，Cadence公司的NC-Verilog/NC-VHDL/NC-SIM等。以上介紹了一些具代表性的EDA 工具軟件。它們在性能上各有所長，有的綜合優(yōu)化能力突出，有的仿真模擬功能強，好在多數工具能相互兼容，具有互操作性。比如Altera公司的 QuartusII集成開發(fā)工具，就支持多種第三方的EDA軟件，用戶可以在QuartusII軟件中通過設置直接調用Modelsim和 Synplify進行仿真和綜合。如果設計的硬件系統(tǒng)不是很大，對綜合和仿真的要求不是很高，那么可以在一個集成的開發(fā)環(huán)境中完成整個設計流程。如果要進行復雜系統(tǒng)的設計，則常規(guī)的方法是多種EDA工具協(xié)調工作，集各家之所長來完成設計流程。

標簽： EDA 編輯邏輯

上傳時間： 2013-10-11

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Cadence PSD 15.0版本功能介紹

隨著PCB設計復雜程度的不斷提高，設計工程師對 EDA工具在交互性和處理復雜層次化設計功能的要求也越來越高。Cadence Design Systems, Inc. 作為世界第一的EDA工具供應商，在這些方面一直為用戶提供業(yè)界領先的解決方案。在 Concept-HDL15.0中，這些功能又得到了大度地提升。首先，Concept-HDL15.0，提供了交互式全局屬性修改刪除，以及全局器件替換的圖形化工作界面。在這些全新的工作環(huán)境中，用戶可以在圖紙，設計，工程不同的級別上對器件，以及器件/線網的屬性進行全局性的編輯。

標簽： Cadence 15.0 PSD 版本

上傳時間： 2013-11-12

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pcb布線經驗精華

布線需要考慮的問題很多，但是最基本的的還是要做到周密，謹慎。寄生元件危害最大的情況印刷電路板布線產生的主要寄生元件包括：寄生電阻、寄生電容和寄生電感。例如：PCB 的寄生電阻由元件之間的走線形成；電路板上的走線、焊盤和平行走線會產生寄生電容；寄生電感的產生途徑包括環(huán)路電感、互感和過孔。當將電路原理圖轉化為實際的PCB 時，所有這些寄生元件都可能對電路的有效性產生干擾。本文將對最棘手的電路板寄生元件類型— 寄生電容進行量化，并提供一個可清楚看到寄生電容對電路性能影響的示例。

標簽： pcb 布線經驗

上傳時間： 2013-10-13

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PXI技術概覽與規(guī)范最新發(fā)展

　　過去十五年以來，自動化測試領域出現了一些明顯的趨勢：從設計到生產的每個階段，自動化程度越來越高；單一的待測設備往往集成了多種的標準和協(xié)議；從商業(yè)角度考慮，縮短產品投放市場時間的壓力也與日俱增；與此同時，著眼于整個經濟環(huán)境的大背景下，各個企業(yè)也都面臨著更加嚴峻的成本控制要求；此外，對制造業(yè)的自動化測試而言，測試設備的體積和功耗已經無法再隨著測試需求線形增長。　　PXI 平臺的出現為自動化測試提供了一種新的思路。 N I 于 1997 年提出 PXI 標準，標準化的商業(yè)技術讓 PXI 技術在過去十五年中以驚人的速度在測試和控制應用領域得到廣泛的接受，并且已經成為主流的模塊化儀器平臺。不僅得到眾多主流測試測量廠商的支持，而且全球各地的用戶基于 PXI 平臺在多個領域實現各種不同的應用。本文將對 PXI 規(guī)范進行概述并介紹一些最新發(fā)展及應用。　　PXI（PCI eXtensions for Instrumentatio n）是一種基于PC技術的面向測試測量和自動化應用的堅固平臺。 PXI 標準將 Com pactPCI 標準（具有 PCI 電氣總線特性，同時具有堅固的、模塊化的歐卡封裝）與專用同步總線和軟件特性結合在一起。該標準由 PXI 系統(tǒng)聯(lián)盟（ PXIS A ）進行管理，這是一個由世界各地超過 50 家公司共同簽約的聯(lián)盟，其宗旨是為了推動 PXI 標準的應用，保證各廠商產品的互操作性，并維護 PXI 規(guī)范。

標簽： PXI 發(fā)展

上傳時間： 2014-12-08

上傳用戶：feifei0302
基于1641的面向信息模型ATE應用解決方案

多年來，自動測試系統(tǒng)經歷了從專用型向通用型、開放性的發(fā)展歷程，ATS作為計算機技術的一個特定領域，一直都是緊隨計算機技術的發(fā)展，而如今計算機技術發(fā)展到互聯(lián)網階段，信息模型的概念為測試領域發(fā)展帶來新的階段，IEEE 1641標準充分解決了ATE的互操作和TPS可移植的問題，最大限度地降低了ATS生命周期的維護費用，具有顯著的軍事及經濟效應。

標簽： 1641 ATE 信息模型方案

上傳時間： 2013-10-13

上傳用戶：busterman