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交通信號燈

  • 485通信仿真源碼.rar

    關于485通信的一些資料 和自己寫的一個仿真 三機通訊(一個主機,2個從機)

    標簽: 485 通信 仿真

    上傳時間: 2013-06-18

    上傳用戶:gzming

  • GSM數字移動通信系統培訓教材.rar

    通信技術新手入門資料,手機軟件開發 GSM數字移動通信系統培訓教材.pdf

    標簽: GSM 數字移動 培訓教材

    上傳時間: 2013-04-24

    上傳用戶:西伯利亞狼

  • 通信電路.rar

    通信電路,主要為高頻電路,發射電路、接受電路、高頻放大、功率放大等電路。

    標簽: 通信電路

    上傳時間: 2013-06-14

    上傳用戶:zsjinju

  • 基于FPGA的直擴通信系統的同步設計與實現.rar

    擴頻通信技術因為具有較強的抗干擾、抗噪聲、抗多徑衰落能力、較好的保密性、較強的多址能力和高精度測量等優點,在軍事抗干擾和個人通信業務中得到了很大的發展。尤其是基于擴頻理論的CDMA通信技術成為國際電聯規定的第三代移動通信系統的主要標準化建議后,標志著擴頻通信技術在民用通信領域的應用進入了新階段。 近年來,隨著微電子技術和電子設計自動化(EDA)技術的迅速發展,以FPGA和CPLD為代表的可編程邏輯器件憑借其設計方便靈活等特點廣泛應用于數字信號處理領域。 本論文正是采用基于FPGA硬件平臺來實現了一個直接序列擴頻通信基帶系統,該系統的實現涉及擴頻通信和有關FPGA的相關知識,以及實現這些模塊的VHDL硬件描述語言和QuartusⅡ開發平臺,目標是實現一個集成度高、靈活性強、并具有較強的數據處理能力的擴頻通信基帶系統。 本論文中首先對擴頻通信的基礎理論做了探討,著重對直序擴頻的理論進行了分析;其次根據理論分析,設計了全數字直接序列擴頻基帶系統的結構,完成了擴頻序列的產生、信息碼的輸入和擴頻。重點完成了對基帶擴頻信號的相關解擴和幾種同步捕獲電路的設計,將多種專用芯片的功能集成在一片大規模FPGA芯片上。在論文中列出了部分模塊的VHDL程序,并在QuartusⅡ仿真平臺上完成各部分模塊的功能仿真。

    標簽: FPGA 直擴通信 同步設計

    上傳時間: 2013-04-24

    上傳用戶:chenjjer

  • 基于FPGA通信原理實驗系統的研究.rar

    通信與信息技術行業飛速發展,已成為我國支柱產業之一。隨著該行業的迅速發展,社會對具備實際動手能力人才的需求也不斷增加,高校通信教學改革勢在必行。在最初的通信原理實驗設備中每個實驗獨立占用一塊硬件資源,隨著EDA技術的發展,實驗設備廠商將CPLD/FPGA技術作為獨立的一項實驗內容,加入到通信原理實驗設備中。FPGA技術具備集成度高、速度快和現場可編程的優勢,適合高集成度和高速的時序運算。本文總結現有通信原理實驗設備的優缺點,采用FPGA技術設計出集驗證性和設計性于一體,具備較高的綜合性和系統性的通信原理實驗系統。  本系統提供了一個開放性的硬件、軟件平臺,從培養學生實際動手能力出發,利用FPGA在通用的硬件上實現所有實驗內容。學生在本系統上除了能完成已固化的實驗內容,還可以實現電子設計開發和驗證。這對培養學生的實踐能力大有裨益。  本文結合數字通信系統基本模型,把基于FPGA的通信原理實驗系統劃分為信號源模塊、發送端模塊、信道仿真模塊、接收端模塊和同步模塊幾部分。其中,模擬信號源采用DDS技術,能夠生成非常高的頻率精度,可作為任意波形發生器。發送端和接收端模塊結合到一起組成多體制調制解調器,形成多頻段、多波形的軟件無線電系統。載波同步采用全數字COSTAS環提取技術,具備良好的載波跟蹤特性,利用對載波相位不敏感 的Gardner算法跟蹤位同步信號。  本文首先介紹了通信原理實驗系統的研究現狀和意義;然后根據通信系統模型從《通信原理》各個章節中提煉出各模塊的實驗內容,分別列出各實驗的數字化實現模型;繼而根據各模塊資源需求選取合適FPGA芯片,并給出硬件設計方案;最后,給出各模塊在FPGA上具體實現過程、系統測試結果及分析。測試和實際運行結果表明設計方法正確,且功能和技術指標滿足設計要求。 關鍵詞:通信原理,實驗系統,FPGA,DDS,多體制調制解調,全數字COSTAS環,位同步

    標簽: FPGA 通信原理 實驗系統

    上傳時間: 2013-07-07

    上傳用戶:evil

  • TCN多功能車輛通信總線的FPGA設計.rar

    隨著列車自動化控制和現場總線技術的發展,基于分布式控制系統的列車通信網絡技術TCN(IEC-61375)在現代高速列車上得到廣泛應用。TCN協議將列車通信網絡分為絞線式列車總線WTB和多功能車輛總線MVB,其中WTB實現對開式列車中的互聯車輛間的數據傳輸和通信,MVB實現車載設備的協同工作和互相交換信息。 本文介紹了國內外列車通信網絡的發展情況和各自優勢,分析了MVB一類設備底層協議。研究利用FPGA實現MVB控制芯片MVBC,用ARM作為微處理器實現MVB一類設備的嵌入式解決方案。其中,在FPGA芯片中主要采用自頂向下的設計方法,RLT硬件描述語言實現MVB控制芯片MVBC一類設備的主要功能,包括幀編碼器、幀解碼器和邏輯接口單元。ARM主要完成了軟件程序的編寫和實時操作系統的移植。在eCos實時操作系統上,完成了驅動和上層應用程序,包括端口初始化、端口配置、幀收發指令和報文分析。 為了驗證設計的正確性,在設計的硬件平臺基礎上,搭建了MVB通信網絡的最小系統,對網絡進行系統功能測試。測試結果表明:設計方案正確,達到了設計的預期要求。

    標簽: FPGA TCN 多功能

    上傳時間: 2013-08-03

    上傳用戶:bruce5996

  • OFDM系統同步及解調的FPGA實現.rar

    自20世紀80年代以來,正交頻分復用技術不但在廣播式數字音頻和視頻領域得到廣泛的應用,而且已經成為無線局域網標準(例如IEEE802.11a和HiperLAN/2等)的一部分。OFDM由于其頻譜利用率高,成本低等原因越來越受到人們的關注。隨著人們對通信數據化、寬帶化、個人化和移動化需求的增強,OFDM技術在綜合無線接入領域將會獲得越來越廣泛的應用。人們開始集中越來越多的精力開發OFDM技術在移動通信領域的應用,本文也是基于無線通信平臺上的OFDM技術的運用。 本文的所有內容都是建立在空地數據無線通信系統下行鏈路FPGA實現基礎上的。本文作者的主要工作集中在鏈路接收端的FPGA實現和調試上。主要包括幀同步(時間同步)算法的研究與設計、OFDM頻率同步算法的研究與設計以及同步模塊、OFDM解調模塊、QAM解調模塊的FPGA實現。最終實現高速數字圖像傳輸系統下行鏈路在無線環境中連通。 對于無線移動通信系統而言,多普勒頻移、收發設備的本地載頻偏差均可能破壞OFDM系統子載波之間的正交性,從而導致ICI,影響系統性能。另外,由于OFDM系統大多采用IFFT/FFT實現調制解調,因此在接收方確定FFT的起點對數據的正確解調也至關重要。同步技術即是針對系統中存在的定時偏差、頻率偏差進行定時、頻偏的估計與補償,來減少各種同步偏差對系統性能的影響。在OFDM實現的關鍵技術中,同步技術是十分重要的一部分。本文花費了三個章節闡述了同步技術的原理、算法和實現方法。 目前OFDM系統的載波同步方案,可以歸納為三大類:輔助數據類,盲估計類和基于循環前綴的半盲估計類。本文首先分析了各種載波同步方案的優缺點,并舉例說明了各個載波同步方式的實現方法。然后具體闡述了本文在FPGA平臺上實現的OFDM接收端同步的同步方式,包括其具體算法和FPGA實現結構。本文所采用的幀同步和頻率同步方案都是采用輔助數據類的,在闡述其具體算法的同時對算法在不同參數和不同形式下的性能做出了仿真對比分析。 OFDM的解調采用FFT算法,在FPGA上的實現是十分方便的。本文主要闡述其實現結構,重點放在提取有效數據部分有效數據位置的推導過程。最后介紹了本文實現QAM軟解調的解調方法。 本文闡述算法采用先提出原理,然后給出具體公式,再根據公式中的系數和變量分析算法性能的方式。在闡述實現方式時首先給出實現框圖,然后對框圖中比較重要或者復雜的部分進行詳細闡述。在介紹完每個模塊實現方式之后給出了仿真或者上板結果,最后再給出整體測試結果。

    標簽: OFDM FPGA

    上傳時間: 2013-06-26

    上傳用戶:希醬大魔王

  • 基于FPGA的DDC在頻譜儀中的設計.rar

    軟件無線電思想的出現帶來了接收機實現方式的革新。隨著近年來軟件無線電理論和應用趨于成熟與完善,軟件無線電技術已經被越來越廣泛地應用于無線通信系統和電子測量測試儀器中。數字下變頻技術作為軟件無線電的核心技術之一,在頻譜分析儀中也得到了越來越普遍的應用。 本人參與的手持式頻譜分析儀項目采用的是中頻數字化實現方式,可滿足輕巧,可重配置和低功耗的需求。數字化中頻的關鍵部件數字下變頻器DDC采用的是Intersil公司的ISL5216,這個器件和高性能FPGA共同組成手持頻譜儀的數字信號處理前端。這個數字前端就手持頻譜分析儀來說存在一定的局限性,ISL5216的信號處理帶寬單通道為1 MHz,4個通道級聯為3MHz,未能滿足譜儀分析帶寬日益增加的需求;系統集成度不高,ISL5216的功能要是集成到FPGA,可進一步提高系統集成度,降低物料成本和系統功耗。基于以上兩個方面的考慮,現正以手持頻譜分析儀項目為依托,基于Xilinx Spartan3A-DSP系列FPGA實現高速高處理帶寬的DDC。 本論文首先描述了數字下變頻基本理論和結構,對完成各級數字信號處理所涉及的數字正交變換、CORDIC算法、CIC、HB、多相濾波等關鍵算法做了適當介紹;然后介紹了當前主流FPGA的數字信號處理特性和其內部的DSP資源。接著詳細描述了數控振蕩器NCO、復數數字混頻器MIXER、5級CIC濾波器、5級HB濾波器和255階可編程FIR的設計和實現,并對各個模塊的不同實現方式作了對比和仿真測試數據作了分析。最后介紹了所設計DDC在手持頻譜分析儀中的主要應用。

    標簽: FPGA DDC 頻譜儀

    上傳時間: 2013-04-24

    上傳用戶:a155166

  • 基于FPGA的小型CPU中通信協議的研究及IPCore的開發.rar

    FPGA作為新一代集成電路的出現,引起了數字電路設計的巨大變革。隨著FPGA工藝的不斷更新與改善,越來越多的用戶與設計公司開始使用FPGA進行系統開發,因此,PFAG的市場需求也越來越高,從而使得FPGA的集成電路板的工藝發展也越來越先進,在如此良性循環下,不久的將來,FPGA可以主領集成電路設計領域。正是由于FPGA有著如此巨大的發展前景與市場吸引力,因此,本文采用FPGA作為電路設計的首選。 @@ 隨著FPGA的開發技術日趨簡單化、軟件化,從面向硬件語言的VHDL、VerilogHDL設計語言,到現在面向對象的System Verilog、SystemC設計語言,硬件設計語言開始向高級語言發展。作為一個軟件設計人員,會很容易接受面向對象的語言。現在軟件的設計中,算法處理的瓶頸就是速度的問題,如果采用專用的硬件電路,可以解決這個問題,本文在第一章第二節詳細介紹了軟硬結合的開發優勢。另外,在第一章中還介紹了知識產權核心(IP Core)的發展與前景,特別是IP Core中軟核的設計與開發,許多FGPA的開發公司開始爭奪軟核的開發市場。 @@ 數字電路設計中最長遇到的就是通信的問題,而每一種通信方式都有自己的協議規范。在CPU的設計中,由于需要高速的處理速度,因此其內部都是用并行總線進行通信,但是由于集成電路資源的問題,不可能所有的外部設備都要用并行總線進行通信,因此其外部通信就需要進行串行傳輸。又因為需要連接的外部設備的不同,因此就需要使用不同的串行通信接口。本文主要介紹了小型CPU中常用的三種通信協議,那就是SPI、I2C、UART。除了分別論述了各自的通信原理外,本文還特別介紹了一個小型CPU的內部構造,以及這三個通信協議在CPU中所處的位置。 @@ 在硬件的設計開發中,由于集成電路本身的特殊性,其開發流程也相對的復雜。本文由于篇幅的問題,只對總的開發流程作了簡要的介紹,并且將其中最復雜但是又很重要的靜態時序分析進行了詳細的論述。在通信協議的開發中,需要注意接口的設計、時序的分析、驗證環境的搭建等,因此,本文以SPI數據通信協議的設計作為一個開發范例,從協議功能的研究到最后的驗證測試,將FPGA 的開發流程與關鍵技術等以實例的方式進行了詳細的論述。在SPI通信協議的開發中,不僅對協議進行了詳細的功能分析,而且對架構中的每個模塊的設計都進行了詳細的論述。@@關鍵詞:FPGA;SPI;I2C;UART;靜態時序分析;驗證環境

    標簽: IPCore FPGA CPU

    上傳時間: 2013-04-24

    上傳用戶:vvbvvb123

  • 多載波擴頻通信的Rake接收機理論研究及FPGA實現.rar

    由于移動環境的復雜性,無線信號在發送傳輸和接收過程中有很明顯的衰落現象,特別是在高頻無線通信中,多徑衰落或頻率選擇性衰落對無線信號的干擾最為嚴重。通過分集接收技術,Rake接收機在CDMA移動通信系統中抗多徑衰落效果尤為明顯。作為一種新穎的多址接入方式,多載波CDMA充分利用了OFDM最優頻率利用率以及CDMA的多址和頻率分集,且系統容量和抗符號間干擾性能明顯優于傳統的單載波CDMA。這些特性使得多載波CDMA成為未來的寬帶無線通信系統最有希望的候選。 @@ 本文研究了一種多載波擴頻通信系統,介紹了其Rake接收機工作原理和設計思想,進行了理論仿真并用FPGA予以實現。 @@ 本文首先介紹了移動通信系統的發展歷史以及OFDM和CDMA技術原理,并描述了OFDM和CDMA結合的三種系統(MC-DS-CDMA、MT-CDMA、MC-CDMA)的原理和系統模型;接著,介紹了目前影響移動通信的主要衰落以及Rake接收機基本原理及其作用。多徑信號的每路信號都可能含有可以利用的信息,Rake接收機就是通過多個相關接收器接收多徑信號中各路信號,通過信道估計和信道補償消去信道因子的附加相位,并把他們合并在一起,以此來改善信號的信噪比和系統的可靠性;在此基礎上,論文提出了一種多載波擴頻通信系統的實現方案,并詳細介紹了其Rake接收機實現原理,給出了最大比合并時各種分徑數目下系統誤碼率的仿真圖;最后介紹了此方案中Rake接收機的FPGA硬件實現設計方案及其系統 測試結果。@@ 仿真結果顯示出隨著分集徑數的增加,系統的誤碼率顯著降低。表明Rake接收機抗多徑衰落效果顯著,且在多載波CDMA系統中其分集效果更好,實現相對簡單。最終Rake接收機的FPGA實現結果同理論仿真一致,時序通過,資源耗費不大,具有較大的實用價值。 @@關鍵詞:多載波擴頻通信,CDMA,Rake接收機,FPGA

    標簽: Rake FPGA 多載波

    上傳時間: 2013-07-25

    上傳用戶:axxsa

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