可編程邏輯器件FPGA(現(xiàn)場可編程門陣列)和CPLD(復(fù)雜可編程邏輯器件)越來越多的應(yīng)用于數(shù)字信號處理領(lǐng)域，與傳統(tǒng)的ASIC(專用集成電路)和DSP(數(shù)字信號處理器)相比，基于FPGA和CPLD實現(xiàn)的數(shù)字信號處理系統(tǒng)具有更高的實時性和可嵌入性，能夠方便地實現(xiàn)系統(tǒng)的集成與功能擴展。 FFT的硬件結(jié)構(gòu)主要包括蝶形處理器、存儲單元、地址生成單元與控制單元。本文提出的算法在蝶形處理器內(nèi)引入流水線結(jié)構(gòu)，提高了FFT的運算速度。同時，流水線寄存器能夠寄存蝶形運算中的公共項，這樣在設(shè)計蝶形處理器時只用到了一個乘法器和兩個加法器，降低了硬件電路的復(fù)雜度。 為了進(jìn)一步提高FFT的運算速度，本文在深入研究各種乘法器算法的基礎(chǔ)上，為蝶形處理器設(shè)計了一個并行乘法器。在實現(xiàn)該乘法器時，本文采用改進(jìn)的布斯算法，用以減少部分積的個數(shù)。同時，使用華萊士樹結(jié)構(gòu)和4-2壓縮器對部分積并行相加。 本文以32點復(fù)數(shù)FFT為例進(jìn)行設(shè)計與邏輯綜合。通過設(shè)計相應(yīng)的存儲單元，地址生成單元和控制單元完成FFT電路。電路的仿真結(jié)果與軟件計算結(jié)果相符，證明了本文所提出的算法的正確性。 另外，本文還對設(shè)計結(jié)果提出了進(jìn)一步的改進(jìn)方案，在乘法器內(nèi)加入一級流水線寄存器，使FFT的速度能夠提高到當(dāng)前速度的兩倍，這在實時性要求較高的場合具有極高的實用價值。
上傳時間： 2013-07-18
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本文主要介紹了基于FPGA的無線信道盲均衡器的設(shè)計與實現(xiàn),在算法上選擇了比較成熟的DDLMS和CMA相結(jié)合的算法,結(jié)構(gòu)上采用四路正交FIR濾波器模型.在設(shè)計的過程中我們采取了用MATLAB進(jìn)行算法仿真,VerilogHDL語言進(jìn)行FPGA設(shè)計的策略.在硬件描述語言的設(shè)計流程中,信道盲均衡器運用了Top-Down的模塊化設(shè)計方法,大大縮短了設(shè)計周期,提高了系統(tǒng)的穩(wěn)定性和可擴展性.測試結(jié)果表明均衡器所有的性能指標(biāo)均達(dá)到預(yù)定目標(biāo),且工作性能良好,均衡效果較為理想,能夠滿足指標(biāo)要求.本課題所設(shè)計和實現(xiàn)的信道盲均衡器,為FPGA芯片設(shè)計技術(shù)做了有益的探索性嘗試,對今后無線通信系統(tǒng)中的單芯片可編程系統(tǒng)(SOPC)的設(shè)計運用有著積極的借鑒意義.
上傳時間： 2013-07-11
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protues仿真rtl8019as 包含電路文件及.hex文件
上傳時間： 2013-04-24
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07電子設(shè)計大賽論文 2007年全國電子設(shè)計大賽論文（A~J題）
標(biāo)簽： 2007 全國電子 設(shè)計大賽 論文
上傳時間： 2013-05-26
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電力電子技術(shù)與Matlab仿真,很經(jīng)典的一本書籍！非常實用！
標(biāo)簽： Matlab 電力電子技術(shù) 仿真
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基于matlab的wimax數(shù)字中頻DUC的仿真
標(biāo)簽： matlab Wimax DUC 數(shù)字中頻
上傳時間： 2013-04-24
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本文介紹了移動通信信道的基本理論，對移動通信中的衰落信道進(jìn)行了分析和建模，在此基礎(chǔ)上通過使用matlab仿真軟件，采用相關(guān)算法編程對衰落信道進(jìn)行仿真，結(jié)果表明了信道分析的有效性。
上傳時間： 2013-07-06
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edison是一款是虛擬的電路仿真軟件，它通過3D模擬電路效果，使初學(xué)者學(xué)習(xí)電子技術(shù)更加的容易。實驗過程中圖聲光并茂。具有非常強的真實感，作出的電路實驗效果與實驗室所做實驗的效果一樣,是電子技校與其它電子相關(guān)專業(yè)必備的教學(xué)軟件?？梢源蟠筇岣邔W(xué)生的學(xué)習(xí)興趣和學(xué)習(xí)成績。
上傳時間： 2013-08-03
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電力電子簡便的仿真軟件，電力電子簡便的仿真軟件
上傳時間： 2013-07-31
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ADVISOR，挺好用的一款汽車仿真軟件
上傳時間： 2013-07-13
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