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低紋波

  • 基于FPGA的任意波形發(fā)生器的設(shè)計(jì)與實(shí)現(xiàn).rar

    隨著國民經(jīng)濟(jì)的發(fā)展和社會(huì)的進(jìn)步,人們?cè)絹碓叫枰憬莸慕煌üぞ撸瑥亩龠M(jìn)了汽車工業(yè)的發(fā)展,同時(shí)汽車發(fā)動(dòng)機(jī)檢測維修等相關(guān)行業(yè)也發(fā)展起來。在汽車發(fā)動(dòng)機(jī)檢測維修中,發(fā)動(dòng)機(jī)電腦(Electronic Control.Unit-ECU)檢測維修是其中最關(guān)鍵的部分。發(fā)動(dòng)機(jī)電腦根據(jù)發(fā)動(dòng)機(jī)的曲軸或凸輪軸傳感器信號(hào)控制發(fā)動(dòng)機(jī)的噴油、點(diǎn)火和排氣。所以,維修發(fā)動(dòng)機(jī)電腦時(shí),必須對(duì)其施加正確的信號(hào)。目前,許多發(fā)動(dòng)機(jī)的曲軸和凸輪軸傳感器信號(hào)已不再是正弦波和方波等傳統(tǒng)信號(hào),而是多種復(fù)雜波形信號(hào)。為了能夠提供這種信號(hào),本文研究并設(shè)計(jì)了一種能夠產(chǎn)生復(fù)雜波形的低成本任意波形發(fā)生器(Arbitrary Waveform Generator-AWG)。 本文提出的任意波形發(fā)生器依據(jù)直接數(shù)字頻率合成(Direct Digial FrequencySynthesis-DDFS)原理,采用自行設(shè)計(jì)現(xiàn)場可編程門陣列(FPGA)的方案實(shí)現(xiàn)頻率合成,擴(kuò)展數(shù)據(jù)存儲(chǔ)器存儲(chǔ)波形的量化幅值(波形數(shù)據(jù)),在微控制單元(MCU)的控制與協(xié)調(diào)下輸出頻率和相位均可調(diào)的信號(hào)。 任意波形發(fā)生器主要由用戶控制界面、DDFS模塊、放大及濾波、微控制器系統(tǒng)和電源模塊五部分組成。在設(shè)計(jì)中采用FPGA芯片EPF10K10QC208-4實(shí)現(xiàn)DDFS的硬件算法。波形調(diào)整及濾波由兩級(jí)放大電路來完成:第一級(jí)對(duì)D/A輸出信號(hào)進(jìn)行調(diào)整;第二級(jí)完成信號(hào)濾波及信號(hào)幅值和偏移量的調(diào)節(jié)。電源模塊利用三端集成穩(wěn)壓器進(jìn)行電壓值變換,利用極性轉(zhuǎn)換芯片ICL7660實(shí)現(xiàn)正負(fù)極性轉(zhuǎn)換。 該任意波形發(fā)生器與通用模擬信號(hào)源相比具有:輸出頻率誤差小,分辨率高,可產(chǎn)生任意波形,成本低,體積小,使用方便,工作穩(wěn)定等優(yōu)點(diǎn),十分適合汽車維修行業(yè)使用,具有較好的市場前景。

    標(biāo)簽: FPGA 任意波形發(fā)生器

    上傳時(shí)間: 2013-05-28

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  • 單片機(jī)產(chǎn)生準(zhǔn)確頻率正弦波的新方法.rar

    單片機(jī)產(chǎn)生正弦波,簡紹了單片機(jī)產(chǎn)生高精度正弦波的方法

    標(biāo)簽: 單片機(jī) 頻率 正弦波

    上傳時(shí)間: 2013-04-24

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  • 5kw正弦波逆變器的原理圖sch和pcb圖紙.rar

    完整的5000kw正弦波逆變器的原理圖sch和pcb圖紙 protel格式

    標(biāo)簽: 5kw sch pcb

    上傳時(shí)間: 2013-04-24

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  • 阮新波講義.rar

    阮新波資料,英文資料,包括其作品,大家速速來下載

    標(biāo)簽: 講義

    上傳時(shí)間: 2013-06-07

    上傳用戶:dylutao

  • 基于AVR單片機(jī)的三相spwm波.rar

    基于AVR單片機(jī)的三相spwm波.相位差120,稍為整一下,也可以搞成變頻

    標(biāo)簽: spwm AVR 單片機(jī)

    上傳時(shí)間: 2013-06-05

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  • 基于FPGA的變頻調(diào)速控制系統(tǒng)設(shè)計(jì)與實(shí)現(xiàn).rar

    如今電力電子電路的控制旨在實(shí)現(xiàn)高頻開關(guān)的計(jì)算機(jī)控制,并向著更高頻率、更低損耗和全數(shù)字化的方向發(fā)展。現(xiàn)場可編程門陣列器件(Field Programmable Gate Arrays)是近年來嶄露頭角的一類新型集成電路,它具有簡潔、經(jīng)濟(jì)、高速度、低功耗等優(yōu)勢,又具有全集成化、適用性強(qiáng),便于開發(fā)和維護(hù)(升級(jí))等顯著優(yōu)點(diǎn)。與單片機(jī)和DSP相比,F(xiàn)PGA的頻率更高、速度更快,這些特點(diǎn)順應(yīng)了電力電子電路的日趨高頻化和復(fù)雜化發(fā)展的需要。因此,在越來越多的領(lǐng)域中FPGA得到了日益廣泛的發(fā)展和應(yīng)用。 本文提出了一種采用現(xiàn)場可編程門陣列(FPGA)器件實(shí)現(xiàn)數(shù)字化變頻調(diào)速控制系統(tǒng)的設(shè)計(jì)方案。該系統(tǒng)能產(chǎn)生三相六路正弦脈寬調(diào)制(SPWM)波形;調(diào)制頻率范圍為0~4KHZ,分7級(jí)控制;16位的速度控制分辨率;載波頻率分8級(jí)控制,最高可達(dá)24KHZ;系統(tǒng)接口兼容Intel系列和Motorola系列單片機(jī);該系統(tǒng)控制簡單、精確,易修改,可現(xiàn)場編程;同時(shí)具有脈沖延時(shí)小、最小脈沖刪除、過壓和過流保護(hù)功能等特點(diǎn),可應(yīng)用于PWM變頻調(diào)速系統(tǒng)的全數(shù)字化控制。文中對(duì)方案的實(shí)現(xiàn)進(jìn)行了詳細(xì)的論述,主要包括系統(tǒng)設(shè)計(jì)的理論分析,系統(tǒng)結(jié)構(gòu)設(shè)計(jì)及在FPGA硬件上的實(shí)現(xiàn),最終驗(yàn)證了該控制系統(tǒng)的可行性和有效性。 數(shù)字化設(shè)計(jì)是本系統(tǒng)的特點(diǎn),系統(tǒng)最終生成的三相SPWM脈沖是基于三相正弦調(diào)制波和三角載波比較得到的。設(shè)計(jì)時(shí),充分結(jié)合FPGA器件的結(jié)構(gòu)特點(diǎn),利用一種改進(jìn)結(jié)構(gòu)的數(shù)字控制振蕩器(NCO)來產(chǎn)生正弦波樣本,在一定程度上解決了傳統(tǒng)NCO產(chǎn)生正弦波的精度和頻率相互制約的問題;把分時(shí)復(fù)用數(shù)字通信原理結(jié)合到系統(tǒng)的設(shè)計(jì)中,設(shè)計(jì)出分時(shí)運(yùn)算電路,使得系統(tǒng)在同步時(shí)鐘下,生成三相正弦調(diào)制波而不影響系統(tǒng)的速度,同三角載波邏輯比較后,最終得到三相SPWM脈沖序列。

    標(biāo)簽: FPGA 變頻調(diào)速控制 系統(tǒng)設(shè)計(jì)

    上傳時(shí)間: 2013-07-05

    上傳用戶:duoshen1989

  • 射頻低噪聲放大器的ADS設(shè)計(jì)

    射頻低噪聲放大器的ADS設(shè)計(jì):本文首先簡要介紹了低噪聲放大器設(shè)計(jì)的理論基礎(chǔ),并以2.1-2.4Ghz 低噪聲放大器為例,詳細(xì)闡述了如何利用Agilent 公司的ADS 軟件進(jìn)行分析和優(yōu)化設(shè)計(jì)該電

    標(biāo)簽: ADS 射頻 低噪聲放大器

    上傳時(shí)間: 2013-06-18

    上傳用戶:han_zh

  • 低功耗四通道電壓監(jiān)測集成電路CN1185

    CN1185是一款低功耗四通道電壓監(jiān)測芯片,其消耗的電流只有7.3微安,非常適合監(jiān)測電池電壓。芯片內(nèi)部包含四個(gè)電壓比較器,每個(gè)比較器的正輸入端接到芯片內(nèi)部的電壓基準(zhǔn)源,可以用來監(jiān)測4個(gè)不同的電壓

    標(biāo)簽: 1185 CN 低功耗 四通道

    上傳時(shí)間: 2013-06-21

    上傳用戶:yuanyuan123

  • 基于模糊增強(qiáng)和小波包變換的人臉識(shí)別方法

    針對(duì)目前光照補(bǔ)償后人臉圖像的識(shí)別率仍不夠理想這一問題,提出了一種基于模糊增強(qiáng)和小波包變換相結(jié)合的非均勻光照下人臉識(shí)別方法。將人臉圖像在對(duì)數(shù)域中計(jì)算二維小波包變換,通過舍棄部分子帶圖像中的系數(shù)來實(shí)現(xiàn)人臉

    標(biāo)簽: 模糊 變換 人臉識(shí)別方法

    上傳時(shí)間: 2013-04-24

    上傳用戶:gxf2016

  • 基于FPGA的甚短距離高速并行光傳輸系統(tǒng)研究

    甚短距離傳輸(VSR)是一種用于短距離(約300 m~600m)內(nèi)進(jìn)行數(shù)據(jù)傳輸?shù)墓鈧鬏敿夹g(shù).它主要應(yīng)用于網(wǎng)絡(luò)中的交換機(jī)、核心路由器(CR)、光交叉連接設(shè)備(OXC)、分插復(fù)用器(ADM)和波分復(fù)用(WDM)終端等不同層次設(shè)備之間的互連,具有構(gòu)建方便、性能穩(wěn)定和成本低等優(yōu)點(diǎn),是光通信技術(shù)發(fā)展的一個(gè)全新領(lǐng)域,逐漸成為國際通用的標(biāo)準(zhǔn)技術(shù),成為全光網(wǎng)的一個(gè)重要組成部分. 本文深入研究了VSR并行光傳輸系統(tǒng),完成了VSR技術(shù)的核心部分--轉(zhuǎn)換器子系統(tǒng)的設(shè)計(jì)與實(shí)現(xiàn),使用現(xiàn)場可編程陣列FPGA(Field Programmable GateArray)來完成轉(zhuǎn)換器電路的設(shè)計(jì)和功能實(shí)現(xiàn).深入研究現(xiàn)有VSR4-1.0和VSR4-3.0兩種并行傳輸標(biāo)準(zhǔn),在其技術(shù)原理的基礎(chǔ)上,提出新的VSR并行方案,提高了多模光纖帶的信道利用率,充分利用系統(tǒng)總吞吐量大的優(yōu)勢,為將來向更高速率升級(jí)提供了依據(jù).根據(jù)萬兆以太網(wǎng)的技術(shù)特點(diǎn)和傳輸要求,提出并設(shè)計(jì)了用VSR技術(shù)實(shí)現(xiàn)局域和廣域萬兆以太網(wǎng)在較短距離上的高速互連的系統(tǒng)方案,成功地將VSR技術(shù)移植到萬兆以太網(wǎng)上,實(shí)現(xiàn)低成本、構(gòu)建方便和性能穩(wěn)定的高速短距離傳輸. 本文所有的設(shè)計(jì)均在Altera Stratix GX系列FPGA的EP1SGX25F1020C7上實(shí)現(xiàn),采用Altera的Quartus Ⅱ開發(fā)工具和 Verilog HDL硬件描述語言完成了VSR4-1.0轉(zhuǎn)換器集成電路和萬兆以太網(wǎng)的SERDES的設(shè)計(jì)和仿真,并給出了各模塊的電路結(jié)構(gòu)和仿真結(jié)果.仿真的結(jié)果表明,所有的設(shè)計(jì)均能正確的實(shí)現(xiàn)各自的功能,完全能夠滿足10Gb/s高速并行傳輸系統(tǒng)的要求.

    標(biāo)簽: FPGA 短距離 光傳輸 高速并行

    上傳時(shí)間: 2013-07-14

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