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使用知識

  • 使用FPGA模擬實現(xiàn)8051單片機(jī)及其外設(shè)的功能

    隨著電子技術(shù)的發(fā)展,當(dāng)前數(shù)字系統(tǒng)的設(shè)計正朝著速度快、容量大、體積小、重量輕的方向發(fā)展.FPGA以其功能強(qiáng)大,開發(fā)過程投資少、周期短,可反復(fù)修改,保密性能好,開發(fā)工具智能化等特點(diǎn)成為當(dāng)今硬件設(shè)計的首選方式之一.由于Intel公司的MCS-51系列單片機(jī)被公認(rèn)為8位機(jī)的工業(yè)標(biāo)準(zhǔn),因此,使用FPGA模擬實現(xiàn)8051單片機(jī)及其外設(shè)的功能便成為大規(guī)模復(fù)雜數(shù)字系統(tǒng)設(shè)計中的重要課題.該文首先介紹了FPGA及Xilinx公司關(guān)于硬件設(shè)計開發(fā)的工具ISE系統(tǒng),繼而用VHDL語言編寫了8051單片機(jī)功能實現(xiàn)的源代碼,然后為其設(shè)計了與部分外設(shè)連接的接口模塊,包括8255并行接口、SCI串行接口和KBC鍵盤接口模塊.并將它們封裝到一塊FPGA之中,最終實現(xiàn)了8051單片機(jī)的大部分功能.

    標(biāo)簽： FPGA 8051 模擬 單片機(jī)

    上傳時間： 2013-07-28

    上傳用戶：erkuizhang

  • 英飛凌公司DAVE2．O軟件的使用

    介紹了Infineon(英飛凌)公司DAVE2．O軟件的使用方法和一些需注意的要點(diǎn)，并按照流程編寫了一個“Infineon XC164CM”的閃燈測試程序

    標(biāo)簽： DAVE2 英飛凌 軟件

    上傳時間： 2013-07-13

    上傳用戶：牛布牛

  • CCS中的graph詳細(xì)使用說明

    CCS中的graph詳細(xì)使用說明

    標(biāo)簽： graph CCS 使用說明

    上傳時間： 2013-07-30

    上傳用戶：1043041441

  • Keil_uvision_4基本使用教程

    Keil_uvision_4軟件使用

    標(biāo)簽： Keil_uvision 使用教程

    上傳時間： 2013-04-24

    上傳用戶：jxfzjh

  • FilterLab 2.0使用手冊(pdf)

    FilterLab2.0使用教程,好東西哦

    標(biāo)簽： FilterLab 2.0 使用手冊

    上傳時間： 2013-07-19

    上傳用戶：lw852826

  • IAR使用教程

    IAR使用教程,IAR使用教程,IAR使用教程

    標(biāo)簽： IAR 使用教程

    上傳時間： 2013-06-18

    上傳用戶：哈哈hah

  • RS485使用手冊與指南

    RS485使用手冊與指南RS485使用手冊與指南RS485使用手冊與指南RS485使用手冊與指南

    標(biāo)簽： 485 RS 使用手冊

    上傳時間： 2013-07-05

    上傳用戶：dwzjt

  • Pspice中變壓器的使用

    教你如何在Cadence Pspice中使用變壓器

    標(biāo)簽： Pspice 變壓器

    上傳時間： 2013-05-23

    上傳用戶：飛翔的胸毛

  • Protues使用總線方式畫電路的方法

    Protues使用總線方式畫電路的方法 使用教程 適合初級新手

    標(biāo)簽： Protues 總線 方式 電路

    上傳時間： 2013-05-24

    上傳用戶：bcjtao

  • 卷積編碼和維特比譯碼的FPGA實現(xiàn)

    由于其很強(qiáng)的糾錯性能和適合硬件實現(xiàn)的編譯碼算法，卷積編碼和軟判決維特比譯碼目前已經(jīng)廣泛應(yīng)用于衛(wèi)星通信系統(tǒng)。然而隨著航天事業(yè)的發(fā)展，衛(wèi)星有效載荷種類的增多和分辨率的不斷提高，信息量越來越大。如何在低信噪比的功率受限信道條件下提高傳輸速率成為目前亟待解決的問題。本論文結(jié)合在研項目，在編譯碼算法、編譯碼器的設(shè)計與實現(xiàn)、編譯碼器性能提高三個方面對卷積編碼和維特比譯碼進(jìn)行了深入研究，并進(jìn)一步介紹了使用VHDL語言和原理圖混合輸入的方式，實現(xiàn)一種(7,3/4)增信刪余方式的高速卷積編碼器和維特比譯碼器的詳細(xì)過程；然后將設(shè)計下載到XILINX的Virtex2 FPGA內(nèi)部進(jìn)行功能和時序確認(rèn)，最終在整個數(shù)據(jù)傳輸系統(tǒng)中測試其性能。本文所實現(xiàn)的維特比譯碼器速率達(dá)160Mbps，遠(yuǎn)遠(yuǎn)高于目前國內(nèi)此領(lǐng)域內(nèi)的相關(guān)產(chǎn)品速率。 首先，論文具體介紹了卷積編碼和維特比譯碼的算法，研究卷積碼的各種參數(shù)(約束長度、生成多項式、碼率以及增信刪余等)對其譯碼性能的影響；針對項目需求，確定卷積編碼器的約束長度、生成多項式格式、碼率和相應(yīng)的維特比譯碼器的回歸長度。 其次，論文介紹了編解碼器的軟、硬件設(shè)計和調(diào)試一根據(jù)已知條件，使用VHDL語言和原理圖混合輸入的方式設(shè)計卷積編碼和維特比譯碼的源代碼和原理圖，分別采用功能和電路級仿真，確定卷積編碼和維特比譯碼分別需要占用的資源，考慮卷積編碼器和維特比譯碼器的具體設(shè)計問題，包括編譯碼的基本結(jié)構(gòu)，各個模塊的功能及實現(xiàn)策略，編譯碼器的時序、邏輯綜合等；根據(jù)軟件仿真結(jié)果，分別確定卷積編碼器和維特比譯碼器的接口、所需的FPGA器件選型和進(jìn)行各自的印制板設(shè)計。利用卷積碼本身的特點(diǎn)，結(jié)合FPGA內(nèi)部結(jié)構(gòu)，采用并行卷積編碼和譯碼運(yùn)算，設(shè)計出高速編譯碼器；對軟、硬件分別進(jìn)行驗證和調(diào)試，并將驗證后的軟件下載到FPGA進(jìn)行電路級調(diào)試。 最后，論文討論了卷積編碼和維特比譯碼的性能：利用已有的測試設(shè)備在整個數(shù)據(jù)傳輸系統(tǒng)中測試其性能(與沒有采用糾錯編碼的數(shù)傳系統(tǒng)進(jìn)行比對)；在信道中加入高斯白噪聲，模擬高斯信道，進(jìn)行誤碼率和信噪比測試。

    標(biāo)簽： FPGA 卷積 編碼 譯碼

    上傳時間： 2013-04-24

    上傳用戶：mingaili888

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