CPLD與8051的總線接口VHDL源碼
標簽： CPLD 8051 VHDL 總線接口
上傳時間： 2013-08-15
上傳用戶：yuchunhai1990
ACTEL的FPGA完整開發文擋 含測試源碼
標簽： ACTEL FPGA 測試 源碼
上傳時間： 2013-08-16
上傳用戶：kristycreasy
TMS3205402Verilog HDL源碼
標簽： 3205402 Verilog TMS HDL
上傳時間： 2013-08-17
上傳用戶：shizhanincc
基于FPGA的交通燈的設計 有Verilog HDL 源碼、仿真圖與引腳配置圖，已下載實現\r\n
標簽： Verilog FPGA HDL 交通燈
上傳時間： 2013-08-18
上傳用戶：BOBOniu
實現基于CPLD的CCD采集系統設計源碼
標簽： CPLD CCD 采集 系統設計
上傳用戶：pkzz021
基于FPGA的多功能數字鐘的設計與實現 內附有詳盡的Verilog HDL源碼，其功能主要有：時間設置，時間顯示，跑表，分頻，日期設置，日期顯示等
標簽： Verilog FPGA HDL 多功能
上傳用戶：問題問題
實時電話計費系統是企業、事業單位信息管理的一個重要組成部分。介紹了一種用FPGA 器件實現電話計費系統的方法, 并給出了設計框圖和詳細設計過程, 設計采用Verilog_HDL 硬件語言。
標簽： 電話 單位 信息管理 分
上傳用戶：manking0408
s3c2410開發板cpld源碼，希望有些參考價值
標簽： s3c2410 cpld 開發板 源碼
上傳時間： 2013-08-20
上傳用戶：wtrl
FPGA RSIC CPU設計文檔和源碼是EDA中對CPU設計非常好用的程序
標簽： CPU FPGA RSIC EDA
上傳時間： 2013-08-21
上傳用戶：cppersonal
通過fpga產生時鐘的VHDL源碼，QII7.1下調試通過
標簽： fpga VHDL 時鐘 源碼
上傳時間： 2013-08-24
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